TimeQuest Timing Analyzer report for lab5
Fri May  6 14:24:16 2016
Quartus Prime Version 15.1.1 Build 189 12/02/2015 SJ Lite Edition


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; Table of Contents ;
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  1. Legal Notice
  2. TimeQuest Timing Analyzer Summary
  3. Parallel Compilation
  4. Clocks
  5. Slow 1200mV 85C Model Fmax Summary
  6. Timing Closure Recommendations
  7. Slow 1200mV 85C Model Setup Summary
  8. Slow 1200mV 85C Model Hold Summary
  9. Slow 1200mV 85C Model Recovery Summary
 10. Slow 1200mV 85C Model Removal Summary
 11. Slow 1200mV 85C Model Minimum Pulse Width Summary
 12. Slow 1200mV 85C Model Setup: 'pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2]'
 13. Slow 1200mV 85C Model Setup: 'debounce_cnt[0]'
 14. Slow 1200mV 85C Model Setup: 'pll_lab5_inst|altpll_component|auto_generated|pll1|clk[1]'
 15. Slow 1200mV 85C Model Setup: 'digit_clk'
 16. Slow 1200mV 85C Model Hold: 'pll_lab5_inst|altpll_component|auto_generated|pll1|clk[1]'
 17. Slow 1200mV 85C Model Hold: 'debounce_cnt[0]'
 18. Slow 1200mV 85C Model Hold: 'digit_clk'
 19. Slow 1200mV 85C Model Hold: 'pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2]'
 20. Slow 1200mV 85C Model Metastability Summary
 21. Slow 1200mV 0C Model Fmax Summary
 22. Slow 1200mV 0C Model Setup Summary
 23. Slow 1200mV 0C Model Hold Summary
 24. Slow 1200mV 0C Model Recovery Summary
 25. Slow 1200mV 0C Model Removal Summary
 26. Slow 1200mV 0C Model Minimum Pulse Width Summary
 27. Slow 1200mV 0C Model Setup: 'pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2]'
 28. Slow 1200mV 0C Model Setup: 'debounce_cnt[0]'
 29. Slow 1200mV 0C Model Setup: 'pll_lab5_inst|altpll_component|auto_generated|pll1|clk[1]'
 30. Slow 1200mV 0C Model Setup: 'digit_clk'
 31. Slow 1200mV 0C Model Hold: 'pll_lab5_inst|altpll_component|auto_generated|pll1|clk[1]'
 32. Slow 1200mV 0C Model Hold: 'debounce_cnt[0]'
 33. Slow 1200mV 0C Model Hold: 'digit_clk'
 34. Slow 1200mV 0C Model Hold: 'pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2]'
 35. Slow 1200mV 0C Model Metastability Summary
 36. Fast 1200mV 0C Model Setup Summary
 37. Fast 1200mV 0C Model Hold Summary
 38. Fast 1200mV 0C Model Recovery Summary
 39. Fast 1200mV 0C Model Removal Summary
 40. Fast 1200mV 0C Model Minimum Pulse Width Summary
 41. Fast 1200mV 0C Model Setup: 'pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2]'
 42. Fast 1200mV 0C Model Setup: 'debounce_cnt[0]'
 43. Fast 1200mV 0C Model Setup: 'pll_lab5_inst|altpll_component|auto_generated|pll1|clk[1]'
 44. Fast 1200mV 0C Model Setup: 'digit_clk'
 45. Fast 1200mV 0C Model Hold: 'pll_lab5_inst|altpll_component|auto_generated|pll1|clk[1]'
 46. Fast 1200mV 0C Model Hold: 'debounce_cnt[0]'
 47. Fast 1200mV 0C Model Hold: 'digit_clk'
 48. Fast 1200mV 0C Model Hold: 'pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2]'
 49. Fast 1200mV 0C Model Metastability Summary
 50. Multicorner Timing Analysis Summary
 51. Board Trace Model Assignments
 52. Input Transition Times
 53. Signal Integrity Metrics (Slow 1200mv 0c Model)
 54. Signal Integrity Metrics (Slow 1200mv 85c Model)
 55. Signal Integrity Metrics (Fast 1200mv 0c Model)
 56. Setup Transfers
 57. Hold Transfers
 58. Report TCCS
 59. Report RSKM
 60. Unconstrained Paths Summary
 61. Clock Status Summary
 62. Unconstrained Input Ports
 63. Unconstrained Output Ports
 64. Unconstrained Input Ports
 65. Unconstrained Output Ports
 66. TimeQuest Timing Analyzer Messages



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; Legal Notice ;
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Copyright (C) 1991-2015 Altera Corporation. All rights reserved.
Your use of Altera Corporation's design tools, logic functions 
and other software and tools, and its AMPP partner logic 
functions, and any output files from any of the foregoing 
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that your use is for the sole purpose of programming logic 
devices manufactured by Altera and sold by Altera or its 
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; TimeQuest Timing Analyzer Summary                                           ;
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; Quartus Prime Version ; Version 15.1.1 Build 189 12/02/2015 SJ Lite Edition ;
; Timing Analyzer       ; TimeQuest                                           ;
; Revision Name         ; lab5                                                ;
; Device Family         ; Cyclone IV E                                        ;
; Device Name           ; EP4CE22F17C6                                        ;
; Timing Models         ; Final                                               ;
; Delay Model           ; Combined                                            ;
; Rise/Fall Delays      ; Enabled                                             ;
+-----------------------+-----------------------------------------------------+


Parallel compilation was disabled, but you have multiple processors available. Enable parallel compilation to reduce compilation time.
+-------------------------------------+
; Parallel Compilation                ;
+----------------------------+--------+
; Processors                 ; Number ;
+----------------------------+--------+
; Number detected on machine ; 2      ;
; Maximum allowed            ; 1      ;
+----------------------------+--------+


+-------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+
; Clocks                                                                                                                                                                                                                                                                                                                                                      ;
+-----------------------------------------------------------+-----------+------------+------------+-------+------------+------------+-----------+-------------+-------+--------+-----------+------------+----------+------------+-------------------------------------------------------------+---------------------------------------------------------------+
; Clock Name                                                ; Type      ; Period     ; Frequency  ; Rise  ; Fall       ; Duty Cycle ; Divide by ; Multiply by ; Phase ; Offset ; Edge List ; Edge Shift ; Inverted ; Master     ; Source                                                      ; Targets                                                       ;
+-----------------------------------------------------------+-----------+------------+------------+-------+------------+------------+-----------+-------------+-------+--------+-----------+------------+----------+------------+-------------------------------------------------------------+---------------------------------------------------------------+
; debounce_cnt[0]                                           ; Base      ; 1.000      ; 1000.0 MHz ; 0.000 ; 0.500      ;            ;           ;             ;       ;        ;           ;            ;          ;            ;                                                             ; { debounce_cnt[0] }                                           ;
; digit_clk                                                 ; Base      ; 1.000      ; 1000.0 MHz ; 0.000 ; 0.500      ;            ;           ;             ;       ;        ;           ;            ;          ;            ;                                                             ; { digit_clk }                                                 ;
; inclk0_sig                                                ; Base      ; 20.000     ; 50.0 MHz   ; 0.000 ; 10.000     ;            ;           ;             ;       ;        ;           ;            ;          ;            ;                                                             ; { inclk0_sig }                                                ;
; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[1] ; Generated ; 250000.000 ; 0.0 MHz    ; 0.000 ; 125000.000 ; 50.00      ; 12500     ; 1           ;       ;        ;           ;            ; false    ; inclk0_sig ; pll_lab5_inst|altpll_component|auto_generated|pll1|inclk[0] ; { pll_lab5_inst|altpll_component|auto_generated|pll1|clk[1] } ;
; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; Generated ; 59.607     ; 16.78 MHz  ; 0.000 ; 29.803     ; 50.00      ; 152       ; 51          ;       ;        ;           ;            ; false    ; inclk0_sig ; pll_lab5_inst|altpll_component|auto_generated|pll1|inclk[0] ; { pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] } ;
+-----------------------------------------------------------+-----------+------------+------------+-------+------------+------------+-----------+-------------+-------+--------+-----------+------------+----------+------------+-------------------------------------------------------------+---------------------------------------------------------------+


+-------------------------------------------------------------------------------------------------------------------------------------------+
; Slow 1200mV 85C Model Fmax Summary                                                                                                        ;
+------------+-----------------+-----------------------------------------------------------+------------------------------------------------+
; Fmax       ; Restricted Fmax ; Clock Name                                                ; Note                                           ;
+------------+-----------------+-----------------------------------------------------------+------------------------------------------------+
; 296.91 MHz ; 296.91 MHz      ; debounce_cnt[0]                                           ;                                                ;
; 364.03 MHz ; 315.06 MHz      ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; limit due to minimum period restriction (tmin) ;
; 643.92 MHz ; 500.0 MHz       ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[1] ; limit due to minimum period restriction (tmin) ;
; 666.22 MHz ; 500.0 MHz       ; digit_clk                                                 ; limit due to minimum period restriction (tmin) ;
+------------+-----------------+-----------------------------------------------------------+------------------------------------------------+
This panel reports FMAX for every clock in the design, regardless of the user-specified clock periods.  FMAX is only computed for paths where the source and destination registers or ports are driven by the same clock.  Paths of different clocks, including generated clocks, are ignored.  For paths between a clock and its inversion, FMAX is computed as if the rising and falling edges are scaled along with FMAX, such that the duty cycle (in terms of a percentage) is maintained. Altera recommends that you always use clock constraints and other slack reports for sign-off analysis.


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; Timing Closure Recommendations ;
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HTML report is unavailable in plain text report export.


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; Slow 1200mV 85C Model Setup Summary                                                ;
+-----------------------------------------------------------+--------+---------------+
; Clock                                                     ; Slack  ; End Point TNS ;
+-----------------------------------------------------------+--------+---------------+
; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; -5.344 ; -112.036      ;
; debounce_cnt[0]                                           ; -2.368 ; -31.522       ;
; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[1] ; -0.798 ; -2.342        ;
; digit_clk                                                 ; -0.501 ; -1.125        ;
+-----------------------------------------------------------+--------+---------------+


+------------------------------------------------------------------------------------+
; Slow 1200mV 85C Model Hold Summary                                                 ;
+-----------------------------------------------------------+--------+---------------+
; Clock                                                     ; Slack  ; End Point TNS ;
+-----------------------------------------------------------+--------+---------------+
; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[1] ; -0.207 ; -0.392        ;
; debounce_cnt[0]                                           ; 0.357  ; 0.000         ;
; digit_clk                                                 ; 0.361  ; 0.000         ;
; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.534  ; 0.000         ;
+-----------------------------------------------------------+--------+---------------+


------------------------------------------
; Slow 1200mV 85C Model Recovery Summary ;
------------------------------------------
No paths to report.


-----------------------------------------
; Slow 1200mV 85C Model Removal Summary ;
-----------------------------------------
No paths to report.


+----------------------------------------------------------------------------------------+
; Slow 1200mV 85C Model Minimum Pulse Width Summary                                      ;
+-----------------------------------------------------------+------------+---------------+
; Clock                                                     ; Slack      ; End Point TNS ;
+-----------------------------------------------------------+------------+---------------+
; debounce_cnt[0]                                           ; -1.000     ; -26.000       ;
; digit_clk                                                 ; -1.000     ; -3.000        ;
; inclk0_sig                                                ; 9.835      ; 0.000         ;
; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 29.550     ; 0.000         ;
; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[1] ; 124999.747 ; 0.000         ;
+-----------------------------------------------------------+------------+---------------+


+-------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+
; Slow 1200mV 85C Model Setup: 'pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2]'                                                                                                        ;
+--------+--------------------------------------------------+--------------+-----------------+-----------------------------------------------------------+--------------+------------+------------+
; Slack  ; From Node                                        ; To Node      ; Launch Clock    ; Latch Clock                                               ; Relationship ; Clock Skew ; Data Delay ;
+--------+--------------------------------------------------+--------------+-----------------+-----------------------------------------------------------+--------------+------------+------------+
; -5.344 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[0]  ; rom_addr[23] ; debounce_cnt[0] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.001        ; -2.229     ; 3.061      ;
; -5.256 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[2]  ; rom_addr[23] ; debounce_cnt[0] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.001        ; -2.229     ; 2.973      ;
; -5.238 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[0]  ; rom_addr[22] ; debounce_cnt[0] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.001        ; -2.229     ; 2.955      ;
; -5.228 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[0]  ; rom_addr[21] ; debounce_cnt[0] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.001        ; -2.229     ; 2.945      ;
; -5.200 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[3]  ; rom_addr[23] ; debounce_cnt[0] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.001        ; -2.229     ; 2.917      ;
; -5.178 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[3]  ; rom_addr[22] ; debounce_cnt[0] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.001        ; -2.229     ; 2.895      ;
; -5.145 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[2]  ; rom_addr[22] ; debounce_cnt[0] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.001        ; -2.229     ; 2.862      ;
; -5.140 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[2]  ; rom_addr[21] ; debounce_cnt[0] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.001        ; -2.229     ; 2.857      ;
; -5.122 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[0]  ; rom_addr[20] ; debounce_cnt[0] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.001        ; -2.229     ; 2.839      ;
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; -5.062 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[3]  ; rom_addr[20] ; debounce_cnt[0] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.001        ; -2.229     ; 2.779      ;
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; -4.867 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[1]  ; rom_addr[19] ; debounce_cnt[0] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.001        ; -2.216     ; 2.597      ;
; -4.863 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[8]  ; rom_addr[19] ; debounce_cnt[0] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.001        ; -2.229     ; 2.580      ;
; -4.857 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[8]  ; rom_addr[20] ; debounce_cnt[0] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.001        ; -2.229     ; 2.574      ;
; -4.852 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[3]  ; rom_addr[17] ; debounce_cnt[0] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.001        ; -2.229     ; 2.569      ;
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; -4.839 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[13] ; rom_addr[20] ; debounce_cnt[0] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.001        ; -2.229     ; 2.556      ;
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; -4.749 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[6]  ; rom_addr[22] ; debounce_cnt[0] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.001        ; -2.216     ; 2.479      ;
; -4.747 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[8]  ; rom_addr[17] ; debounce_cnt[0] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.001        ; -2.229     ; 2.464      ;
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; -4.737 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[11] ; rom_addr[22] ; debounce_cnt[0] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.001        ; -2.215     ; 2.468      ;
; -4.736 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[3]  ; rom_addr[15] ; debounce_cnt[0] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.001        ; -2.229     ; 2.453      ;
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; -4.717 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[13] ; rom_addr[19] ; debounce_cnt[0] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.001        ; -2.229     ; 2.434      ;
; -4.714 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[3]  ; rom_addr[14] ; debounce_cnt[0] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.001        ; -2.229     ; 2.431      ;
; -4.705 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[4]  ; rom_addr[20] ; debounce_cnt[0] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.001        ; -2.216     ; 2.435      ;
; -4.693 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[7]  ; rom_addr[23] ; debounce_cnt[0] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.001        ; -2.216     ; 2.423      ;
; -4.686 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[4]  ; rom_addr[19] ; debounce_cnt[0] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.001        ; -2.216     ; 2.416      ;
; -4.681 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[2]  ; rom_addr[14] ; debounce_cnt[0] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.001        ; -2.229     ; 2.398      ;
; -4.676 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[2]  ; rom_addr[13] ; debounce_cnt[0] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.001        ; -2.229     ; 2.393      ;
; -4.674 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[7]  ; rom_addr[22] ; debounce_cnt[0] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.001        ; -2.216     ; 2.404      ;
; -4.666 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[9]  ; rom_addr[21] ; debounce_cnt[0] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.001        ; -2.230     ; 2.382      ;
; -4.661 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[5]  ; rom_addr[21] ; debounce_cnt[0] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.001        ; -2.216     ; 2.391      ;
; -4.658 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[0]  ; rom_addr[12] ; debounce_cnt[0] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.001        ; -2.229     ; 2.375      ;
; -4.658 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[9]  ; rom_addr[20] ; debounce_cnt[0] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.001        ; -2.230     ; 2.374      ;
; -4.654 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[12] ; rom_addr[22] ; debounce_cnt[0] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.001        ; -2.215     ; 2.385      ;
; -4.646 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[0]  ; rom_addr[11] ; debounce_cnt[0] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.001        ; -2.227     ; 2.365      ;
; -4.641 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[1]  ; rom_addr[14] ; debounce_cnt[0] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.001        ; -2.216     ; 2.371      ;
; -4.639 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[6]  ; rom_addr[19] ; debounce_cnt[0] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.001        ; -2.216     ; 2.369      ;
; -4.635 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[1]  ; rom_addr[15] ; debounce_cnt[0] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.001        ; -2.216     ; 2.365      ;
; -4.633 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[5]  ; rom_addr[20] ; debounce_cnt[0] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.001        ; -2.216     ; 2.363      ;
; -4.633 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[6]  ; rom_addr[20] ; debounce_cnt[0] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.001        ; -2.216     ; 2.363      ;
; -4.631 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[8]  ; rom_addr[15] ; debounce_cnt[0] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.001        ; -2.229     ; 2.348      ;
; -4.628 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[10] ; rom_addr[20] ; debounce_cnt[0] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.001        ; -2.230     ; 2.344      ;
; -4.625 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[8]  ; rom_addr[16] ; debounce_cnt[0] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.001        ; -2.229     ; 2.342      ;
; -4.624 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[12] ; rom_addr[21] ; debounce_cnt[0] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.001        ; -2.215     ; 2.355      ;
; -4.621 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[11] ; rom_addr[20] ; debounce_cnt[0] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.001        ; -2.215     ; 2.352      ;
; -4.620 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[3]  ; rom_addr[13] ; debounce_cnt[0] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.001        ; -2.229     ; 2.337      ;
; -4.615 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[11] ; rom_addr[21] ; debounce_cnt[0] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.001        ; -2.215     ; 2.346      ;
; -4.614 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[10] ; rom_addr[19] ; debounce_cnt[0] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.001        ; -2.230     ; 2.330      ;
; -4.607 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[13] ; rom_addr[16] ; debounce_cnt[0] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.001        ; -2.229     ; 2.324      ;
; -4.601 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[13] ; rom_addr[17] ; debounce_cnt[0] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.001        ; -2.229     ; 2.318      ;
; -4.598 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[3]  ; rom_addr[12] ; debounce_cnt[0] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.001        ; -2.229     ; 2.315      ;
; -4.589 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[4]  ; rom_addr[18] ; debounce_cnt[0] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.001        ; -2.216     ; 2.319      ;
; -4.577 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[7]  ; rom_addr[21] ; debounce_cnt[0] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.001        ; -2.216     ; 2.307      ;
; -4.570 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[4]  ; rom_addr[17] ; debounce_cnt[0] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.001        ; -2.216     ; 2.300      ;
; -4.565 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[2]  ; rom_addr[12] ; debounce_cnt[0] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.001        ; -2.229     ; 2.282      ;
; -4.558 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[7]  ; rom_addr[20] ; debounce_cnt[0] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.001        ; -2.216     ; 2.288      ;
+--------+--------------------------------------------------+--------------+-----------------+-----------------------------------------------------------+--------------+------------+------------+


+-------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+
; Slow 1200mV 85C Model Setup: 'debounce_cnt[0]'                                                                                                                                            ;
+--------+--------------------------------------------------+--------------------------------------------------+-----------------+-----------------+--------------+------------+------------+
; Slack  ; From Node                                        ; To Node                                          ; Launch Clock    ; Latch Clock     ; Relationship ; Clock Skew ; Data Delay ;
+--------+--------------------------------------------------+--------------------------------------------------+-----------------+-----------------+--------------+------------+------------+
; -2.368 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[12] ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[4]  ; debounce_cnt[0] ; debounce_cnt[0] ; 1.000        ; -0.062     ; 3.301      ;
; -2.236 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[1]  ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[12] ; debounce_cnt[0] ; debounce_cnt[0] ; 1.000        ; -0.063     ; 3.168      ;
; -2.214 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[0]  ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[13] ; debounce_cnt[0] ; debounce_cnt[0] ; 1.000        ; -0.063     ; 3.146      ;
; -2.202 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[12] ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[2]  ; debounce_cnt[0] ; debounce_cnt[0] ; 1.000        ; -0.049     ; 3.148      ;
; -2.181 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[12] ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[1]  ; debounce_cnt[0] ; debounce_cnt[0] ; 1.000        ; -0.062     ; 3.114      ;
; -2.168 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[6]  ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[4]  ; debounce_cnt[0] ; debounce_cnt[0] ; 1.000        ; -0.063     ; 3.100      ;
; -2.160 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[7]  ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[4]  ; debounce_cnt[0] ; debounce_cnt[0] ; 1.000        ; -0.063     ; 3.092      ;
; -2.151 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[12] ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[3]  ; debounce_cnt[0] ; debounce_cnt[0] ; 1.000        ; -0.049     ; 3.097      ;
; -2.114 ; debouncer:debounce_enc_a|jk_ff                   ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[4]  ; debounce_cnt[0] ; debounce_cnt[0] ; 1.000        ; -0.052     ; 3.057      ;
; -2.108 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[1]  ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[13] ; debounce_cnt[0] ; debounce_cnt[0] ; 1.000        ; -0.050     ; 3.053      ;
; -2.102 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[11] ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[4]  ; debounce_cnt[0] ; debounce_cnt[0] ; 1.000        ; -0.062     ; 3.035      ;
; -2.098 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[2]  ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[13] ; debounce_cnt[0] ; debounce_cnt[0] ; 1.000        ; -0.063     ; 3.030      ;
; -2.082 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[12] ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[12] ; debounce_cnt[0] ; debounce_cnt[0] ; 1.000        ; -0.062     ; 3.015      ;
; -2.082 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[6]  ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[2]  ; debounce_cnt[0] ; debounce_cnt[0] ; 1.000        ; -0.050     ; 3.027      ;
; -2.081 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[12] ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[11] ; debounce_cnt[0] ; debounce_cnt[0] ; 1.000        ; -0.062     ; 3.014      ;
; -2.075 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[1]  ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[11] ; debounce_cnt[0] ; debounce_cnt[0] ; 1.000        ; -0.063     ; 3.007      ;
; -2.074 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[7]  ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[2]  ; debounce_cnt[0] ; debounce_cnt[0] ; 1.000        ; -0.050     ; 3.019      ;
; -2.068 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[0]  ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[10] ; debounce_cnt[0] ; debounce_cnt[0] ; 1.000        ; -0.062     ; 3.001      ;
; -2.066 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[6]  ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[1]  ; debounce_cnt[0] ; debounce_cnt[0] ; 1.000        ; -0.063     ; 2.998      ;
; -2.058 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[7]  ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[1]  ; debounce_cnt[0] ; debounce_cnt[0] ; 1.000        ; -0.063     ; 2.990      ;
; -2.056 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[12] ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[7]  ; debounce_cnt[0] ; debounce_cnt[0] ; 1.000        ; -0.062     ; 2.989      ;
; -2.054 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[1]  ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[10] ; debounce_cnt[0] ; debounce_cnt[0] ; 1.000        ; -0.049     ; 3.000      ;
; -2.053 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[12] ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[5]  ; debounce_cnt[0] ; debounce_cnt[0] ; 1.000        ; -0.062     ; 2.986      ;
; -2.053 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[12] ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[6]  ; debounce_cnt[0] ; debounce_cnt[0] ; 1.000        ; -0.062     ; 2.986      ;
; -2.014 ; debouncer:debounce_enc_a|jk_ff                   ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[3]  ; debounce_cnt[0] ; debounce_cnt[0] ; 1.000        ; -0.039     ; 2.970      ;
; -2.012 ; quad_decode:quad_decode_0|quad_ff_b              ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[4]  ; debounce_cnt[0] ; debounce_cnt[0] ; 1.000        ; -0.063     ; 2.944      ;
; -2.001 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[3]  ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[13] ; debounce_cnt[0] ; debounce_cnt[0] ; 1.000        ; -0.063     ; 2.933      ;
; -1.985 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[5]  ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[13] ; debounce_cnt[0] ; debounce_cnt[0] ; 1.000        ; -0.050     ; 2.930      ;
; -1.968 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[12] ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[9]  ; debounce_cnt[0] ; debounce_cnt[0] ; 1.000        ; -0.048     ; 2.915      ;
; -1.967 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[0]  ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[12] ; debounce_cnt[0] ; debounce_cnt[0] ; 1.000        ; -0.076     ; 2.886      ;
; -1.967 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[12] ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[10] ; debounce_cnt[0] ; debounce_cnt[0] ; 1.000        ; -0.048     ; 2.914      ;
; -1.963 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[1]  ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[4]  ; debounce_cnt[0] ; debounce_cnt[0] ; 1.000        ; -0.063     ; 2.895      ;
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; -1.948 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[6]  ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[3]  ; debounce_cnt[0] ; debounce_cnt[0] ; 1.000        ; -0.050     ; 2.893      ;
; -1.946 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[1]  ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[2]  ; debounce_cnt[0] ; debounce_cnt[0] ; 1.000        ; -0.050     ; 2.891      ;
; -1.940 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[7]  ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[3]  ; debounce_cnt[0] ; debounce_cnt[0] ; 1.000        ; -0.050     ; 2.885      ;
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+-----------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+
; Slow 1200mV 85C Model Setup: 'pll_lab5_inst|altpll_component|auto_generated|pll1|clk[1]'                                                                                                                        ;
+------------+-----------------+-----------------+-----------------------------------------------------------+-----------------------------------------------------------+--------------+------------+------------+
; Slack      ; From Node       ; To Node         ; Launch Clock                                              ; Latch Clock                                               ; Relationship ; Clock Skew ; Data Delay ;
+------------+-----------------+-----------------+-----------------------------------------------------------+-----------------------------------------------------------+--------------+------------+------------+
; -0.798     ; debounce_cnt[0] ; digit_clk       ; debounce_cnt[0]                                           ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[1] ; 0.500        ; -0.074     ; 1.368      ;
; -0.794     ; debounce_cnt[0] ; debounce_cnt[1] ; debounce_cnt[0]                                           ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[1] ; 0.500        ; -0.074     ; 1.364      ;
; -0.750     ; debounce_cnt[0] ; debounce_cnt[0] ; debounce_cnt[0]                                           ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[1] ; 0.500        ; -0.074     ; 1.320      ;
; -0.235     ; debounce_cnt[0] ; debounce_cnt[1] ; debounce_cnt[0]                                           ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[1] ; 1.000        ; -0.074     ; 1.305      ;
; -0.212     ; debounce_cnt[0] ; digit_clk       ; debounce_cnt[0]                                           ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[1] ; 1.000        ; -0.074     ; 1.282      ;
; -0.203     ; debounce_cnt[0] ; debounce_cnt[0] ; debounce_cnt[0]                                           ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[1] ; 1.000        ; -0.074     ; 1.273      ;
; -0.067     ; digit_clk       ; digit_clk       ; digit_clk                                                 ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[1] ; 0.500        ; -0.074     ; 0.637      ;
; 0.411      ; digit_clk       ; digit_clk       ; digit_clk                                                 ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[1] ; 1.000        ; -0.074     ; 0.659      ;
; 249998.447 ; debounce_cnt[1] ; digit_clk       ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[1] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[1] ; 250000.000   ; -0.062     ; 1.486      ;
; 249998.451 ; debounce_cnt[1] ; debounce_cnt[1] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[1] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[1] ; 250000.000   ; -0.062     ; 1.482      ;
; 249998.495 ; debounce_cnt[1] ; debounce_cnt[0] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[1] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[1] ; 250000.000   ; -0.062     ; 1.438      ;
+------------+-----------------+-----------------+-----------------------------------------------------------+-----------------------------------------------------------+--------------+------------+------------+


+------------------------------------------------------------------------------------------------------------------+
; Slow 1200mV 85C Model Setup: 'digit_clk'                                                                         ;
+--------+-----------------+-----------------+--------------+-------------+--------------+------------+------------+
; Slack  ; From Node       ; To Node         ; Launch Clock ; Latch Clock ; Relationship ; Clock Skew ; Data Delay ;
+--------+-----------------+-----------------+--------------+-------------+--------------+------------+------------+
; -0.501 ; digit_seq_ps[2] ; digit_seq_ps[2] ; digit_clk    ; digit_clk   ; 1.000        ; -0.062     ; 1.434      ;
; -0.405 ; digit_seq_ps[1] ; digit_seq_ps[2] ; digit_clk    ; digit_clk   ; 1.000        ; -0.062     ; 1.338      ;
; -0.383 ; digit_seq_ps[1] ; digit_seq_ps[0] ; digit_clk    ; digit_clk   ; 1.000        ; -0.062     ; 1.316      ;
; -0.361 ; digit_seq_ps[2] ; digit_seq_ps[0] ; digit_clk    ; digit_clk   ; 1.000        ; -0.062     ; 1.294      ;
; -0.249 ; digit_seq_ps[0] ; digit_seq_ps[2] ; digit_clk    ; digit_clk   ; 1.000        ; -0.062     ; 1.182      ;
; -0.241 ; digit_seq_ps[0] ; digit_seq_ps[1] ; digit_clk    ; digit_clk   ; 1.000        ; -0.062     ; 1.174      ;
; -0.093 ; digit_seq_ps[2] ; digit_seq_ps[1] ; digit_clk    ; digit_clk   ; 1.000        ; -0.062     ; 1.026      ;
; 0.274  ; digit_seq_ps[1] ; digit_seq_ps[1] ; digit_clk    ; digit_clk   ; 1.000        ; -0.062     ; 0.659      ;
+--------+-----------------+-----------------+--------------+-------------+--------------+------------+------------+


+-------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+
; Slow 1200mV 85C Model Hold: 'pll_lab5_inst|altpll_component|auto_generated|pll1|clk[1]'                                                                                                                     ;
+--------+-----------------+-----------------+-----------------------------------------------------------+-----------------------------------------------------------+--------------+------------+------------+
; Slack  ; From Node       ; To Node         ; Launch Clock                                              ; Latch Clock                                               ; Relationship ; Clock Skew ; Data Delay ;
+--------+-----------------+-----------------+-----------------------------------------------------------+-----------------------------------------------------------+--------------+------------+------------+
; -0.207 ; digit_clk       ; digit_clk       ; digit_clk                                                 ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[1] ; 0.000        ; 0.328      ; 0.577      ;
; -0.185 ; debounce_cnt[0] ; debounce_cnt[0] ; debounce_cnt[0]                                           ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[1] ; 0.000        ; 0.328      ; 0.599      ;
; 0.283  ; debounce_cnt[0] ; debounce_cnt[1] ; debounce_cnt[0]                                           ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[1] ; 0.000        ; 0.328      ; 1.067      ;
; 0.294  ; digit_clk       ; digit_clk       ; digit_clk                                                 ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[1] ; -0.500       ; 0.328      ; 0.578      ;
; 0.296  ; debounce_cnt[0] ; debounce_cnt[0] ; debounce_cnt[0]                                           ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[1] ; -0.500       ; 0.328      ; 0.580      ;
; 0.349  ; debounce_cnt[0] ; digit_clk       ; debounce_cnt[0]                                           ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[1] ; 0.000        ; 0.328      ; 1.133      ;
; 0.358  ; debounce_cnt[1] ; debounce_cnt[1] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[1] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[1] ; 0.000        ; 0.062      ; 0.577      ;
; 0.846  ; debounce_cnt[0] ; debounce_cnt[1] ; debounce_cnt[0]                                           ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[1] ; -0.500       ; 0.328      ; 1.130      ;
; 0.935  ; debounce_cnt[0] ; digit_clk       ; debounce_cnt[0]                                           ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[1] ; -0.500       ; 0.328      ; 1.219      ;
; 0.998  ; debounce_cnt[1] ; digit_clk       ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[1] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[1] ; 0.000        ; 0.062      ; 1.217      ;
; 1.074  ; debounce_cnt[1] ; debounce_cnt[0] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[1] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[1] ; 0.000        ; 0.062      ; 1.293      ;
+--------+-----------------+-----------------+-----------------------------------------------------------+-----------------------------------------------------------+--------------+------------+------------+


+------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+
; Slow 1200mV 85C Model Hold: 'debounce_cnt[0]'                                                                                                                                            ;
+-------+--------------------------------------------------+--------------------------------------------------+-----------------+-----------------+--------------+------------+------------+
; Slack ; From Node                                        ; To Node                                          ; Launch Clock    ; Latch Clock     ; Relationship ; Clock Skew ; Data Delay ;
+-------+--------------------------------------------------+--------------------------------------------------+-----------------+-----------------+--------------+------------+------------+
; 0.357 ; debouncer:debounce_enc_a|jk_ff                   ; debouncer:debounce_enc_a|jk_ff                   ; debounce_cnt[0] ; debounce_cnt[0] ; 0.000        ; 0.063      ; 0.577      ;
; 0.357 ; debouncer:debounce_enc_b|jk_ff                   ; debouncer:debounce_enc_b|jk_ff                   ; debounce_cnt[0] ; debounce_cnt[0] ; 0.000        ; 0.063      ; 0.577      ;
; 0.372 ; debouncer:debounce_enc_b|shift_reg[3]            ; debouncer:debounce_enc_b|jk_ff                   ; debounce_cnt[0] ; debounce_cnt[0] ; 0.000        ; 0.063      ; 0.592      ;
; 0.373 ; debouncer:debounce_enc_a|shift_reg[0]            ; debouncer:debounce_enc_a|shift_reg[1]            ; debounce_cnt[0] ; debounce_cnt[0] ; 0.000        ; 0.063      ; 0.593      ;
; 0.380 ; debouncer:debounce_enc_b|jk_ff                   ; quad_decode:quad_decode_0|quad_ff_b              ; debounce_cnt[0] ; debounce_cnt[0] ; 0.000        ; 0.063      ; 0.600      ;
; 0.387 ; debouncer:debounce_enc_a|shift_reg[2]            ; debouncer:debounce_enc_a|shift_reg[3]            ; debounce_cnt[0] ; debounce_cnt[0] ; 0.000        ; 0.063      ; 0.607      ;
; 0.387 ; debouncer:debounce_enc_a|shift_reg[2]            ; debouncer:debounce_enc_a|jk_ff                   ; debounce_cnt[0] ; debounce_cnt[0] ; 0.000        ; 0.063      ; 0.607      ;
; 0.523 ; debouncer:debounce_enc_a|shift_reg[1]            ; debouncer:debounce_enc_a|shift_reg[2]            ; debounce_cnt[0] ; debounce_cnt[0] ; 0.000        ; 0.063      ; 0.743      ;
; 0.524 ; debouncer:debounce_enc_b|shift_reg[1]            ; debouncer:debounce_enc_b|shift_reg[2]            ; debounce_cnt[0] ; debounce_cnt[0] ; 0.000        ; 0.063      ; 0.744      ;
; 0.530 ; debouncer:debounce_enc_b|shift_reg[2]            ; debouncer:debounce_enc_b|shift_reg[3]            ; debounce_cnt[0] ; debounce_cnt[0] ; 0.000        ; 0.063      ; 0.750      ;
; 0.554 ; debouncer:debounce_enc_a|shift_reg[3]            ; debouncer:debounce_enc_a|jk_ff                   ; debounce_cnt[0] ; debounce_cnt[0] ; 0.000        ; 0.063      ; 0.774      ;
; 0.566 ; debouncer:debounce_enc_b|shift_reg[2]            ; debouncer:debounce_enc_b|jk_ff                   ; debounce_cnt[0] ; debounce_cnt[0] ; 0.000        ; 0.063      ; 0.786      ;
; 0.829 ; debouncer:debounce_enc_b|shift_reg[0]            ; debouncer:debounce_enc_b|jk_ff                   ; debounce_cnt[0] ; debounce_cnt[0] ; 0.000        ; 0.063      ; 1.049      ;
; 0.867 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[10] ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[10] ; debounce_cnt[0] ; debounce_cnt[0] ; 0.000        ; 0.063      ; 1.087      ;
; 0.906 ; quad_decode:quad_decode_0|quad_ff_b              ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[4]  ; debounce_cnt[0] ; debounce_cnt[0] ; 0.000        ; 0.063      ; 1.126      ;
; 0.939 ; debouncer:debounce_enc_a|jk_ff                   ; quad_decode:quad_decode_0|quad_ff_a              ; debounce_cnt[0] ; debounce_cnt[0] ; 0.000        ; 0.074      ; 1.170      ;
; 0.965 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[9]  ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[9]  ; debounce_cnt[0] ; debounce_cnt[0] ; 0.000        ; 0.063      ; 1.185      ;
; 0.967 ; debouncer:debounce_enc_a|shift_reg[0]            ; debouncer:debounce_enc_a|jk_ff                   ; debounce_cnt[0] ; debounce_cnt[0] ; 0.000        ; 0.063      ; 1.187      ;
; 0.988 ; quad_decode:quad_decode_0|quad_ff_b              ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[1]  ; debounce_cnt[0] ; debounce_cnt[0] ; 0.000        ; 0.063      ; 1.208      ;
; 1.036 ; debouncer:debounce_enc_b|shift_reg[1]            ; debouncer:debounce_enc_b|jk_ff                   ; debounce_cnt[0] ; debounce_cnt[0] ; 0.000        ; 0.063      ; 1.256      ;
; 1.039 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[11] ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[11] ; debounce_cnt[0] ; debounce_cnt[0] ; 0.000        ; 0.062      ; 1.258      ;
; 1.058 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[12] ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[12] ; debounce_cnt[0] ; debounce_cnt[0] ; 0.000        ; 0.062      ; 1.277      ;
; 1.095 ; debouncer:debounce_enc_b|shift_reg[0]            ; debouncer:debounce_enc_b|shift_reg[1]            ; debounce_cnt[0] ; debounce_cnt[0] ; 0.000        ; 0.063      ; 1.315      ;
; 1.156 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[9]  ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[10] ; debounce_cnt[0] ; debounce_cnt[0] ; 0.000        ; 0.063      ; 1.376      ;
; 1.169 ; debouncer:debounce_enc_a|shift_reg[1]            ; debouncer:debounce_enc_a|jk_ff                   ; debounce_cnt[0] ; debounce_cnt[0] ; 0.000        ; 0.063      ; 1.389      ;
; 1.176 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[8]  ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[8]  ; debounce_cnt[0] ; debounce_cnt[0] ; 0.000        ; 0.063      ; 1.396      ;
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; 1.593 ; debouncer:debounce_enc_b|jk_ff                   ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[13] ; debounce_cnt[0] ; debounce_cnt[0] ; 0.000        ; 0.076      ; 1.826      ;
; 1.597 ; debouncer:debounce_enc_b|jk_ff                   ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[9]  ; debounce_cnt[0] ; debounce_cnt[0] ; 0.000        ; 0.077      ; 1.831      ;
; 1.597 ; debouncer:debounce_enc_b|jk_ff                   ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[10] ; debounce_cnt[0] ; debounce_cnt[0] ; 0.000        ; 0.077      ; 1.831      ;
; 1.599 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[0]  ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[3]  ; debounce_cnt[0] ; debounce_cnt[0] ; 0.000        ; 0.063      ; 1.819      ;
; 1.600 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[13] ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[3]  ; debounce_cnt[0] ; debounce_cnt[0] ; 0.000        ; 0.063      ; 1.820      ;
; 1.613 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[7]  ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[9]  ; debounce_cnt[0] ; debounce_cnt[0] ; 0.000        ; 0.077      ; 1.847      ;
; 1.617 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[11] ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[13] ; debounce_cnt[0] ; debounce_cnt[0] ; 0.000        ; 0.076      ; 1.850      ;
; 1.625 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[7]  ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[10] ; debounce_cnt[0] ; debounce_cnt[0] ; 0.000        ; 0.077      ; 1.859      ;
+-------+--------------------------------------------------+--------------------------------------------------+-----------------+-----------------+--------------+------------+------------+


+-----------------------------------------------------------------------------------------------------------------+
; Slow 1200mV 85C Model Hold: 'digit_clk'                                                                         ;
+-------+-----------------+-----------------+--------------+-------------+--------------+------------+------------+
; Slack ; From Node       ; To Node         ; Launch Clock ; Latch Clock ; Relationship ; Clock Skew ; Data Delay ;
+-------+-----------------+-----------------+--------------+-------------+--------------+------------+------------+
; 0.361 ; digit_seq_ps[1] ; digit_seq_ps[1] ; digit_clk    ; digit_clk   ; 0.000        ; 0.062      ; 0.580      ;
; 0.629 ; digit_seq_ps[2] ; digit_seq_ps[1] ; digit_clk    ; digit_clk   ; 0.000        ; 0.062      ; 0.848      ;
; 0.761 ; digit_seq_ps[0] ; digit_seq_ps[1] ; digit_clk    ; digit_clk   ; 0.000        ; 0.062      ; 0.980      ;
; 0.848 ; digit_seq_ps[0] ; digit_seq_ps[2] ; digit_clk    ; digit_clk   ; 0.000        ; 0.062      ; 1.067      ;
; 0.971 ; digit_seq_ps[1] ; digit_seq_ps[2] ; digit_clk    ; digit_clk   ; 0.000        ; 0.062      ; 1.190      ;
; 0.985 ; digit_seq_ps[2] ; digit_seq_ps[0] ; digit_clk    ; digit_clk   ; 0.000        ; 0.062      ; 1.204      ;
; 1.025 ; digit_seq_ps[1] ; digit_seq_ps[0] ; digit_clk    ; digit_clk   ; 0.000        ; 0.062      ; 1.244      ;
; 1.085 ; digit_seq_ps[2] ; digit_seq_ps[2] ; digit_clk    ; digit_clk   ; 0.000        ; 0.062      ; 1.304      ;
+-------+-----------------+-----------------+--------------+-------------+--------------+------------+------------+


+--------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+
; Slow 1200mV 85C Model Hold: 'pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2]'                                                                                                                                                                                                          ;
+-------+--------------+----------------------------------------------------------------------------------------------------------+-----------------------------------------------------------+-----------------------------------------------------------+--------------+------------+------------+
; Slack ; From Node    ; To Node                                                                                                  ; Launch Clock                                              ; Latch Clock                                               ; Relationship ; Clock Skew ; Data Delay ;
+-------+--------------+----------------------------------------------------------------------------------------------------------+-----------------------------------------------------------+-----------------------------------------------------------+--------------+------------+------------+
; 0.534 ; rom_addr[9]  ; rom_addr[9]                                                                                              ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.000        ; 0.076      ; 0.767      ;
; 0.535 ; rom_addr[11] ; rom_addr[11]                                                                                             ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.000        ; 0.076      ; 0.768      ;
; 0.536 ; rom_addr[12] ; rom_addr[12]                                                                                             ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.000        ; 0.076      ; 0.769      ;
; 0.536 ; rom_addr[10] ; rom_addr[10]                                                                                             ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.000        ; 0.076      ; 0.769      ;
; 0.538 ; rom_addr[4]  ; rom_addr[4]                                                                                              ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.000        ; 0.076      ; 0.771      ;
; 0.538 ; rom_addr[3]  ; rom_addr[3]                                                                                              ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.000        ; 0.076      ; 0.771      ;
; 0.548 ; rom_addr[0]  ; rom_addr[0]                                                                                              ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.000        ; 0.076      ; 0.781      ;
; 0.555 ; rom_addr[15] ; rom_addr[15]                                                                                             ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.000        ; 0.076      ; 0.788      ;
; 0.556 ; rom_addr[17] ; rom_addr[17]                                                                                             ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.000        ; 0.076      ; 0.789      ;
; 0.557 ; rom_addr[18] ; rom_addr[18]                                                                                             ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.000        ; 0.076      ; 0.790      ;
; 0.558 ; rom_addr[23] ; rom_addr[23]                                                                                             ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.000        ; 0.076      ; 0.791      ;
; 0.558 ; rom_addr[13] ; rom_addr[13]                                                                                             ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.000        ; 0.076      ; 0.791      ;
; 0.559 ; rom_addr[21] ; rom_addr[21]                                                                                             ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.000        ; 0.076      ; 0.792      ;
; 0.559 ; rom_addr[19] ; rom_addr[19]                                                                                             ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.000        ; 0.076      ; 0.792      ;
; 0.559 ; rom_addr[14] ; rom_addr[14]                                                                                             ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.000        ; 0.076      ; 0.792      ;
; 0.560 ; rom_addr[16] ; rom_addr[16]                                                                                             ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.000        ; 0.076      ; 0.793      ;
; 0.561 ; rom_addr[22] ; rom_addr[22]                                                                                             ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.000        ; 0.076      ; 0.794      ;
; 0.561 ; rom_addr[20] ; rom_addr[20]                                                                                             ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.000        ; 0.076      ; 0.794      ;
; 0.607 ; rom_addr[2]  ; rom_addr[3]                                                                                              ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.000        ; 0.427      ; 1.191      ;
; 0.609 ; rom_addr[2]  ; rom_addr[4]                                                                                              ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.000        ; 0.427      ; 1.193      ;
; 0.669 ; rom_addr[5]  ; rom_addr[5]                                                                                              ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.000        ; 0.076      ; 0.902      ;
; 0.671 ; rom_addr[7]  ; rom_addr[7]                                                                                              ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.000        ; 0.076      ; 0.904      ;
; 0.674 ; rom_addr[8]  ; rom_addr[8]                                                                                              ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.000        ; 0.076      ; 0.907      ;
; 0.683 ; rom_addr[2]  ; rom_addr[2]                                                                                              ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.000        ; 0.062      ; 0.902      ;
; 0.692 ; rom_addr[1]  ; rom_addr[1]                                                                                              ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.000        ; 0.062      ; 0.911      ;
; 0.709 ; rom_addr[1]  ; rom_addr[3]                                                                                              ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.000        ; 0.427      ; 1.293      ;
; 0.711 ; rom_addr[1]  ; rom_addr[4]                                                                                              ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.000        ; 0.427      ; 1.295      ;
; 0.719 ; rom_addr[2]  ; rom_addr[5]                                                                                              ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.000        ; 0.427      ; 1.303      ;
; 0.721 ; rom_addr[2]  ; rom_addr[6]                                                                                              ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.000        ; 0.427      ; 1.305      ;
; 0.809 ; rom_addr[9]  ; rom_addr[10]                                                                                             ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.000        ; 0.076      ; 1.042      ;
; 0.811 ; rom_addr[11] ; rom_addr[12]                                                                                             ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.000        ; 0.074      ; 1.042      ;
; 0.812 ; rom_addr[3]  ; rom_addr[4]                                                                                              ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.000        ; 0.076      ; 1.045      ;
; 0.821 ; rom_addr[1]  ; rom_addr[5]                                                                                              ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.000        ; 0.427      ; 1.405      ;
; 0.823 ; rom_addr[1]  ; rom_addr[6]                                                                                              ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.000        ; 0.427      ; 1.407      ;
; 0.825 ; rom_addr[10] ; rom_addr[11]                                                                                             ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.000        ; 0.076      ; 1.058      ;
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; 0.827 ; rom_addr[4]  ; rom_addr[5]                                                                                              ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.000        ; 0.076      ; 1.060      ;
; 0.829 ; rom_addr[4]  ; rom_addr[6]                                                                                              ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.000        ; 0.076      ; 1.062      ;
; 0.829 ; rom_addr[10] ; rom_addr[12]                                                                                             ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.000        ; 0.074      ; 1.060      ;
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; 0.831 ; rom_addr[17] ; rom_addr[18]                                                                                             ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.000        ; 0.076      ; 1.064      ;
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; 0.848 ; rom_addr[20] ; rom_addr[21]                                                                                             ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.000        ; 0.076      ; 1.081      ;
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; 0.919 ; rom_addr[9]  ; rom_addr[11]                                                                                             ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.000        ; 0.076      ; 1.152      ;
; 0.921 ; rom_addr[11] ; rom_addr[13]                                                                                             ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.000        ; 0.074      ; 1.152      ;
; 0.922 ; rom_addr[3]  ; rom_addr[5]                                                                                              ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.000        ; 0.076      ; 1.155      ;
; 0.923 ; rom_addr[14] ; sine_rom:sine_rom_0|altsyncram:Ram0_rtl_0|altsyncram_ct61:auto_generated|ram_block1a4~porta_address_reg0 ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.000        ; 0.038      ; 1.148      ;
; 0.923 ; rom_addr[11] ; rom_addr[14]                                                                                             ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.000        ; 0.074      ; 1.154      ;
; 0.923 ; rom_addr[9]  ; rom_addr[12]                                                                                             ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.000        ; 0.074      ; 1.154      ;
; 0.924 ; rom_addr[3]  ; rom_addr[6]                                                                                              ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.000        ; 0.076      ; 1.157      ;
; 0.931 ; rom_addr[16] ; sine_rom:sine_rom_0|altsyncram:Ram0_rtl_0|altsyncram_ct61:auto_generated|ram_block1a4~porta_address_reg0 ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.000        ; 0.038      ; 1.156      ;
; 0.933 ; rom_addr[1]  ; rom_addr[7]                                                                                              ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.000        ; 0.427      ; 1.517      ;
; 0.935 ; rom_addr[1]  ; rom_addr[8]                                                                                              ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.000        ; 0.427      ; 1.519      ;
; 0.937 ; rom_addr[12] ; rom_addr[15]                                                                                             ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.000        ; 0.076      ; 1.170      ;
; 0.938 ; rom_addr[0]  ; rom_addr[3]                                                                                              ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.000        ; 0.076      ; 1.171      ;
; 0.939 ; rom_addr[4]  ; rom_addr[7]                                                                                              ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.000        ; 0.076      ; 1.172      ;
; 0.939 ; rom_addr[12] ; rom_addr[16]                                                                                             ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.000        ; 0.076      ; 1.172      ;
; 0.939 ; rom_addr[10] ; rom_addr[13]                                                                                             ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.000        ; 0.074      ; 1.170      ;
; 0.940 ; rom_addr[0]  ; rom_addr[4]                                                                                              ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.000        ; 0.076      ; 1.173      ;
; 0.940 ; rom_addr[15] ; rom_addr[17]                                                                                             ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.000        ; 0.076      ; 1.173      ;
; 0.940 ; rom_addr[13] ; rom_addr[15]                                                                                             ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.000        ; 0.076      ; 1.173      ;
; 0.941 ; rom_addr[4]  ; rom_addr[8]                                                                                              ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.000        ; 0.076      ; 1.174      ;
; 0.941 ; rom_addr[17] ; rom_addr[19]                                                                                             ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.000        ; 0.076      ; 1.174      ;
; 0.941 ; rom_addr[10] ; rom_addr[14]                                                                                             ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.000        ; 0.074      ; 1.172      ;
; 0.942 ; rom_addr[15] ; rom_addr[18]                                                                                             ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.000        ; 0.076      ; 1.175      ;
; 0.942 ; rom_addr[13] ; rom_addr[16]                                                                                             ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.000        ; 0.076      ; 1.175      ;
; 0.943 ; rom_addr[2]  ; rom_addr[9]                                                                                              ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.000        ; 0.427      ; 1.527      ;
; 0.943 ; rom_addr[17] ; rom_addr[20]                                                                                             ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.000        ; 0.076      ; 1.176      ;
; 0.943 ; rom_addr[21] ; rom_addr[23]                                                                                             ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.000        ; 0.076      ; 1.176      ;
; 0.943 ; rom_addr[19] ; rom_addr[21]                                                                                             ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.000        ; 0.076      ; 1.176      ;
; 0.944 ; rom_addr[5]  ; rom_addr[6]                                                                                              ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.000        ; 0.076      ; 1.177      ;
; 0.945 ; rom_addr[2]  ; rom_addr[10]                                                                                             ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.000        ; 0.427      ; 1.529      ;
; 0.945 ; rom_addr[7]  ; rom_addr[8]                                                                                              ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.000        ; 0.076      ; 1.178      ;
; 0.945 ; rom_addr[19] ; rom_addr[22]                                                                                             ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.000        ; 0.076      ; 1.178      ;
; 0.946 ; rom_addr[14] ; sine_rom:sine_rom_0|altsyncram:Ram0_rtl_0|altsyncram_ct61:auto_generated|ram_block1a0~porta_address_reg0 ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.000        ; 0.038      ; 1.171      ;
; 0.957 ; rom_addr[18] ; rom_addr[21]                                                                                             ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.000        ; 0.076      ; 1.190      ;
; 0.958 ; rom_addr[14] ; rom_addr[17]                                                                                             ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.000        ; 0.076      ; 1.191      ;
; 0.959 ; rom_addr[16] ; rom_addr[19]                                                                                             ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.000        ; 0.076      ; 1.192      ;
; 0.959 ; rom_addr[18] ; rom_addr[22]                                                                                             ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.000        ; 0.076      ; 1.192      ;
+-------+--------------+----------------------------------------------------------------------------------------------------------+-----------------------------------------------------------+-----------------------------------------------------------+--------------+------------+------------+


-----------------------------------------------
; Slow 1200mV 85C Model Metastability Summary ;
-----------------------------------------------
No synchronizer chains to report.


+-------------------------------------------------------------------------------------------------------------------------------------------+
; Slow 1200mV 0C Model Fmax Summary                                                                                                         ;
+------------+-----------------+-----------------------------------------------------------+------------------------------------------------+
; Fmax       ; Restricted Fmax ; Clock Name                                                ; Note                                           ;
+------------+-----------------+-----------------------------------------------------------+------------------------------------------------+
; 327.01 MHz ; 327.01 MHz      ; debounce_cnt[0]                                           ;                                                ;
; 410.85 MHz ; 315.06 MHz      ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; limit due to minimum period restriction (tmin) ;
; 711.24 MHz ; 500.0 MHz       ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[1] ; limit due to minimum period restriction (tmin) ;
; 742.39 MHz ; 500.0 MHz       ; digit_clk                                                 ; limit due to minimum period restriction (tmin) ;
+------------+-----------------+-----------------------------------------------------------+------------------------------------------------+
This panel reports FMAX for every clock in the design, regardless of the user-specified clock periods.  FMAX is only computed for paths where the source and destination registers or ports are driven by the same clock.  Paths of different clocks, including generated clocks, are ignored.  For paths between a clock and its inversion, FMAX is computed as if the rising and falling edges are scaled along with FMAX, such that the duty cycle (in terms of a percentage) is maintained. Altera recommends that you always use clock constraints and other slack reports for sign-off analysis.


+------------------------------------------------------------------------------------+
; Slow 1200mV 0C Model Setup Summary                                                 ;
+-----------------------------------------------------------+--------+---------------+
; Clock                                                     ; Slack  ; End Point TNS ;
+-----------------------------------------------------------+--------+---------------+
; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; -4.693 ; -98.560       ;
; debounce_cnt[0]                                           ; -2.058 ; -26.608       ;
; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[1] ; -0.608 ; -1.746        ;
; digit_clk                                                 ; -0.347 ; -0.693        ;
+-----------------------------------------------------------+--------+---------------+


+------------------------------------------------------------------------------------+
; Slow 1200mV 0C Model Hold Summary                                                  ;
+-----------------------------------------------------------+--------+---------------+
; Clock                                                     ; Slack  ; End Point TNS ;
+-----------------------------------------------------------+--------+---------------+
; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[1] ; -0.265 ; -0.516        ;
; debounce_cnt[0]                                           ; 0.312  ; 0.000         ;
; digit_clk                                                 ; 0.318  ; 0.000         ;
; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.479  ; 0.000         ;
+-----------------------------------------------------------+--------+---------------+


-----------------------------------------
; Slow 1200mV 0C Model Recovery Summary ;
-----------------------------------------
No paths to report.


----------------------------------------
; Slow 1200mV 0C Model Removal Summary ;
----------------------------------------
No paths to report.


+----------------------------------------------------------------------------------------+
; Slow 1200mV 0C Model Minimum Pulse Width Summary                                       ;
+-----------------------------------------------------------+------------+---------------+
; Clock                                                     ; Slack      ; End Point TNS ;
+-----------------------------------------------------------+------------+---------------+
; debounce_cnt[0]                                           ; -1.000     ; -26.000       ;
; digit_clk                                                 ; -1.000     ; -3.000        ;
; inclk0_sig                                                ; 9.818      ; 0.000         ;
; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 29.548     ; 0.000         ;
; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[1] ; 124999.743 ; 0.000         ;
+-----------------------------------------------------------+------------+---------------+


+-------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+
; Slow 1200mV 0C Model Setup: 'pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2]'                                                                                                         ;
+--------+--------------------------------------------------+--------------+-----------------+-----------------------------------------------------------+--------------+------------+------------+
; Slack  ; From Node                                        ; To Node      ; Launch Clock    ; Latch Clock                                               ; Relationship ; Clock Skew ; Data Delay ;
+--------+--------------------------------------------------+--------------+-----------------+-----------------------------------------------------------+--------------+------------+------------+
; -4.693 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[0]  ; rom_addr[23] ; debounce_cnt[0] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.001        ; -1.929     ; 2.710      ;
; -4.612 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[2]  ; rom_addr[23] ; debounce_cnt[0] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.001        ; -1.929     ; 2.629      ;
; -4.595 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[0]  ; rom_addr[22] ; debounce_cnt[0] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.001        ; -1.929     ; 2.612      ;
; -4.593 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[0]  ; rom_addr[21] ; debounce_cnt[0] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.001        ; -1.929     ; 2.610      ;
; -4.558 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[3]  ; rom_addr[22] ; debounce_cnt[0] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.001        ; -1.929     ; 2.575      ;
; -4.550 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[3]  ; rom_addr[23] ; debounce_cnt[0] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.001        ; -1.929     ; 2.567      ;
; -4.516 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[2]  ; rom_addr[22] ; debounce_cnt[0] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.001        ; -1.929     ; 2.533      ;
; -4.512 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[2]  ; rom_addr[21] ; debounce_cnt[0] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.001        ; -1.929     ; 2.529      ;
; -4.495 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[0]  ; rom_addr[20] ; debounce_cnt[0] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.001        ; -1.929     ; 2.512      ;
; -4.493 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[0]  ; rom_addr[19] ; debounce_cnt[0] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.001        ; -1.929     ; 2.510      ;
; -4.458 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[3]  ; rom_addr[20] ; debounce_cnt[0] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.001        ; -1.929     ; 2.475      ;
; -4.456 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[1]  ; rom_addr[22] ; debounce_cnt[0] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.001        ; -1.917     ; 2.485      ;
; -4.452 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[8]  ; rom_addr[23] ; debounce_cnt[0] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.001        ; -1.929     ; 2.469      ;
; -4.450 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[3]  ; rom_addr[21] ; debounce_cnt[0] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.001        ; -1.929     ; 2.467      ;
; -4.438 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[1]  ; rom_addr[23] ; debounce_cnt[0] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.001        ; -1.917     ; 2.467      ;
; -4.416 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[2]  ; rom_addr[20] ; debounce_cnt[0] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.001        ; -1.929     ; 2.433      ;
; -4.412 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[2]  ; rom_addr[19] ; debounce_cnt[0] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.001        ; -1.929     ; 2.429      ;
; -4.395 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[0]  ; rom_addr[18] ; debounce_cnt[0] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.001        ; -1.929     ; 2.412      ;
; -4.393 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[0]  ; rom_addr[17] ; debounce_cnt[0] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.001        ; -1.929     ; 2.410      ;
; -4.358 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[3]  ; rom_addr[18] ; debounce_cnt[0] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.001        ; -1.929     ; 2.375      ;
; -4.356 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[1]  ; rom_addr[20] ; debounce_cnt[0] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.001        ; -1.917     ; 2.385      ;
; -4.352 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[8]  ; rom_addr[21] ; debounce_cnt[0] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.001        ; -1.929     ; 2.369      ;
; -4.350 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[3]  ; rom_addr[19] ; debounce_cnt[0] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.001        ; -1.929     ; 2.367      ;
; -4.340 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[13] ; rom_addr[22] ; debounce_cnt[0] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.001        ; -1.929     ; 2.357      ;
; -4.338 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[1]  ; rom_addr[21] ; debounce_cnt[0] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.001        ; -1.917     ; 2.367      ;
; -4.334 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[8]  ; rom_addr[22] ; debounce_cnt[0] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.001        ; -1.929     ; 2.351      ;
; -4.322 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[13] ; rom_addr[23] ; debounce_cnt[0] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.001        ; -1.929     ; 2.339      ;
; -4.316 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[2]  ; rom_addr[18] ; debounce_cnt[0] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.001        ; -1.929     ; 2.333      ;
; -4.313 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[4]  ; rom_addr[23] ; debounce_cnt[0] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.001        ; -1.917     ; 2.342      ;
; -4.312 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[2]  ; rom_addr[17] ; debounce_cnt[0] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.001        ; -1.929     ; 2.329      ;
; -4.295 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[0]  ; rom_addr[16] ; debounce_cnt[0] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.001        ; -1.929     ; 2.312      ;
; -4.293 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[0]  ; rom_addr[15] ; debounce_cnt[0] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.001        ; -1.929     ; 2.310      ;
; -4.269 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[10] ; rom_addr[23] ; debounce_cnt[0] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.001        ; -1.930     ; 2.285      ;
; -4.258 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[6]  ; rom_addr[23] ; debounce_cnt[0] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.001        ; -1.917     ; 2.287      ;
; -4.258 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[3]  ; rom_addr[16] ; debounce_cnt[0] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.001        ; -1.929     ; 2.275      ;
; -4.256 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[1]  ; rom_addr[18] ; debounce_cnt[0] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.001        ; -1.917     ; 2.285      ;
; -4.252 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[8]  ; rom_addr[19] ; debounce_cnt[0] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.001        ; -1.929     ; 2.269      ;
; -4.250 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[3]  ; rom_addr[17] ; debounce_cnt[0] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.001        ; -1.929     ; 2.267      ;
; -4.240 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[13] ; rom_addr[20] ; debounce_cnt[0] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.001        ; -1.929     ; 2.257      ;
; -4.238 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[1]  ; rom_addr[19] ; debounce_cnt[0] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.001        ; -1.917     ; 2.267      ;
; -4.234 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[8]  ; rom_addr[20] ; debounce_cnt[0] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.001        ; -1.929     ; 2.251      ;
; -4.222 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[13] ; rom_addr[21] ; debounce_cnt[0] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.001        ; -1.929     ; 2.239      ;
; -4.220 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[4]  ; rom_addr[22] ; debounce_cnt[0] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.001        ; -1.917     ; 2.249      ;
; -4.216 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[2]  ; rom_addr[16] ; debounce_cnt[0] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.001        ; -1.929     ; 2.233      ;
; -4.213 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[4]  ; rom_addr[21] ; debounce_cnt[0] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.001        ; -1.917     ; 2.242      ;
; -4.212 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[2]  ; rom_addr[15] ; debounce_cnt[0] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.001        ; -1.929     ; 2.229      ;
; -4.204 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[9]  ; rom_addr[23] ; debounce_cnt[0] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.001        ; -1.930     ; 2.220      ;
; -4.201 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[9]  ; rom_addr[22] ; debounce_cnt[0] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.001        ; -1.930     ; 2.217      ;
; -4.195 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[0]  ; rom_addr[14] ; debounce_cnt[0] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.001        ; -1.929     ; 2.212      ;
; -4.193 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[0]  ; rom_addr[13] ; debounce_cnt[0] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.001        ; -1.929     ; 2.210      ;
; -4.180 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[10] ; rom_addr[22] ; debounce_cnt[0] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.001        ; -1.930     ; 2.196      ;
; -4.177 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[5]  ; rom_addr[23] ; debounce_cnt[0] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.001        ; -1.917     ; 2.206      ;
; -4.169 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[10] ; rom_addr[21] ; debounce_cnt[0] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.001        ; -1.930     ; 2.185      ;
; -4.163 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[12] ; rom_addr[23] ; debounce_cnt[0] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.001        ; -1.917     ; 2.192      ;
; -4.162 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[5]  ; rom_addr[22] ; debounce_cnt[0] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.001        ; -1.917     ; 2.191      ;
; -4.158 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[6]  ; rom_addr[21] ; debounce_cnt[0] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.001        ; -1.917     ; 2.187      ;
; -4.158 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[3]  ; rom_addr[14] ; debounce_cnt[0] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.001        ; -1.929     ; 2.175      ;
; -4.156 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[1]  ; rom_addr[16] ; debounce_cnt[0] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.001        ; -1.917     ; 2.185      ;
; -4.152 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[8]  ; rom_addr[17] ; debounce_cnt[0] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.001        ; -1.929     ; 2.169      ;
; -4.150 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[3]  ; rom_addr[15] ; debounce_cnt[0] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.001        ; -1.929     ; 2.167      ;
; -4.142 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[11] ; rom_addr[22] ; debounce_cnt[0] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.001        ; -1.917     ; 2.171      ;
; -4.140 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[6]  ; rom_addr[22] ; debounce_cnt[0] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.001        ; -1.917     ; 2.169      ;
; -4.140 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[13] ; rom_addr[18] ; debounce_cnt[0] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.001        ; -1.929     ; 2.157      ;
; -4.138 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[1]  ; rom_addr[17] ; debounce_cnt[0] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.001        ; -1.917     ; 2.167      ;
; -4.134 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[8]  ; rom_addr[18] ; debounce_cnt[0] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.001        ; -1.929     ; 2.151      ;
; -4.124 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[11] ; rom_addr[23] ; debounce_cnt[0] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.001        ; -1.917     ; 2.153      ;
; -4.122 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[13] ; rom_addr[19] ; debounce_cnt[0] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.001        ; -1.929     ; 2.139      ;
; -4.120 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[4]  ; rom_addr[20] ; debounce_cnt[0] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.001        ; -1.917     ; 2.149      ;
; -4.116 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[2]  ; rom_addr[14] ; debounce_cnt[0] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.001        ; -1.929     ; 2.133      ;
; -4.113 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[4]  ; rom_addr[19] ; debounce_cnt[0] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.001        ; -1.917     ; 2.142      ;
; -4.112 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[2]  ; rom_addr[13] ; debounce_cnt[0] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.001        ; -1.929     ; 2.129      ;
; -4.107 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[7]  ; rom_addr[23] ; debounce_cnt[0] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.001        ; -1.917     ; 2.136      ;
; -4.104 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[9]  ; rom_addr[21] ; debounce_cnt[0] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.001        ; -1.930     ; 2.120      ;
; -4.101 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[9]  ; rom_addr[20] ; debounce_cnt[0] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.001        ; -1.930     ; 2.117      ;
; -4.098 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[7]  ; rom_addr[22] ; debounce_cnt[0] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.001        ; -1.917     ; 2.127      ;
; -4.095 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[0]  ; rom_addr[12] ; debounce_cnt[0] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.001        ; -1.929     ; 2.112      ;
; -4.090 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[0]  ; rom_addr[11] ; debounce_cnt[0] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.001        ; -1.926     ; 2.110      ;
; -4.080 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[10] ; rom_addr[20] ; debounce_cnt[0] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.001        ; -1.930     ; 2.096      ;
; -4.077 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[5]  ; rom_addr[21] ; debounce_cnt[0] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.001        ; -1.917     ; 2.106      ;
; -4.072 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[12] ; rom_addr[22] ; debounce_cnt[0] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.001        ; -1.917     ; 2.101      ;
; -4.069 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[10] ; rom_addr[19] ; debounce_cnt[0] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.001        ; -1.930     ; 2.085      ;
; -4.063 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[12] ; rom_addr[21] ; debounce_cnt[0] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.001        ; -1.917     ; 2.092      ;
; -4.062 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[5]  ; rom_addr[20] ; debounce_cnt[0] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.001        ; -1.917     ; 2.091      ;
; -4.058 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[6]  ; rom_addr[19] ; debounce_cnt[0] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.001        ; -1.917     ; 2.087      ;
; -4.058 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[3]  ; rom_addr[12] ; debounce_cnt[0] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.001        ; -1.929     ; 2.075      ;
; -4.056 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[1]  ; rom_addr[14] ; debounce_cnt[0] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.001        ; -1.917     ; 2.085      ;
; -4.052 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[8]  ; rom_addr[15] ; debounce_cnt[0] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.001        ; -1.929     ; 2.069      ;
; -4.050 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[3]  ; rom_addr[13] ; debounce_cnt[0] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.001        ; -1.929     ; 2.067      ;
; -4.042 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[11] ; rom_addr[20] ; debounce_cnt[0] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.001        ; -1.917     ; 2.071      ;
; -4.040 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[6]  ; rom_addr[20] ; debounce_cnt[0] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.001        ; -1.917     ; 2.069      ;
; -4.040 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[13] ; rom_addr[16] ; debounce_cnt[0] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.001        ; -1.929     ; 2.057      ;
; -4.038 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[1]  ; rom_addr[15] ; debounce_cnt[0] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.001        ; -1.917     ; 2.067      ;
; -4.034 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[8]  ; rom_addr[16] ; debounce_cnt[0] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.001        ; -1.929     ; 2.051      ;
; -4.024 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[11] ; rom_addr[21] ; debounce_cnt[0] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.001        ; -1.917     ; 2.053      ;
; -4.022 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[13] ; rom_addr[17] ; debounce_cnt[0] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.001        ; -1.929     ; 2.039      ;
; -4.020 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[4]  ; rom_addr[18] ; debounce_cnt[0] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.001        ; -1.917     ; 2.049      ;
; -4.016 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[2]  ; rom_addr[12] ; debounce_cnt[0] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.001        ; -1.929     ; 2.033      ;
; -4.013 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[4]  ; rom_addr[17] ; debounce_cnt[0] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.001        ; -1.917     ; 2.042      ;
; -4.009 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[2]  ; rom_addr[11] ; debounce_cnt[0] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.001        ; -1.926     ; 2.029      ;
; -4.007 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[7]  ; rom_addr[21] ; debounce_cnt[0] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.001        ; -1.917     ; 2.036      ;
+--------+--------------------------------------------------+--------------+-----------------+-----------------------------------------------------------+--------------+------------+------------+


+-------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+
; Slow 1200mV 0C Model Setup: 'debounce_cnt[0]'                                                                                                                                             ;
+--------+--------------------------------------------------+--------------------------------------------------+-----------------+-----------------+--------------+------------+------------+
; Slack  ; From Node                                        ; To Node                                          ; Launch Clock    ; Latch Clock     ; Relationship ; Clock Skew ; Data Delay ;
+--------+--------------------------------------------------+--------------------------------------------------+-----------------+-----------------+--------------+------------+------------+
; -2.058 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[12] ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[4]  ; debounce_cnt[0] ; debounce_cnt[0] ; 1.000        ; -0.055     ; 2.998      ;
; -1.910 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[12] ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[2]  ; debounce_cnt[0] ; debounce_cnt[0] ; 1.000        ; -0.043     ; 2.862      ;
; -1.894 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[12] ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[1]  ; debounce_cnt[0] ; debounce_cnt[0] ; 1.000        ; -0.055     ; 2.834      ;
; -1.887 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[1]  ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[12] ; debounce_cnt[0] ; debounce_cnt[0] ; 1.000        ; -0.055     ; 2.827      ;
; -1.855 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[7]  ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[4]  ; debounce_cnt[0] ; debounce_cnt[0] ; 1.000        ; -0.055     ; 2.795      ;
; -1.851 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[12] ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[3]  ; debounce_cnt[0] ; debounce_cnt[0] ; 1.000        ; -0.043     ; 2.803      ;
; -1.848 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[6]  ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[4]  ; debounce_cnt[0] ; debounce_cnt[0] ; 1.000        ; -0.055     ; 2.788      ;
; -1.838 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[0]  ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[13] ; debounce_cnt[0] ; debounce_cnt[0] ; 1.000        ; -0.055     ; 2.778      ;
; -1.821 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[11] ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[4]  ; debounce_cnt[0] ; debounce_cnt[0] ; 1.000        ; -0.055     ; 2.761      ;
; -1.802 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[12] ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[11] ; debounce_cnt[0] ; debounce_cnt[0] ; 1.000        ; -0.055     ; 2.742      ;
; -1.802 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[12] ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[12] ; debounce_cnt[0] ; debounce_cnt[0] ; 1.000        ; -0.055     ; 2.742      ;
; -1.798 ; debouncer:debounce_enc_a|jk_ff                   ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[4]  ; debounce_cnt[0] ; debounce_cnt[0] ; 1.000        ; -0.044     ; 2.749      ;
; -1.768 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[12] ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[7]  ; debounce_cnt[0] ; debounce_cnt[0] ; 1.000        ; -0.055     ; 2.708      ;
; -1.765 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[12] ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[5]  ; debounce_cnt[0] ; debounce_cnt[0] ; 1.000        ; -0.055     ; 2.705      ;
; -1.765 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[12] ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[6]  ; debounce_cnt[0] ; debounce_cnt[0] ; 1.000        ; -0.055     ; 2.705      ;
; -1.748 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[6]  ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[2]  ; debounce_cnt[0] ; debounce_cnt[0] ; 1.000        ; -0.043     ; 2.700      ;
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; -1.534 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[1]  ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[1]  ; debounce_cnt[0] ; debounce_cnt[0] ; 1.000        ; -0.055     ; 2.474      ;
; -1.531 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[6]  ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[13] ; debounce_cnt[0] ; debounce_cnt[0] ; 1.000        ; -0.043     ; 2.483      ;
; -1.531 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[11] ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[7]  ; debounce_cnt[0] ; debounce_cnt[0] ; 1.000        ; -0.055     ; 2.471      ;
; -1.528 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[11] ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[5]  ; debounce_cnt[0] ; debounce_cnt[0] ; 1.000        ; -0.055     ; 2.468      ;
; -1.528 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[11] ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[6]  ; debounce_cnt[0] ; debounce_cnt[0] ; 1.000        ; -0.055     ; 2.468      ;
; -1.521 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[3]  ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[12] ; debounce_cnt[0] ; debounce_cnt[0] ; 1.000        ; -0.067     ; 2.449      ;
; -1.520 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[2]  ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[12] ; debounce_cnt[0] ; debounce_cnt[0] ; 1.000        ; -0.067     ; 2.448      ;
; -1.520 ; debouncer:debounce_enc_a|jk_ff                   ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[1]  ; debounce_cnt[0] ; debounce_cnt[0] ; 1.000        ; -0.044     ; 2.471      ;
; -1.519 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[1]  ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[8]  ; debounce_cnt[0] ; debounce_cnt[0] ; 1.000        ; -0.043     ; 2.471      ;
; -1.508 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[6]  ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[9]  ; debounce_cnt[0] ; debounce_cnt[0] ; 1.000        ; -0.042     ; 2.461      ;
; -1.508 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[2]  ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[9]  ; debounce_cnt[0] ; debounce_cnt[0] ; 1.000        ; -0.054     ; 2.449      ;
; -1.507 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[10] ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[13] ; debounce_cnt[0] ; debounce_cnt[0] ; 1.000        ; -0.056     ; 2.446      ;
; -1.502 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[7]  ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[9]  ; debounce_cnt[0] ; debounce_cnt[0] ; 1.000        ; -0.042     ; 2.455      ;
; -1.501 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[0]  ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[7]  ; debounce_cnt[0] ; debounce_cnt[0] ; 1.000        ; -0.067     ; 2.429      ;
; -1.492 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[8]  ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[13] ; debounce_cnt[0] ; debounce_cnt[0] ; 1.000        ; -0.055     ; 2.432      ;
; -1.491 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[6]  ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[10] ; debounce_cnt[0] ; debounce_cnt[0] ; 1.000        ; -0.042     ; 2.444      ;
; -1.488 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[5]  ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[11] ; debounce_cnt[0] ; debounce_cnt[0] ; 1.000        ; -0.055     ; 2.428      ;
; -1.486 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[2]  ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[11] ; debounce_cnt[0] ; debounce_cnt[0] ; 1.000        ; -0.067     ; 2.414      ;
+--------+--------------------------------------------------+--------------------------------------------------+-----------------+-----------------+--------------+------------+------------+


+-----------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+
; Slow 1200mV 0C Model Setup: 'pll_lab5_inst|altpll_component|auto_generated|pll1|clk[1]'                                                                                                                         ;
+------------+-----------------+-----------------+-----------------------------------------------------------+-----------------------------------------------------------+--------------+------------+------------+
; Slack      ; From Node       ; To Node         ; Launch Clock                                              ; Latch Clock                                               ; Relationship ; Clock Skew ; Data Delay ;
+------------+-----------------+-----------------+-----------------------------------------------------------+-----------------------------------------------------------+--------------+------------+------------+
; -0.608     ; debounce_cnt[0] ; debounce_cnt[1] ; debounce_cnt[0]                                           ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[1] ; 0.500        ; 0.002      ; 1.235      ;
; -0.588     ; debounce_cnt[0] ; digit_clk       ; debounce_cnt[0]                                           ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[1] ; 0.500        ; 0.002      ; 1.215      ;
; -0.550     ; debounce_cnt[0] ; debounce_cnt[0] ; debounce_cnt[0]                                           ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[1] ; 0.500        ; 0.002      ; 1.177      ;
; -0.058     ; debounce_cnt[0] ; debounce_cnt[1] ; debounce_cnt[0]                                           ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[1] ; 1.000        ; 0.002      ; 1.185      ;
; -0.040     ; debounce_cnt[0] ; debounce_cnt[0] ; debounce_cnt[0]                                           ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[1] ; 1.000        ; 0.002      ; 1.167      ;
; -0.028     ; debounce_cnt[0] ; digit_clk       ; debounce_cnt[0]                                           ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[1] ; 1.000        ; 0.002      ; 1.155      ;
; 0.065      ; digit_clk       ; digit_clk       ; digit_clk                                                 ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[1] ; 0.500        ; 0.002      ; 0.562      ;
; 0.544      ; digit_clk       ; digit_clk       ; digit_clk                                                 ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[1] ; 1.000        ; 0.002      ; 0.583      ;
; 249998.594 ; debounce_cnt[1] ; debounce_cnt[1] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[1] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[1] ; 250000.000   ; -0.056     ; 1.345      ;
; 249998.614 ; debounce_cnt[1] ; digit_clk       ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[1] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[1] ; 250000.000   ; -0.056     ; 1.325      ;
; 249998.652 ; debounce_cnt[1] ; debounce_cnt[0] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[1] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[1] ; 250000.000   ; -0.056     ; 1.287      ;
+------------+-----------------+-----------------+-----------------------------------------------------------+-----------------------------------------------------------+--------------+------------+------------+


+------------------------------------------------------------------------------------------------------------------+
; Slow 1200mV 0C Model Setup: 'digit_clk'                                                                          ;
+--------+-----------------+-----------------+--------------+-------------+--------------+------------+------------+
; Slack  ; From Node       ; To Node         ; Launch Clock ; Latch Clock ; Relationship ; Clock Skew ; Data Delay ;
+--------+-----------------+-----------------+--------------+-------------+--------------+------------+------------+
; -0.347 ; digit_seq_ps[2] ; digit_seq_ps[2] ; digit_clk    ; digit_clk   ; 1.000        ; -0.057     ; 1.285      ;
; -0.265 ; digit_seq_ps[1] ; digit_seq_ps[2] ; digit_clk    ; digit_clk   ; 1.000        ; -0.057     ; 1.203      ;
; -0.244 ; digit_seq_ps[1] ; digit_seq_ps[0] ; digit_clk    ; digit_clk   ; 1.000        ; -0.057     ; 1.182      ;
; -0.232 ; digit_seq_ps[2] ; digit_seq_ps[0] ; digit_clk    ; digit_clk   ; 1.000        ; -0.057     ; 1.170      ;
; -0.121 ; digit_seq_ps[0] ; digit_seq_ps[2] ; digit_clk    ; digit_clk   ; 1.000        ; -0.057     ; 1.059      ;
; -0.102 ; digit_seq_ps[0] ; digit_seq_ps[1] ; digit_clk    ; digit_clk   ; 1.000        ; -0.057     ; 1.040      ;
; 0.024  ; digit_seq_ps[2] ; digit_seq_ps[1] ; digit_clk    ; digit_clk   ; 1.000        ; -0.057     ; 0.914      ;
; 0.355  ; digit_seq_ps[1] ; digit_seq_ps[1] ; digit_clk    ; digit_clk   ; 1.000        ; -0.057     ; 0.583      ;
+--------+-----------------+-----------------+--------------+-------------+--------------+------------+------------+


+-------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+
; Slow 1200mV 0C Model Hold: 'pll_lab5_inst|altpll_component|auto_generated|pll1|clk[1]'                                                                                                                      ;
+--------+-----------------+-----------------+-----------------------------------------------------------+-----------------------------------------------------------+--------------+------------+------------+
; Slack  ; From Node       ; To Node         ; Launch Clock                                              ; Latch Clock                                               ; Relationship ; Clock Skew ; Data Delay ;
+--------+-----------------+-----------------+-----------------------------------------------------------+-----------------------------------------------------------+--------------+------------+------------+
; -0.265 ; digit_clk       ; digit_clk       ; digit_clk                                                 ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[1] ; 0.000        ; 0.359      ; 0.518      ;
; -0.251 ; debounce_cnt[0] ; debounce_cnt[0] ; debounce_cnt[0]                                           ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[1] ; 0.000        ; 0.359      ; 0.532      ;
; 0.195  ; debounce_cnt[0] ; debounce_cnt[1] ; debounce_cnt[0]                                           ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[1] ; 0.000        ; 0.359      ; 0.978      ;
; 0.228  ; digit_clk       ; digit_clk       ; digit_clk                                                 ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[1] ; -0.500       ; 0.359      ; 0.511      ;
; 0.236  ; debounce_cnt[0] ; debounce_cnt[0] ; debounce_cnt[0]                                           ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[1] ; -0.500       ; 0.359      ; 0.519      ;
; 0.242  ; debounce_cnt[0] ; digit_clk       ; debounce_cnt[0]                                           ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[1] ; 0.000        ; 0.359      ; 1.025      ;
; 0.311  ; debounce_cnt[1] ; debounce_cnt[1] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[1] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[1] ; 0.000        ; 0.056      ; 0.511      ;
; 0.715  ; debounce_cnt[0] ; debounce_cnt[1] ; debounce_cnt[0]                                           ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[1] ; -0.500       ; 0.359      ; 0.998      ;
; 0.802  ; debounce_cnt[0] ; digit_clk       ; debounce_cnt[0]                                           ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[1] ; -0.500       ; 0.359      ; 1.085      ;
; 0.900  ; debounce_cnt[1] ; digit_clk       ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[1] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[1] ; 0.000        ; 0.056      ; 1.100      ;
; 0.983  ; debounce_cnt[1] ; debounce_cnt[0] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[1] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[1] ; 0.000        ; 0.056      ; 1.183      ;
+--------+-----------------+-----------------+-----------------------------------------------------------+-----------------------------------------------------------+--------------+------------+------------+


+------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+
; Slow 1200mV 0C Model Hold: 'debounce_cnt[0]'                                                                                                                                             ;
+-------+--------------------------------------------------+--------------------------------------------------+-----------------+-----------------+--------------+------------+------------+
; Slack ; From Node                                        ; To Node                                          ; Launch Clock    ; Latch Clock     ; Relationship ; Clock Skew ; Data Delay ;
+-------+--------------------------------------------------+--------------------------------------------------+-----------------+-----------------+--------------+------------+------------+
; 0.312 ; debouncer:debounce_enc_b|jk_ff                   ; debouncer:debounce_enc_b|jk_ff                   ; debounce_cnt[0] ; debounce_cnt[0] ; 0.000        ; 0.055      ; 0.511      ;
; 0.313 ; debouncer:debounce_enc_a|jk_ff                   ; debouncer:debounce_enc_a|jk_ff                   ; debounce_cnt[0] ; debounce_cnt[0] ; 0.000        ; 0.054      ; 0.511      ;
; 0.339 ; debouncer:debounce_enc_b|shift_reg[3]            ; debouncer:debounce_enc_b|jk_ff                   ; debounce_cnt[0] ; debounce_cnt[0] ; 0.000        ; 0.055      ; 0.538      ;
; 0.340 ; debouncer:debounce_enc_a|shift_reg[0]            ; debouncer:debounce_enc_a|shift_reg[1]            ; debounce_cnt[0] ; debounce_cnt[0] ; 0.000        ; 0.054      ; 0.538      ;
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; 1.408 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[0]  ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[13] ; debounce_cnt[0] ; debounce_cnt[0] ; 0.000        ; 0.055      ; 1.607      ;
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; 1.410 ; debouncer:debounce_enc_b|jk_ff                   ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[11] ; debounce_cnt[0] ; debounce_cnt[0] ; 0.000        ; 0.055      ; 1.609      ;
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; 1.420 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[9]  ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[3]  ; debounce_cnt[0] ; debounce_cnt[0] ; 0.000        ; 0.054      ; 1.618      ;
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; 1.421 ; quad_decode:quad_decode_0|quad_ff_a              ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[10] ; debounce_cnt[0] ; debounce_cnt[0] ; 0.000        ; 0.068      ; 1.633      ;
; 1.422 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[9]  ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[0]  ; debounce_cnt[0] ; debounce_cnt[0] ; 0.000        ; 0.054      ; 1.620      ;
; 1.423 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[9]  ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[2]  ; debounce_cnt[0] ; debounce_cnt[0] ; 0.000        ; 0.054      ; 1.621      ;
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; 1.428 ; debouncer:debounce_enc_b|jk_ff                   ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[0]  ; debounce_cnt[0] ; debounce_cnt[0] ; 0.000        ; 0.067      ; 1.639      ;
; 1.428 ; debouncer:debounce_enc_b|jk_ff                   ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[2]  ; debounce_cnt[0] ; debounce_cnt[0] ; 0.000        ; 0.067      ; 1.639      ;
; 1.428 ; debouncer:debounce_enc_b|jk_ff                   ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[3]  ; debounce_cnt[0] ; debounce_cnt[0] ; 0.000        ; 0.067      ; 1.639      ;
; 1.428 ; debouncer:debounce_enc_b|jk_ff                   ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[8]  ; debounce_cnt[0] ; debounce_cnt[0] ; 0.000        ; 0.067      ; 1.639      ;
; 1.428 ; debouncer:debounce_enc_b|jk_ff                   ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[13] ; debounce_cnt[0] ; debounce_cnt[0] ; 0.000        ; 0.067      ; 1.639      ;
; 1.431 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[7]  ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[7]  ; debounce_cnt[0] ; debounce_cnt[0] ; 0.000        ; 0.055      ; 1.630      ;
; 1.437 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[0]  ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[3]  ; debounce_cnt[0] ; debounce_cnt[0] ; 0.000        ; 0.055      ; 1.636      ;
; 1.439 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[13] ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[3]  ; debounce_cnt[0] ; debounce_cnt[0] ; 0.000        ; 0.055      ; 1.638      ;
; 1.443 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[9]  ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[12] ; debounce_cnt[0] ; debounce_cnt[0] ; 0.000        ; 0.042      ; 1.629      ;
; 1.444 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[5]  ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[5]  ; debounce_cnt[0] ; debounce_cnt[0] ; 0.000        ; 0.055      ; 1.643      ;
; 1.445 ; debouncer:debounce_enc_b|jk_ff                   ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[9]  ; debounce_cnt[0] ; debounce_cnt[0] ; 0.000        ; 0.068      ; 1.657      ;
; 1.445 ; debouncer:debounce_enc_b|jk_ff                   ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[10] ; debounce_cnt[0] ; debounce_cnt[0] ; 0.000        ; 0.068      ; 1.657      ;
; 1.463 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[11] ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[13] ; debounce_cnt[0] ; debounce_cnt[0] ; 0.000        ; 0.067      ; 1.674      ;
; 1.465 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[2]  ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[10] ; debounce_cnt[0] ; debounce_cnt[0] ; 0.000        ; 0.056      ; 1.665      ;
+-------+--------------------------------------------------+--------------------------------------------------+-----------------+-----------------+--------------+------------+------------+


+-----------------------------------------------------------------------------------------------------------------+
; Slow 1200mV 0C Model Hold: 'digit_clk'                                                                          ;
+-------+-----------------+-----------------+--------------+-------------+--------------+------------+------------+
; Slack ; From Node       ; To Node         ; Launch Clock ; Latch Clock ; Relationship ; Clock Skew ; Data Delay ;
+-------+-----------------+-----------------+--------------+-------------+--------------+------------+------------+
; 0.318 ; digit_seq_ps[1] ; digit_seq_ps[1] ; digit_clk    ; digit_clk   ; 0.000        ; 0.057      ; 0.519      ;
; 0.554 ; digit_seq_ps[2] ; digit_seq_ps[1] ; digit_clk    ; digit_clk   ; 0.000        ; 0.057      ; 0.755      ;
; 0.693 ; digit_seq_ps[0] ; digit_seq_ps[1] ; digit_clk    ; digit_clk   ; 0.000        ; 0.057      ; 0.894      ;
; 0.766 ; digit_seq_ps[0] ; digit_seq_ps[2] ; digit_clk    ; digit_clk   ; 0.000        ; 0.057      ; 0.967      ;
; 0.874 ; digit_seq_ps[1] ; digit_seq_ps[2] ; digit_clk    ; digit_clk   ; 0.000        ; 0.057      ; 1.075      ;
; 0.881 ; digit_seq_ps[2] ; digit_seq_ps[0] ; digit_clk    ; digit_clk   ; 0.000        ; 0.057      ; 1.082      ;
; 0.931 ; digit_seq_ps[1] ; digit_seq_ps[0] ; digit_clk    ; digit_clk   ; 0.000        ; 0.057      ; 1.132      ;
; 0.973 ; digit_seq_ps[2] ; digit_seq_ps[2] ; digit_clk    ; digit_clk   ; 0.000        ; 0.057      ; 1.174      ;
+-------+-----------------+-----------------+--------------+-------------+--------------+------------+------------+


+--------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+
; Slow 1200mV 0C Model Hold: 'pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2]'                                                                                                                                                                                                           ;
+-------+--------------+----------------------------------------------------------------------------------------------------------+-----------------------------------------------------------+-----------------------------------------------------------+--------------+------------+------------+
; Slack ; From Node    ; To Node                                                                                                  ; Launch Clock                                              ; Latch Clock                                               ; Relationship ; Clock Skew ; Data Delay ;
+-------+--------------+----------------------------------------------------------------------------------------------------------+-----------------------------------------------------------+-----------------------------------------------------------+--------------+------------+------------+
; 0.479 ; rom_addr[9]  ; rom_addr[9]                                                                                              ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.000        ; 0.068      ; 0.691      ;
; 0.480 ; rom_addr[11] ; rom_addr[11]                                                                                             ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.000        ; 0.068      ; 0.692      ;
; 0.481 ; rom_addr[12] ; rom_addr[12]                                                                                             ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.000        ; 0.068      ; 0.693      ;
; 0.482 ; rom_addr[10] ; rom_addr[10]                                                                                             ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.000        ; 0.068      ; 0.694      ;
; 0.484 ; rom_addr[4]  ; rom_addr[4]                                                                                              ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.000        ; 0.068      ; 0.696      ;
; 0.484 ; rom_addr[3]  ; rom_addr[3]                                                                                              ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.000        ; 0.068      ; 0.696      ;
; 0.495 ; rom_addr[0]  ; rom_addr[0]                                                                                              ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.000        ; 0.068      ; 0.707      ;
; 0.498 ; rom_addr[15] ; rom_addr[15]                                                                                             ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.000        ; 0.068      ; 0.710      ;
; 0.499 ; rom_addr[17] ; rom_addr[17]                                                                                             ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.000        ; 0.068      ; 0.711      ;
; 0.500 ; rom_addr[23] ; rom_addr[23]                                                                                             ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.000        ; 0.068      ; 0.712      ;
; 0.500 ; rom_addr[18] ; rom_addr[18]                                                                                             ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.000        ; 0.068      ; 0.712      ;
; 0.502 ; rom_addr[21] ; rom_addr[21]                                                                                             ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.000        ; 0.068      ; 0.714      ;
; 0.502 ; rom_addr[19] ; rom_addr[19]                                                                                             ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.000        ; 0.068      ; 0.714      ;
; 0.502 ; rom_addr[14] ; rom_addr[14]                                                                                             ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.000        ; 0.068      ; 0.714      ;
; 0.502 ; rom_addr[13] ; rom_addr[13]                                                                                             ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.000        ; 0.068      ; 0.714      ;
; 0.503 ; rom_addr[16] ; rom_addr[16]                                                                                             ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.000        ; 0.068      ; 0.715      ;
; 0.504 ; rom_addr[22] ; rom_addr[22]                                                                                             ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.000        ; 0.068      ; 0.716      ;
; 0.504 ; rom_addr[20] ; rom_addr[20]                                                                                             ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.000        ; 0.068      ; 0.716      ;
; 0.551 ; rom_addr[2]  ; rom_addr[3]                                                                                              ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.000        ; 0.382      ; 1.077      ;
; 0.558 ; rom_addr[2]  ; rom_addr[4]                                                                                              ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.000        ; 0.382      ; 1.084      ;
; 0.606 ; rom_addr[7]  ; rom_addr[7]                                                                                              ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.000        ; 0.068      ; 0.818      ;
; 0.613 ; rom_addr[8]  ; rom_addr[8]                                                                                              ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.000        ; 0.068      ; 0.825      ;
; 0.614 ; rom_addr[5]  ; rom_addr[5]                                                                                              ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.000        ; 0.068      ; 0.826      ;
; 0.627 ; rom_addr[2]  ; rom_addr[2]                                                                                              ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.000        ; 0.055      ; 0.826      ;
; 0.630 ; rom_addr[1]  ; rom_addr[1]                                                                                              ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.000        ; 0.055      ; 0.829      ;
; 0.633 ; rom_addr[1]  ; rom_addr[3]                                                                                              ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.000        ; 0.382      ; 1.159      ;
; 0.642 ; rom_addr[1]  ; rom_addr[4]                                                                                              ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.000        ; 0.382      ; 1.168      ;
; 0.647 ; rom_addr[2]  ; rom_addr[5]                                                                                              ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.000        ; 0.382      ; 1.173      ;
; 0.654 ; rom_addr[2]  ; rom_addr[6]                                                                                              ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.000        ; 0.382      ; 1.180      ;
; 0.723 ; rom_addr[9]  ; rom_addr[10]                                                                                             ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.000        ; 0.068      ; 0.935      ;
; 0.726 ; rom_addr[11] ; rom_addr[12]                                                                                             ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.000        ; 0.065      ; 0.935      ;
; 0.729 ; rom_addr[3]  ; rom_addr[4]                                                                                              ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.000        ; 0.068      ; 0.941      ;
; 0.729 ; rom_addr[1]  ; rom_addr[5]                                                                                              ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.000        ; 0.382      ; 1.255      ;
; 0.732 ; rom_addr[12] ; rom_addr[13]                                                                                             ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.000        ; 0.068      ; 0.944      ;
; 0.733 ; rom_addr[10] ; rom_addr[11]                                                                                             ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.000        ; 0.068      ; 0.945      ;
; 0.735 ; rom_addr[4]  ; rom_addr[5]                                                                                              ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.000        ; 0.068      ; 0.947      ;
; 0.738 ; rom_addr[1]  ; rom_addr[6]                                                                                              ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.000        ; 0.382      ; 1.264      ;
; 0.739 ; rom_addr[12] ; rom_addr[14]                                                                                             ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.000        ; 0.068      ; 0.951      ;
; 0.742 ; rom_addr[15] ; rom_addr[16]                                                                                             ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.000        ; 0.068      ; 0.954      ;
; 0.742 ; rom_addr[4]  ; rom_addr[6]                                                                                              ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.000        ; 0.068      ; 0.954      ;
; 0.743 ; rom_addr[17] ; rom_addr[18]                                                                                             ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.000        ; 0.068      ; 0.955      ;
; 0.743 ; rom_addr[2]  ; rom_addr[7]                                                                                              ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.000        ; 0.382      ; 1.269      ;
; 0.743 ; rom_addr[10] ; rom_addr[12]                                                                                             ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.000        ; 0.065      ; 0.952      ;
; 0.745 ; rom_addr[13] ; rom_addr[14]                                                                                             ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.000        ; 0.068      ; 0.957      ;
; 0.747 ; rom_addr[21] ; rom_addr[22]                                                                                             ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.000        ; 0.068      ; 0.959      ;
; 0.747 ; rom_addr[19] ; rom_addr[20]                                                                                             ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.000        ; 0.068      ; 0.959      ;
; 0.749 ; rom_addr[18] ; rom_addr[19]                                                                                             ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.000        ; 0.068      ; 0.961      ;
; 0.750 ; rom_addr[2]  ; rom_addr[8]                                                                                              ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.000        ; 0.382      ; 1.276      ;
; 0.751 ; rom_addr[14] ; rom_addr[15]                                                                                             ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.000        ; 0.068      ; 0.963      ;
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; 0.753 ; rom_addr[22] ; rom_addr[23]                                                                                             ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.000        ; 0.068      ; 0.965      ;
; 0.753 ; rom_addr[20] ; rom_addr[21]                                                                                             ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.000        ; 0.068      ; 0.965      ;
; 0.756 ; rom_addr[18] ; rom_addr[20]                                                                                             ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.000        ; 0.068      ; 0.968      ;
; 0.758 ; rom_addr[14] ; rom_addr[16]                                                                                             ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.000        ; 0.068      ; 0.970      ;
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; 0.825 ; rom_addr[1]  ; rom_addr[7]                                                                                              ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.000        ; 0.382      ; 1.351      ;
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; 0.832 ; rom_addr[17] ; rom_addr[19]                                                                                             ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.000        ; 0.068      ; 1.044      ;
; 0.832 ; rom_addr[10] ; rom_addr[13]                                                                                             ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.000        ; 0.065      ; 1.041      ;
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; 0.834 ; rom_addr[13] ; rom_addr[15]                                                                                             ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.000        ; 0.068      ; 1.046      ;
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; 0.837 ; rom_addr[0]  ; rom_addr[4]                                                                                              ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.000        ; 0.068      ; 1.049      ;
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; 0.846 ; rom_addr[23] ; sine_rom:sine_rom_0|altsyncram:Ram0_rtl_0|altsyncram_ct61:auto_generated|ram_block1a0~porta_address_reg0 ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.000        ; 0.036      ; 1.051      ;
; 0.846 ; rom_addr[2]  ; rom_addr[10]                                                                                             ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.000        ; 0.382      ; 1.372      ;
; 0.847 ; rom_addr[18] ; sine_rom:sine_rom_0|altsyncram:Ram0_rtl_0|altsyncram_ct61:auto_generated|ram_block1a0~porta_address_reg0 ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.000        ; 0.036      ; 1.052      ;
; 0.847 ; rom_addr[14] ; rom_addr[17]                                                                                             ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.000        ; 0.068      ; 1.059      ;
; 0.848 ; rom_addr[16] ; rom_addr[19]                                                                                             ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.000        ; 0.068      ; 1.060      ;
; 0.849 ; rom_addr[19] ; sine_rom:sine_rom_0|altsyncram:Ram0_rtl_0|altsyncram_ct61:auto_generated|ram_block1a0~porta_address_reg0 ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.000        ; 0.036      ; 1.054      ;
; 0.849 ; rom_addr[20] ; rom_addr[23]                                                                                             ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.000        ; 0.068      ; 1.061      ;
; 0.851 ; rom_addr[7]  ; rom_addr[8]                                                                                              ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.000        ; 0.068      ; 1.063      ;
; 0.852 ; rom_addr[18] ; rom_addr[22]                                                                                             ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.000        ; 0.068      ; 1.064      ;
; 0.854 ; rom_addr[14] ; rom_addr[18]                                                                                             ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.000        ; 0.068      ; 1.066      ;
; 0.855 ; rom_addr[16] ; rom_addr[20]                                                                                             ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.000        ; 0.068      ; 1.067      ;
; 0.858 ; rom_addr[14] ; sine_rom:sine_rom_0|altsyncram:Ram0_rtl_0|altsyncram_ct61:auto_generated|ram_block1a4~porta_address_reg0 ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.000        ; 0.035      ; 1.062      ;
+-------+--------------+----------------------------------------------------------------------------------------------------------+-----------------------------------------------------------+-----------------------------------------------------------+--------------+------------+------------+


----------------------------------------------
; Slow 1200mV 0C Model Metastability Summary ;
----------------------------------------------
No synchronizer chains to report.


+------------------------------------------------------------------------------------+
; Fast 1200mV 0C Model Setup Summary                                                 ;
+-----------------------------------------------------------+--------+---------------+
; Clock                                                     ; Slack  ; End Point TNS ;
+-----------------------------------------------------------+--------+---------------+
; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; -3.152 ; -66.595       ;
; debounce_cnt[0]                                           ; -0.853 ; -10.334       ;
; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[1] ; -0.325 ; -0.920        ;
; digit_clk                                                 ; 0.174  ; 0.000         ;
+-----------------------------------------------------------+--------+---------------+


+------------------------------------------------------------------------------------+
; Fast 1200mV 0C Model Hold Summary                                                  ;
+-----------------------------------------------------------+--------+---------------+
; Clock                                                     ; Slack  ; End Point TNS ;
+-----------------------------------------------------------+--------+---------------+
; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[1] ; -0.116 ; -0.216        ;
; debounce_cnt[0]                                           ; 0.187  ; 0.000         ;
; digit_clk                                                 ; 0.194  ; 0.000         ;
; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.285  ; 0.000         ;
+-----------------------------------------------------------+--------+---------------+


-----------------------------------------
; Fast 1200mV 0C Model Recovery Summary ;
-----------------------------------------
No paths to report.


----------------------------------------
; Fast 1200mV 0C Model Removal Summary ;
----------------------------------------
No paths to report.


+----------------------------------------------------------------------------------------+
; Fast 1200mV 0C Model Minimum Pulse Width Summary                                       ;
+-----------------------------------------------------------+------------+---------------+
; Clock                                                     ; Slack      ; End Point TNS ;
+-----------------------------------------------------------+------------+---------------+
; debounce_cnt[0]                                           ; -1.000     ; -26.000       ;
; digit_clk                                                 ; -1.000     ; -3.000        ;
; inclk0_sig                                                ; 9.587      ; 0.000         ;
; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 29.556     ; 0.000         ;
; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[1] ; 124999.782 ; 0.000         ;
+-----------------------------------------------------------+------------+---------------+


+-------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+
; Fast 1200mV 0C Model Setup: 'pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2]'                                                                                                         ;
+--------+--------------------------------------------------+--------------+-----------------+-----------------------------------------------------------+--------------+------------+------------+
; Slack  ; From Node                                        ; To Node      ; Launch Clock    ; Latch Clock                                               ; Relationship ; Clock Skew ; Data Delay ;
+--------+--------------------------------------------------+--------------+-----------------+-----------------------------------------------------------+--------------+------------+------------+
; -3.152 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[0]  ; rom_addr[23] ; debounce_cnt[0] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.001        ; -1.374     ; 1.716      ;
; -3.130 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[0]  ; rom_addr[22] ; debounce_cnt[0] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.001        ; -1.374     ; 1.694      ;
; -3.108 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[3]  ; rom_addr[23] ; debounce_cnt[0] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.001        ; -1.374     ; 1.672      ;
; -3.095 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[2]  ; rom_addr[23] ; debounce_cnt[0] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.001        ; -1.374     ; 1.659      ;
; -3.084 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[0]  ; rom_addr[21] ; debounce_cnt[0] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.001        ; -1.374     ; 1.648      ;
; -3.076 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[2]  ; rom_addr[22] ; debounce_cnt[0] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.001        ; -1.374     ; 1.640      ;
; -3.062 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[0]  ; rom_addr[20] ; debounce_cnt[0] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.001        ; -1.374     ; 1.626      ;
; -3.053 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[3]  ; rom_addr[22] ; debounce_cnt[0] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.001        ; -1.374     ; 1.617      ;
; -3.048 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[8]  ; rom_addr[23] ; debounce_cnt[0] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.001        ; -1.374     ; 1.612      ;
; -3.040 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[3]  ; rom_addr[21] ; debounce_cnt[0] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.001        ; -1.374     ; 1.604      ;
; -3.038 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[1]  ; rom_addr[23] ; debounce_cnt[0] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.001        ; -1.366     ; 1.610      ;
; -3.034 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[1]  ; rom_addr[22] ; debounce_cnt[0] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.001        ; -1.366     ; 1.606      ;
; -3.027 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[2]  ; rom_addr[21] ; debounce_cnt[0] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.001        ; -1.374     ; 1.591      ;
; -3.016 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[0]  ; rom_addr[19] ; debounce_cnt[0] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.001        ; -1.374     ; 1.580      ;
; -3.008 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[2]  ; rom_addr[20] ; debounce_cnt[0] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.001        ; -1.374     ; 1.572      ;
; -2.994 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[0]  ; rom_addr[18] ; debounce_cnt[0] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.001        ; -1.374     ; 1.558      ;
; -2.985 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[3]  ; rom_addr[20] ; debounce_cnt[0] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.001        ; -1.374     ; 1.549      ;
; -2.984 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[8]  ; rom_addr[22] ; debounce_cnt[0] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.001        ; -1.374     ; 1.548      ;
; -2.983 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[13] ; rom_addr[23] ; debounce_cnt[0] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.001        ; -1.374     ; 1.547      ;
; -2.980 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[8]  ; rom_addr[21] ; debounce_cnt[0] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.001        ; -1.374     ; 1.544      ;
; -2.979 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[13] ; rom_addr[22] ; debounce_cnt[0] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.001        ; -1.374     ; 1.543      ;
; -2.972 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[3]  ; rom_addr[19] ; debounce_cnt[0] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.001        ; -1.374     ; 1.536      ;
; -2.970 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[1]  ; rom_addr[21] ; debounce_cnt[0] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.001        ; -1.366     ; 1.542      ;
; -2.966 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[1]  ; rom_addr[20] ; debounce_cnt[0] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.001        ; -1.366     ; 1.538      ;
; -2.959 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[2]  ; rom_addr[19] ; debounce_cnt[0] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.001        ; -1.374     ; 1.523      ;
; -2.948 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[0]  ; rom_addr[17] ; debounce_cnt[0] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.001        ; -1.374     ; 1.512      ;
; -2.940 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[2]  ; rom_addr[18] ; debounce_cnt[0] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.001        ; -1.374     ; 1.504      ;
; -2.926 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[0]  ; rom_addr[16] ; debounce_cnt[0] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.001        ; -1.374     ; 1.490      ;
; -2.917 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[3]  ; rom_addr[18] ; debounce_cnt[0] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.001        ; -1.374     ; 1.481      ;
; -2.916 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[8]  ; rom_addr[20] ; debounce_cnt[0] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.001        ; -1.374     ; 1.480      ;
; -2.915 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[13] ; rom_addr[21] ; debounce_cnt[0] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.001        ; -1.374     ; 1.479      ;
; -2.912 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[8]  ; rom_addr[19] ; debounce_cnt[0] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.001        ; -1.374     ; 1.476      ;
; -2.911 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[13] ; rom_addr[20] ; debounce_cnt[0] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.001        ; -1.374     ; 1.475      ;
; -2.904 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[3]  ; rom_addr[17] ; debounce_cnt[0] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.001        ; -1.374     ; 1.468      ;
; -2.902 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[4]  ; rom_addr[23] ; debounce_cnt[0] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.001        ; -1.366     ; 1.474      ;
; -2.902 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[1]  ; rom_addr[19] ; debounce_cnt[0] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.001        ; -1.366     ; 1.474      ;
; -2.901 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[6]  ; rom_addr[23] ; debounce_cnt[0] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.001        ; -1.366     ; 1.473      ;
; -2.898 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[1]  ; rom_addr[18] ; debounce_cnt[0] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.001        ; -1.366     ; 1.470      ;
; -2.891 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[2]  ; rom_addr[17] ; debounce_cnt[0] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.001        ; -1.374     ; 1.455      ;
; -2.880 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[0]  ; rom_addr[15] ; debounce_cnt[0] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.001        ; -1.374     ; 1.444      ;
; -2.872 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[2]  ; rom_addr[16] ; debounce_cnt[0] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.001        ; -1.374     ; 1.436      ;
; -2.869 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[9]  ; rom_addr[23] ; debounce_cnt[0] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.001        ; -1.375     ; 1.432      ;
; -2.869 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[4]  ; rom_addr[22] ; debounce_cnt[0] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.001        ; -1.366     ; 1.441      ;
; -2.858 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[0]  ; rom_addr[14] ; debounce_cnt[0] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.001        ; -1.374     ; 1.422      ;
; -2.853 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[10] ; rom_addr[23] ; debounce_cnt[0] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.001        ; -1.375     ; 1.416      ;
; -2.849 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[3]  ; rom_addr[16] ; debounce_cnt[0] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.001        ; -1.374     ; 1.413      ;
; -2.848 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[8]  ; rom_addr[18] ; debounce_cnt[0] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.001        ; -1.374     ; 1.412      ;
; -2.847 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[10] ; rom_addr[22] ; debounce_cnt[0] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.001        ; -1.375     ; 1.410      ;
; -2.847 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[13] ; rom_addr[19] ; debounce_cnt[0] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.001        ; -1.374     ; 1.411      ;
; -2.846 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[5]  ; rom_addr[23] ; debounce_cnt[0] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.001        ; -1.366     ; 1.418      ;
; -2.844 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[8]  ; rom_addr[17] ; debounce_cnt[0] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.001        ; -1.374     ; 1.408      ;
; -2.843 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[13] ; rom_addr[18] ; debounce_cnt[0] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.001        ; -1.374     ; 1.407      ;
; -2.837 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[6]  ; rom_addr[22] ; debounce_cnt[0] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.001        ; -1.366     ; 1.409      ;
; -2.836 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[3]  ; rom_addr[15] ; debounce_cnt[0] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.001        ; -1.374     ; 1.400      ;
; -2.834 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[4]  ; rom_addr[21] ; debounce_cnt[0] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.001        ; -1.366     ; 1.406      ;
; -2.834 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[1]  ; rom_addr[17] ; debounce_cnt[0] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.001        ; -1.366     ; 1.406      ;
; -2.833 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[6]  ; rom_addr[21] ; debounce_cnt[0] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.001        ; -1.366     ; 1.405      ;
; -2.830 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[11] ; rom_addr[23] ; debounce_cnt[0] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.001        ; -1.366     ; 1.402      ;
; -2.830 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[1]  ; rom_addr[16] ; debounce_cnt[0] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.001        ; -1.366     ; 1.402      ;
; -2.826 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[11] ; rom_addr[22] ; debounce_cnt[0] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.001        ; -1.366     ; 1.398      ;
; -2.823 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[2]  ; rom_addr[15] ; debounce_cnt[0] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.001        ; -1.374     ; 1.387      ;
; -2.818 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[9]  ; rom_addr[22] ; debounce_cnt[0] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.001        ; -1.375     ; 1.381      ;
; -2.812 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[0]  ; rom_addr[13] ; debounce_cnt[0] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.001        ; -1.374     ; 1.376      ;
; -2.806 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[5]  ; rom_addr[22] ; debounce_cnt[0] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.001        ; -1.366     ; 1.378      ;
; -2.804 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[2]  ; rom_addr[14] ; debounce_cnt[0] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.001        ; -1.374     ; 1.368      ;
; -2.801 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[9]  ; rom_addr[21] ; debounce_cnt[0] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.001        ; -1.375     ; 1.364      ;
; -2.801 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[4]  ; rom_addr[20] ; debounce_cnt[0] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.001        ; -1.366     ; 1.373      ;
; -2.794 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[7]  ; rom_addr[23] ; debounce_cnt[0] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.001        ; -1.366     ; 1.366      ;
; -2.790 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[0]  ; rom_addr[12] ; debounce_cnt[0] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.001        ; -1.374     ; 1.354      ;
; -2.790 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[12] ; rom_addr[23] ; debounce_cnt[0] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.001        ; -1.366     ; 1.362      ;
; -2.786 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[12] ; rom_addr[22] ; debounce_cnt[0] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.001        ; -1.366     ; 1.358      ;
; -2.785 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[10] ; rom_addr[21] ; debounce_cnt[0] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.001        ; -1.375     ; 1.348      ;
; -2.781 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[3]  ; rom_addr[14] ; debounce_cnt[0] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.001        ; -1.374     ; 1.345      ;
; -2.780 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[8]  ; rom_addr[16] ; debounce_cnt[0] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.001        ; -1.374     ; 1.344      ;
; -2.779 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[10] ; rom_addr[20] ; debounce_cnt[0] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.001        ; -1.375     ; 1.342      ;
; -2.779 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[13] ; rom_addr[17] ; debounce_cnt[0] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.001        ; -1.374     ; 1.343      ;
; -2.778 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[5]  ; rom_addr[21] ; debounce_cnt[0] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.001        ; -1.366     ; 1.350      ;
; -2.776 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[8]  ; rom_addr[15] ; debounce_cnt[0] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.001        ; -1.374     ; 1.340      ;
; -2.775 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[13] ; rom_addr[16] ; debounce_cnt[0] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.001        ; -1.374     ; 1.339      ;
; -2.769 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[6]  ; rom_addr[20] ; debounce_cnt[0] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.001        ; -1.366     ; 1.341      ;
; -2.768 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[3]  ; rom_addr[13] ; debounce_cnt[0] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.001        ; -1.374     ; 1.332      ;
; -2.766 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[4]  ; rom_addr[19] ; debounce_cnt[0] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.001        ; -1.366     ; 1.338      ;
; -2.766 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[1]  ; rom_addr[15] ; debounce_cnt[0] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.001        ; -1.366     ; 1.338      ;
; -2.765 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[6]  ; rom_addr[19] ; debounce_cnt[0] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.001        ; -1.366     ; 1.337      ;
; -2.762 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[11] ; rom_addr[21] ; debounce_cnt[0] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.001        ; -1.366     ; 1.334      ;
; -2.762 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[1]  ; rom_addr[14] ; debounce_cnt[0] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.001        ; -1.366     ; 1.334      ;
; -2.758 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[11] ; rom_addr[20] ; debounce_cnt[0] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.001        ; -1.366     ; 1.330      ;
; -2.757 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[7]  ; rom_addr[22] ; debounce_cnt[0] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.001        ; -1.366     ; 1.329      ;
; -2.755 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[2]  ; rom_addr[13] ; debounce_cnt[0] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.001        ; -1.374     ; 1.319      ;
; -2.750 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[9]  ; rom_addr[20] ; debounce_cnt[0] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.001        ; -1.375     ; 1.313      ;
; -2.742 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[0]  ; rom_addr[11] ; debounce_cnt[0] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.001        ; -1.372     ; 1.308      ;
; -2.738 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[5]  ; rom_addr[20] ; debounce_cnt[0] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.001        ; -1.366     ; 1.310      ;
; -2.736 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[2]  ; rom_addr[12] ; debounce_cnt[0] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.001        ; -1.374     ; 1.300      ;
; -2.733 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[9]  ; rom_addr[19] ; debounce_cnt[0] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.001        ; -1.375     ; 1.296      ;
; -2.733 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[4]  ; rom_addr[18] ; debounce_cnt[0] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.001        ; -1.366     ; 1.305      ;
; -2.726 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[7]  ; rom_addr[21] ; debounce_cnt[0] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.001        ; -1.366     ; 1.298      ;
; -2.722 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[12] ; rom_addr[21] ; debounce_cnt[0] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.001        ; -1.366     ; 1.294      ;
; -2.720 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[0]  ; rom_addr[10] ; debounce_cnt[0] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.001        ; -1.372     ; 1.286      ;
; -2.718 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[12] ; rom_addr[20] ; debounce_cnt[0] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.001        ; -1.366     ; 1.290      ;
; -2.717 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[10] ; rom_addr[19] ; debounce_cnt[0] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.001        ; -1.375     ; 1.280      ;
+--------+--------------------------------------------------+--------------+-----------------+-----------------------------------------------------------+--------------+------------+------------+


+-------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+
; Fast 1200mV 0C Model Setup: 'debounce_cnt[0]'                                                                                                                                             ;
+--------+--------------------------------------------------+--------------------------------------------------+-----------------+-----------------+--------------+------------+------------+
; Slack  ; From Node                                        ; To Node                                          ; Launch Clock    ; Latch Clock     ; Relationship ; Clock Skew ; Data Delay ;
+--------+--------------------------------------------------+--------------------------------------------------+-----------------+-----------------+--------------+------------+------------+
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; -0.601 ; debouncer:debounce_enc_a|jk_ff                   ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[1]  ; debounce_cnt[0] ; debounce_cnt[0] ; 1.000        ; -0.028     ; 1.560      ;
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; -0.595 ; quad_decode:quad_decode_0|quad_ff_b              ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[5]  ; debounce_cnt[0] ; debounce_cnt[0] ; 1.000        ; -0.036     ; 1.546      ;
; -0.595 ; quad_decode:quad_decode_0|quad_ff_b              ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[6]  ; debounce_cnt[0] ; debounce_cnt[0] ; 1.000        ; -0.036     ; 1.546      ;
; -0.593 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[6]  ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[10] ; debounce_cnt[0] ; debounce_cnt[0] ; 1.000        ; -0.027     ; 1.553      ;
; -0.590 ; quad_decode:quad_decode_0|quad_ff_b              ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[12] ; debounce_cnt[0] ; debounce_cnt[0] ; 1.000        ; -0.036     ; 1.541      ;
; -0.590 ; quad_decode:quad_decode_0|quad_ff_b              ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[11] ; debounce_cnt[0] ; debounce_cnt[0] ; 1.000        ; -0.036     ; 1.541      ;
; -0.587 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[7]  ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[10] ; debounce_cnt[0] ; debounce_cnt[0] ; 1.000        ; -0.027     ; 1.547      ;
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; -0.579 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[12] ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[0]  ; debounce_cnt[0] ; debounce_cnt[0] ; 1.000        ; -0.028     ; 1.538      ;
; -0.579 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[11] ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[3]  ; debounce_cnt[0] ; debounce_cnt[0] ; 1.000        ; -0.028     ; 1.538      ;
; -0.576 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[3]  ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[12] ; debounce_cnt[0] ; debounce_cnt[0] ; 1.000        ; -0.044     ; 1.519      ;
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; -0.564 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[2]  ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[8]  ; debounce_cnt[0] ; debounce_cnt[0] ; 1.000        ; -0.036     ; 1.515      ;
; -0.563 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[0]  ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[7]  ; debounce_cnt[0] ; debounce_cnt[0] ; 1.000        ; -0.044     ; 1.506      ;
; -0.562 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[10] ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[13] ; debounce_cnt[0] ; debounce_cnt[0] ; 1.000        ; -0.037     ; 1.512      ;
; -0.562 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[2]  ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[9]  ; debounce_cnt[0] ; debounce_cnt[0] ; 1.000        ; -0.035     ; 1.514      ;
; -0.559 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[7]  ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[9]  ; debounce_cnt[0] ; debounce_cnt[0] ; 1.000        ; -0.027     ; 1.519      ;
; -0.554 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[2]  ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[11] ; debounce_cnt[0] ; debounce_cnt[0] ; 1.000        ; -0.044     ; 1.497      ;
; -0.550 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[0]  ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[6]  ; debounce_cnt[0] ; debounce_cnt[0] ; 1.000        ; -0.044     ; 1.493      ;
+--------+--------------------------------------------------+--------------------------------------------------+-----------------+-----------------+--------------+------------+------------+


+-----------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+
; Fast 1200mV 0C Model Setup: 'pll_lab5_inst|altpll_component|auto_generated|pll1|clk[1]'                                                                                                                         ;
+------------+-----------------+-----------------+-----------------------------------------------------------+-----------------------------------------------------------+--------------+------------+------------+
; Slack      ; From Node       ; To Node         ; Launch Clock                                              ; Latch Clock                                               ; Relationship ; Clock Skew ; Data Delay ;
+------------+-----------------+-----------------+-----------------------------------------------------------+-----------------------------------------------------------+--------------+------------+------------+
; -0.325     ; debounce_cnt[0] ; digit_clk       ; debounce_cnt[0]                                           ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[1] ; 0.500        ; -0.110     ; 0.757      ;
; -0.299     ; debounce_cnt[0] ; debounce_cnt[0] ; debounce_cnt[0]                                           ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[1] ; 0.500        ; -0.110     ; 0.731      ;
; -0.296     ; debounce_cnt[0] ; debounce_cnt[1] ; debounce_cnt[0]                                           ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[1] ; 0.500        ; -0.110     ; 0.728      ;
; 0.082      ; digit_clk       ; digit_clk       ; digit_clk                                                 ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[1] ; 0.500        ; -0.110     ; 0.350      ;
; 0.239      ; debounce_cnt[0] ; digit_clk       ; debounce_cnt[0]                                           ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[1] ; 1.000        ; -0.110     ; 0.693      ;
; 0.241      ; debounce_cnt[0] ; debounce_cnt[1] ; debounce_cnt[0]                                           ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[1] ; 1.000        ; -0.110     ; 0.691      ;
; 0.257      ; debounce_cnt[0] ; debounce_cnt[0] ; debounce_cnt[0]                                           ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[1] ; 1.000        ; -0.110     ; 0.675      ;
; 0.573      ; digit_clk       ; digit_clk       ; digit_clk                                                 ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[1] ; 1.000        ; -0.110     ; 0.359      ;
; 249999.133 ; debounce_cnt[1] ; digit_clk       ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[1] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[1] ; 250000.000   ; -0.037     ; 0.817      ;
; 249999.159 ; debounce_cnt[1] ; debounce_cnt[0] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[1] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[1] ; 250000.000   ; -0.037     ; 0.791      ;
; 249999.162 ; debounce_cnt[1] ; debounce_cnt[1] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[1] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[1] ; 250000.000   ; -0.037     ; 0.788      ;
+------------+-----------------+-----------------+-----------------------------------------------------------+-----------------------------------------------------------+--------------+------------+------------+


+-----------------------------------------------------------------------------------------------------------------+
; Fast 1200mV 0C Model Setup: 'digit_clk'                                                                         ;
+-------+-----------------+-----------------+--------------+-------------+--------------+------------+------------+
; Slack ; From Node       ; To Node         ; Launch Clock ; Latch Clock ; Relationship ; Clock Skew ; Data Delay ;
+-------+-----------------+-----------------+--------------+-------------+--------------+------------+------------+
; 0.174 ; digit_seq_ps[2] ; digit_seq_ps[2] ; digit_clk    ; digit_clk   ; 1.000        ; -0.036     ; 0.777      ;
; 0.236 ; digit_seq_ps[1] ; digit_seq_ps[2] ; digit_clk    ; digit_clk   ; 1.000        ; -0.036     ; 0.715      ;
; 0.242 ; digit_seq_ps[1] ; digit_seq_ps[0] ; digit_clk    ; digit_clk   ; 1.000        ; -0.036     ; 0.709      ;
; 0.263 ; digit_seq_ps[2] ; digit_seq_ps[0] ; digit_clk    ; digit_clk   ; 1.000        ; -0.036     ; 0.688      ;
; 0.301 ; digit_seq_ps[0] ; digit_seq_ps[1] ; digit_clk    ; digit_clk   ; 1.000        ; -0.036     ; 0.650      ;
; 0.318 ; digit_seq_ps[0] ; digit_seq_ps[2] ; digit_clk    ; digit_clk   ; 1.000        ; -0.036     ; 0.633      ;
; 0.384 ; digit_seq_ps[2] ; digit_seq_ps[1] ; digit_clk    ; digit_clk   ; 1.000        ; -0.036     ; 0.567      ;
; 0.592 ; digit_seq_ps[1] ; digit_seq_ps[1] ; digit_clk    ; digit_clk   ; 1.000        ; -0.036     ; 0.359      ;
+-------+-----------------+-----------------+--------------+-------------+--------------+------------+------------+


+-------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+
; Fast 1200mV 0C Model Hold: 'pll_lab5_inst|altpll_component|auto_generated|pll1|clk[1]'                                                                                                                      ;
+--------+-----------------+-----------------+-----------------------------------------------------------+-----------------------------------------------------------+--------------+------------+------------+
; Slack  ; From Node       ; To Node         ; Launch Clock                                              ; Latch Clock                                               ; Relationship ; Clock Skew ; Data Delay ;
+--------+-----------------+-----------------+-----------------------------------------------------------+-----------------------------------------------------------+--------------+------------+------------+
; -0.116 ; digit_clk       ; digit_clk       ; digit_clk                                                 ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[1] ; 0.000        ; 0.134      ; 0.307      ;
; -0.100 ; debounce_cnt[0] ; debounce_cnt[0] ; debounce_cnt[0]                                           ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[1] ; 0.000        ; 0.134      ; 0.323      ;
; 0.142  ; debounce_cnt[0] ; debounce_cnt[1] ; debounce_cnt[0]                                           ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[1] ; 0.000        ; 0.134      ; 0.565      ;
; 0.186  ; debounce_cnt[1] ; debounce_cnt[1] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[1] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[1] ; 0.000        ; 0.037      ; 0.307      ;
; 0.186  ; debounce_cnt[0] ; digit_clk       ; debounce_cnt[0]                                           ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[1] ; 0.000        ; 0.134      ; 0.609      ;
; 0.391  ; debounce_cnt[0] ; debounce_cnt[0] ; debounce_cnt[0]                                           ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[1] ; -0.500       ; 0.134      ; 0.314      ;
; 0.391  ; digit_clk       ; digit_clk       ; digit_clk                                                 ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[1] ; -0.500       ; 0.134      ; 0.314      ;
; 0.535  ; debounce_cnt[1] ; digit_clk       ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[1] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[1] ; 0.000        ; 0.037      ; 0.656      ;
; 0.566  ; debounce_cnt[1] ; debounce_cnt[0] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[1] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[1] ; 0.000        ; 0.037      ; 0.687      ;
; 0.705  ; debounce_cnt[0] ; debounce_cnt[1] ; debounce_cnt[0]                                           ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[1] ; -0.500       ; 0.134      ; 0.628      ;
; 0.749  ; debounce_cnt[0] ; digit_clk       ; debounce_cnt[0]                                           ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[1] ; -0.500       ; 0.134      ; 0.672      ;
+--------+-----------------+-----------------+-----------------------------------------------------------+-----------------------------------------------------------+--------------+------------+------------+


+------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+
; Fast 1200mV 0C Model Hold: 'debounce_cnt[0]'                                                                                                                                             ;
+-------+--------------------------------------------------+--------------------------------------------------+-----------------+-----------------+--------------+------------+------------+
; Slack ; From Node                                        ; To Node                                          ; Launch Clock    ; Latch Clock     ; Relationship ; Clock Skew ; Data Delay ;
+-------+--------------------------------------------------+--------------------------------------------------+-----------------+-----------------+--------------+------------+------------+
; 0.187 ; debouncer:debounce_enc_a|jk_ff                   ; debouncer:debounce_enc_a|jk_ff                   ; debounce_cnt[0] ; debounce_cnt[0] ; 0.000        ; 0.036      ; 0.307      ;
; 0.187 ; debouncer:debounce_enc_b|jk_ff                   ; debouncer:debounce_enc_b|jk_ff                   ; debounce_cnt[0] ; debounce_cnt[0] ; 0.000        ; 0.036      ; 0.307      ;
; 0.194 ; debouncer:debounce_enc_a|shift_reg[0]            ; debouncer:debounce_enc_a|shift_reg[1]            ; debounce_cnt[0] ; debounce_cnt[0] ; 0.000        ; 0.036      ; 0.314      ;
; 0.194 ; debouncer:debounce_enc_b|shift_reg[3]            ; debouncer:debounce_enc_b|jk_ff                   ; debounce_cnt[0] ; debounce_cnt[0] ; 0.000        ; 0.036      ; 0.314      ;
; 0.198 ; debouncer:debounce_enc_b|jk_ff                   ; quad_decode:quad_decode_0|quad_ff_b              ; debounce_cnt[0] ; debounce_cnt[0] ; 0.000        ; 0.036      ; 0.318      ;
; 0.201 ; debouncer:debounce_enc_a|shift_reg[2]            ; debouncer:debounce_enc_a|shift_reg[3]            ; debounce_cnt[0] ; debounce_cnt[0] ; 0.000        ; 0.036      ; 0.321      ;
; 0.203 ; debouncer:debounce_enc_a|shift_reg[2]            ; debouncer:debounce_enc_a|jk_ff                   ; debounce_cnt[0] ; debounce_cnt[0] ; 0.000        ; 0.036      ; 0.323      ;
; 0.272 ; debouncer:debounce_enc_a|shift_reg[1]            ; debouncer:debounce_enc_a|shift_reg[2]            ; debounce_cnt[0] ; debounce_cnt[0] ; 0.000        ; 0.036      ; 0.392      ;
; 0.273 ; debouncer:debounce_enc_b|shift_reg[1]            ; debouncer:debounce_enc_b|shift_reg[2]            ; debounce_cnt[0] ; debounce_cnt[0] ; 0.000        ; 0.036      ; 0.393      ;
; 0.277 ; debouncer:debounce_enc_b|shift_reg[2]            ; debouncer:debounce_enc_b|shift_reg[3]            ; debounce_cnt[0] ; debounce_cnt[0] ; 0.000        ; 0.036      ; 0.397      ;
; 0.297 ; debouncer:debounce_enc_a|shift_reg[3]            ; debouncer:debounce_enc_a|jk_ff                   ; debounce_cnt[0] ; debounce_cnt[0] ; 0.000        ; 0.036      ; 0.417      ;
; 0.304 ; debouncer:debounce_enc_b|shift_reg[2]            ; debouncer:debounce_enc_b|jk_ff                   ; debounce_cnt[0] ; debounce_cnt[0] ; 0.000        ; 0.036      ; 0.424      ;
; 0.440 ; debouncer:debounce_enc_b|shift_reg[0]            ; debouncer:debounce_enc_b|jk_ff                   ; debounce_cnt[0] ; debounce_cnt[0] ; 0.000        ; 0.036      ; 0.560      ;
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; 0.483 ; quad_decode:quad_decode_0|quad_ff_b              ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[4]  ; debounce_cnt[0] ; debounce_cnt[0] ; 0.000        ; 0.036      ; 0.603      ;
; 0.495 ; debouncer:debounce_enc_a|jk_ff                   ; quad_decode:quad_decode_0|quad_ff_a              ; debounce_cnt[0] ; debounce_cnt[0] ; 0.000        ; 0.044      ; 0.623      ;
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; 0.528 ; quad_decode:quad_decode_0|quad_ff_b              ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[1]  ; debounce_cnt[0] ; debounce_cnt[0] ; 0.000        ; 0.036      ; 0.648      ;
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; 0.871 ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[11] ; cntr_updn_14bit:cntr_updn_14_bit_0|count_out[13] ; debounce_cnt[0] ; debounce_cnt[0] ; 0.000        ; 0.044      ; 0.999      ;
+-------+--------------------------------------------------+--------------------------------------------------+-----------------+-----------------+--------------+------------+------------+


+-----------------------------------------------------------------------------------------------------------------+
; Fast 1200mV 0C Model Hold: 'digit_clk'                                                                          ;
+-------+-----------------+-----------------+--------------+-------------+--------------+------------+------------+
; Slack ; From Node       ; To Node         ; Launch Clock ; Latch Clock ; Relationship ; Clock Skew ; Data Delay ;
+-------+-----------------+-----------------+--------------+-------------+--------------+------------+------------+
; 0.194 ; digit_seq_ps[1] ; digit_seq_ps[1] ; digit_clk    ; digit_clk   ; 0.000        ; 0.036      ; 0.314      ;
; 0.338 ; digit_seq_ps[2] ; digit_seq_ps[1] ; digit_clk    ; digit_clk   ; 0.000        ; 0.036      ; 0.458      ;
; 0.404 ; digit_seq_ps[0] ; digit_seq_ps[1] ; digit_clk    ; digit_clk   ; 0.000        ; 0.036      ; 0.524      ;
; 0.443 ; digit_seq_ps[0] ; digit_seq_ps[2] ; digit_clk    ; digit_clk   ; 0.000        ; 0.036      ; 0.563      ;
; 0.512 ; digit_seq_ps[1] ; digit_seq_ps[2] ; digit_clk    ; digit_clk   ; 0.000        ; 0.036      ; 0.632      ;
; 0.523 ; digit_seq_ps[2] ; digit_seq_ps[0] ; digit_clk    ; digit_clk   ; 0.000        ; 0.036      ; 0.643      ;
; 0.539 ; digit_seq_ps[1] ; digit_seq_ps[0] ; digit_clk    ; digit_clk   ; 0.000        ; 0.036      ; 0.659      ;
; 0.577 ; digit_seq_ps[2] ; digit_seq_ps[2] ; digit_clk    ; digit_clk   ; 0.000        ; 0.036      ; 0.697      ;
+-------+-----------------+-----------------+--------------+-------------+--------------+------------+------------+


+--------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+
; Fast 1200mV 0C Model Hold: 'pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2]'                                                                                                                                                                                                           ;
+-------+--------------+----------------------------------------------------------------------------------------------------------+-----------------------------------------------------------+-----------------------------------------------------------+--------------+------------+------------+
; Slack ; From Node    ; To Node                                                                                                  ; Launch Clock                                              ; Latch Clock                                               ; Relationship ; Clock Skew ; Data Delay ;
+-------+--------------+----------------------------------------------------------------------------------------------------------+-----------------------------------------------------------+-----------------------------------------------------------+--------------+------------+------------+
; 0.285 ; rom_addr[11] ; rom_addr[11]                                                                                             ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.000        ; 0.044      ; 0.413      ;
; 0.285 ; rom_addr[9]  ; rom_addr[9]                                                                                              ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.000        ; 0.044      ; 0.413      ;
; 0.286 ; rom_addr[12] ; rom_addr[12]                                                                                             ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.000        ; 0.044      ; 0.414      ;
; 0.286 ; rom_addr[10] ; rom_addr[10]                                                                                             ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.000        ; 0.044      ; 0.414      ;
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; 0.292 ; rom_addr[0]  ; rom_addr[0]                                                                                              ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.000        ; 0.044      ; 0.420      ;
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; 0.510 ; rom_addr[1]  ; rom_addr[2]                                                                                              ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.000        ; 0.037      ; 0.631      ;
; 0.510 ; rom_addr[19] ; rom_addr[21]                                                                                             ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.000        ; 0.044      ; 0.638      ;
; 0.511 ; rom_addr[0]  ; rom_addr[3]                                                                                              ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.000        ; 0.044      ; 0.639      ;
; 0.511 ; rom_addr[4]  ; rom_addr[7]                                                                                              ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.000        ; 0.044      ; 0.639      ;
; 0.511 ; rom_addr[21] ; rom_addr[23]                                                                                             ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.000        ; 0.044      ; 0.639      ;
; 0.511 ; rom_addr[12] ; rom_addr[15]                                                                                             ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.000        ; 0.044      ; 0.639      ;
; 0.512 ; rom_addr[8]  ; rom_addr[9]                                                                                              ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.000        ; 0.044      ; 0.640      ;
; 0.512 ; rom_addr[1]  ; rom_addr[8]                                                                                              ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.000        ; 0.233      ; 0.829      ;
; 0.512 ; rom_addr[17] ; rom_addr[20]                                                                                             ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.000        ; 0.044      ; 0.640      ;
; 0.512 ; rom_addr[15] ; rom_addr[18]                                                                                             ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.000        ; 0.044      ; 0.640      ;
; 0.512 ; rom_addr[13] ; rom_addr[16]                                                                                             ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.000        ; 0.044      ; 0.640      ;
; 0.513 ; rom_addr[19] ; rom_addr[22]                                                                                             ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.000        ; 0.044      ; 0.641      ;
; 0.513 ; rom_addr[10] ; rom_addr[13]                                                                                             ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.000        ; 0.042      ; 0.639      ;
; 0.514 ; rom_addr[0]  ; rom_addr[4]                                                                                              ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.000        ; 0.044      ; 0.642      ;
; 0.514 ; rom_addr[4]  ; rom_addr[8]                                                                                              ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.000        ; 0.044      ; 0.642      ;
; 0.514 ; rom_addr[12] ; rom_addr[16]                                                                                             ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.000        ; 0.044      ; 0.642      ;
; 0.515 ; rom_addr[8]  ; rom_addr[10]                                                                                             ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.000        ; 0.044      ; 0.643      ;
; 0.516 ; rom_addr[10] ; rom_addr[14]                                                                                             ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.000        ; 0.042      ; 0.642      ;
; 0.521 ; rom_addr[2]  ; rom_addr[9]                                                                                              ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.000        ; 0.233      ; 0.838      ;
; 0.522 ; rom_addr[18] ; rom_addr[21]                                                                                             ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.000        ; 0.044      ; 0.650      ;
; 0.523 ; rom_addr[16] ; rom_addr[19]                                                                                             ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 0.000        ; 0.044      ; 0.651      ;
+-------+--------------+----------------------------------------------------------------------------------------------------------+-----------------------------------------------------------+-----------------------------------------------------------+--------------+------------+------------+


----------------------------------------------
; Fast 1200mV 0C Model Metastability Summary ;
----------------------------------------------
No synchronizer chains to report.


+---------------------------------------------------------------------------------------------------------------------------+
; Multicorner Timing Analysis Summary                                                                                       ;
+------------------------------------------------------------+----------+--------+----------+---------+---------------------+
; Clock                                                      ; Setup    ; Hold   ; Recovery ; Removal ; Minimum Pulse Width ;
+------------------------------------------------------------+----------+--------+----------+---------+---------------------+
; Worst-case Slack                                           ; -5.344   ; -0.265 ; N/A      ; N/A     ; -1.000              ;
;  debounce_cnt[0]                                           ; -2.368   ; 0.187  ; N/A      ; N/A     ; -1.000              ;
;  digit_clk                                                 ; -0.501   ; 0.194  ; N/A      ; N/A     ; -1.000              ;
;  inclk0_sig                                                ; N/A      ; N/A    ; N/A      ; N/A     ; 9.587               ;
;  pll_lab5_inst|altpll_component|auto_generated|pll1|clk[1] ; -0.798   ; -0.265 ; N/A      ; N/A     ; 124999.743          ;
;  pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; -5.344   ; 0.285  ; N/A      ; N/A     ; 29.548              ;
; Design-wide TNS                                            ; -147.025 ; -0.516 ; 0.0      ; 0.0     ; -29.0               ;
;  debounce_cnt[0]                                           ; -31.522  ; 0.000  ; N/A      ; N/A     ; -26.000             ;
;  digit_clk                                                 ; -1.125   ; 0.000  ; N/A      ; N/A     ; -3.000              ;
;  inclk0_sig                                                ; N/A      ; N/A    ; N/A      ; N/A     ; 0.000               ;
;  pll_lab5_inst|altpll_component|auto_generated|pll1|clk[1] ; -2.342   ; -0.516 ; N/A      ; N/A     ; 0.000               ;
;  pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; -112.036 ; 0.000  ; N/A      ; N/A     ; 0.000               ;
+------------------------------------------------------------+----------+--------+----------+---------+---------------------+


+--------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+
; Board Trace Model Assignments                                                                                                                                                                                                                                                                                                                                                                                      ;
+-----------------+--------------+-------------------+-------------------------+-------------------------+---------------+---------------------+----------------+------------------+--------+------------------+------------------------+------------------------+--------------+---------------+-----------------+-------+---------------------+--------------------+---------------+-----------------+-------------+
; Pin             ; I/O Standard ; Near Tline Length ; Near Tline L per Length ; Near Tline C per Length ; Near Series R ; Near Differential R ; Near Pull-up R ; Near Pull-down R ; Near C ; Far Tline Length ; Far Tline L per Length ; Far Tline C per Length ; Far Series R ; Far Pull-up R ; Far Pull-down R ; Far C ; Termination Voltage ; Far Differential R ; EBD File Name ; EBD Signal Name ; EBD Far-end ;
+-----------------+--------------+-------------------+-------------------------+-------------------------+---------------+---------------------+----------------+------------------+--------+------------------+------------------------+------------------------+--------------+---------------+-----------------+-------+---------------------+--------------------+---------------+-----------------+-------------+
; segment_data[0] ; 2.5 V        ; 0 in              ; 0 H/in                  ; 0 F/in                  ; short         ; -                   ; open           ; open             ; open   ; 0 in             ; 0 H/in                 ; 0 F/in                 ; short        ; open          ; open            ; open  ; 0 V                 ; -                  ; n/a           ; n/a             ; n/a         ;
; segment_data[1] ; 2.5 V        ; 0 in              ; 0 H/in                  ; 0 F/in                  ; short         ; -                   ; open           ; open             ; open   ; 0 in             ; 0 H/in                 ; 0 F/in                 ; short        ; open          ; open            ; open  ; 0 V                 ; -                  ; n/a           ; n/a             ; n/a         ;
; segment_data[2] ; 2.5 V        ; 0 in              ; 0 H/in                  ; 0 F/in                  ; short         ; -                   ; open           ; open             ; open   ; 0 in             ; 0 H/in                 ; 0 F/in                 ; short        ; open          ; open            ; open  ; 0 V                 ; -                  ; n/a           ; n/a             ; n/a         ;
; segment_data[3] ; 2.5 V        ; 0 in              ; 0 H/in                  ; 0 F/in                  ; short         ; -                   ; open           ; open             ; open   ; 0 in             ; 0 H/in                 ; 0 F/in                 ; short        ; open          ; open            ; open  ; 0 V                 ; -                  ; n/a           ; n/a             ; n/a         ;
; segment_data[4] ; 2.5 V        ; 0 in              ; 0 H/in                  ; 0 F/in                  ; short         ; -                   ; open           ; open             ; open   ; 0 in             ; 0 H/in                 ; 0 F/in                 ; short        ; open          ; open            ; open  ; 0 V                 ; -                  ; n/a           ; n/a             ; n/a         ;
; segment_data[5] ; 2.5 V        ; 0 in              ; 0 H/in                  ; 0 F/in                  ; short         ; -                   ; open           ; open             ; open   ; 0 in             ; 0 H/in                 ; 0 F/in                 ; short        ; open          ; open            ; open  ; 0 V                 ; -                  ; n/a           ; n/a             ; n/a         ;
; segment_data[6] ; 2.5 V        ; 0 in              ; 0 H/in                  ; 0 F/in                  ; short         ; -                   ; open           ; open             ; open   ; 0 in             ; 0 H/in                 ; 0 F/in                 ; short        ; open          ; open            ; open  ; 0 V                 ; -                  ; n/a           ; n/a             ; n/a         ;
; segment_data[7] ; 2.5 V        ; 0 in              ; 0 H/in                  ; 0 F/in                  ; short         ; -                   ; open           ; open             ; open   ; 0 in             ; 0 H/in                 ; 0 F/in                 ; short        ; open          ; open            ; open  ; 0 V                 ; -                  ; n/a           ; n/a             ; n/a         ;
; sel0            ; 2.5 V        ; 0 in              ; 0 H/in                  ; 0 F/in                  ; short         ; -                   ; open           ; open             ; open   ; 0 in             ; 0 H/in                 ; 0 F/in                 ; short        ; open          ; open            ; open  ; 0 V                 ; -                  ; n/a           ; n/a             ; n/a         ;
; sel1            ; 2.5 V        ; 0 in              ; 0 H/in                  ; 0 F/in                  ; short         ; -                   ; open           ; open             ; open   ; 0 in             ; 0 H/in                 ; 0 F/in                 ; short        ; open          ; open            ; open  ; 0 V                 ; -                  ; n/a           ; n/a             ; n/a         ;
; sel2            ; 2.5 V        ; 0 in              ; 0 H/in                  ; 0 F/in                  ; short         ; -                   ; open           ; open             ; open   ; 0 in             ; 0 H/in                 ; 0 F/in                 ; short        ; open          ; open            ; open  ; 0 V                 ; -                  ; n/a           ; n/a             ; n/a         ;
; enable3to8      ; 2.5 V        ; 0 in              ; 0 H/in                  ; 0 F/in                  ; short         ; -                   ; open           ; open             ; open   ; 0 in             ; 0 H/in                 ; 0 F/in                 ; short        ; open          ; open            ; open  ; 0 V                 ; -                  ; n/a           ; n/a             ; n/a         ;
; enable3to8_n    ; 2.5 V        ; 0 in              ; 0 H/in                  ; 0 F/in                  ; short         ; -                   ; open           ; open             ; open   ; 0 in             ; 0 H/in                 ; 0 F/in                 ; short        ; open          ; open            ; open  ; 0 V                 ; -                  ; n/a           ; n/a             ; n/a         ;
; pwm_output      ; 2.5 V        ; 0 in              ; 0 H/in                  ; 0 F/in                  ; short         ; -                   ; open           ; open             ; open   ; 0 in             ; 0 H/in                 ; 0 F/in                 ; short        ; open          ; open            ; open  ; 0 V                 ; -                  ; n/a           ; n/a             ; n/a         ;
; rom_data[0]     ; 2.5 V        ; 0 in              ; 0 H/in                  ; 0 F/in                  ; short         ; -                   ; open           ; open             ; open   ; 0 in             ; 0 H/in                 ; 0 F/in                 ; short        ; open          ; open            ; open  ; 0 V                 ; -                  ; n/a           ; n/a             ; n/a         ;
; rom_data[1]     ; 2.5 V        ; 0 in              ; 0 H/in                  ; 0 F/in                  ; short         ; -                   ; open           ; open             ; open   ; 0 in             ; 0 H/in                 ; 0 F/in                 ; short        ; open          ; open            ; open  ; 0 V                 ; -                  ; n/a           ; n/a             ; n/a         ;
; rom_data[2]     ; 2.5 V        ; 0 in              ; 0 H/in                  ; 0 F/in                  ; short         ; -                   ; open           ; open             ; open   ; 0 in             ; 0 H/in                 ; 0 F/in                 ; short        ; open          ; open            ; open  ; 0 V                 ; -                  ; n/a           ; n/a             ; n/a         ;
; rom_data[3]     ; 2.5 V        ; 0 in              ; 0 H/in                  ; 0 F/in                  ; short         ; -                   ; open           ; open             ; open   ; 0 in             ; 0 H/in                 ; 0 F/in                 ; short        ; open          ; open            ; open  ; 0 V                 ; -                  ; n/a           ; n/a             ; n/a         ;
; rom_data[4]     ; 2.5 V        ; 0 in              ; 0 H/in                  ; 0 F/in                  ; short         ; -                   ; open           ; open             ; open   ; 0 in             ; 0 H/in                 ; 0 F/in                 ; short        ; open          ; open            ; open  ; 0 V                 ; -                  ; n/a           ; n/a             ; n/a         ;
; rom_data[5]     ; 2.5 V        ; 0 in              ; 0 H/in                  ; 0 F/in                  ; short         ; -                   ; open           ; open             ; open   ; 0 in             ; 0 H/in                 ; 0 F/in                 ; short        ; open          ; open            ; open  ; 0 V                 ; -                  ; n/a           ; n/a             ; n/a         ;
; rom_data[6]     ; 2.5 V        ; 0 in              ; 0 H/in                  ; 0 F/in                  ; short         ; -                   ; open           ; open             ; open   ; 0 in             ; 0 H/in                 ; 0 F/in                 ; short        ; open          ; open            ; open  ; 0 V                 ; -                  ; n/a           ; n/a             ; n/a         ;
; rom_data[7]     ; 2.5 V        ; 0 in              ; 0 H/in                  ; 0 F/in                  ; short         ; -                   ; open           ; open             ; open   ; 0 in             ; 0 H/in                 ; 0 F/in                 ; short        ; open          ; open            ; open  ; 0 V                 ; -                  ; n/a           ; n/a             ; n/a         ;
; ~ALTERA_DCLK~   ; 2.5 V        ; 0 in              ; 0 H/in                  ; 0 F/in                  ; short         ; -                   ; open           ; open             ; open   ; 0 in             ; 0 H/in                 ; 0 F/in                 ; short        ; open          ; open            ; open  ; 0 V                 ; -                  ; n/a           ; n/a             ; n/a         ;
; ~ALTERA_nCEO~   ; 2.5 V        ; 0 in              ; 0 H/in                  ; 0 F/in                  ; short         ; -                   ; open           ; open             ; open   ; 0 in             ; 0 H/in                 ; 0 F/in                 ; short        ; open          ; open            ; open  ; 0 V                 ; -                  ; n/a           ; n/a             ; n/a         ;
+-----------------+--------------+-------------------+-------------------------+-------------------------+---------------+---------------------+----------------+------------------+--------+------------------+------------------------+------------------------+--------------+---------------+-----------------+-------+---------------------+--------------------+---------------+-----------------+-------------+


+----------------------------------------------------------------------------+
; Input Transition Times                                                     ;
+-------------------------+--------------+-----------------+-----------------+
; Pin                     ; I/O Standard ; 10-90 Rise Time ; 90-10 Fall Time ;
+-------------------------+--------------+-----------------+-----------------+
; reset_n                 ; 2.5 V        ; 2000 ps         ; 2000 ps         ;
; inclk0_sig              ; 2.5 V        ; 2000 ps         ; 2000 ps         ;
; encoder_a               ; 2.5 V        ; 2000 ps         ; 2000 ps         ;
; encoder_b               ; 2.5 V        ; 2000 ps         ; 2000 ps         ;
; ~ALTERA_ASDO_DATA1~     ; 2.5 V        ; 2000 ps         ; 2000 ps         ;
; ~ALTERA_FLASH_nCE_nCSO~ ; 2.5 V        ; 2000 ps         ; 2000 ps         ;
; ~ALTERA_DATA0~          ; 2.5 V        ; 2000 ps         ; 2000 ps         ;
+-------------------------+--------------+-----------------+-----------------+


+----------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+
; Signal Integrity Metrics (Slow 1200mv 0c Model)                                                                                                                                                                                                                                                                                                                                                                                                                                                                                                                                                                                                                                              ;
+-----------------+--------------+---------------------+---------------------+------------------------------+------------------------------+---------------------+---------------------+--------------------------------------+--------------------------------------+-----------------------------+-----------------------------+----------------------------+----------------------------+-----------------------------+-----------------------------+--------------------+--------------------+-------------------------------------+-------------------------------------+----------------------------+----------------------------+---------------------------+---------------------------+
; Pin             ; I/O Standard ; Board Delay on Rise ; Board Delay on Fall ; Steady State Voh at FPGA Pin ; Steady State Vol at FPGA Pin ; Voh Max at FPGA Pin ; Vol Min at FPGA Pin ; Ringback Voltage on Rise at FPGA Pin ; Ringback Voltage on Fall at FPGA Pin ; 10-90 Rise Time at FPGA Pin ; 90-10 Fall Time at FPGA Pin ; Monotonic Rise at FPGA Pin ; Monotonic Fall at FPGA Pin ; Steady State Voh at Far-end ; Steady State Vol at Far-end ; Voh Max at Far-end ; Vol Min at Far-end ; Ringback Voltage on Rise at Far-end ; Ringback Voltage on Fall at Far-end ; 10-90 Rise Time at Far-end ; 90-10 Fall Time at Far-end ; Monotonic Rise at Far-end ; Monotonic Fall at Far-end ;
+-----------------+--------------+---------------------+---------------------+------------------------------+------------------------------+---------------------+---------------------+--------------------------------------+--------------------------------------+-----------------------------+-----------------------------+----------------------------+----------------------------+-----------------------------+-----------------------------+--------------------+--------------------+-------------------------------------+-------------------------------------+----------------------------+----------------------------+---------------------------+---------------------------+
; segment_data[0] ; 2.5 V        ; 0 s                 ; 0 s                 ; 2.32 V                       ; 5.95e-09 V                   ; 2.38 V              ; -0.016 V            ; 0.22 V                               ; 0.025 V                              ; 3.06e-10 s                  ; 3.3e-10 s                   ; Yes                        ; Yes                        ; 2.32 V                      ; 5.95e-09 V                  ; 2.38 V             ; -0.016 V           ; 0.22 V                              ; 0.025 V                             ; 3.06e-10 s                 ; 3.3e-10 s                  ; Yes                       ; Yes                       ;
; segment_data[1] ; 2.5 V        ; 0 s                 ; 0 s                 ; 2.32 V                       ; 5.95e-09 V                   ; 2.38 V              ; -0.016 V            ; 0.22 V                               ; 0.025 V                              ; 3.06e-10 s                  ; 3.3e-10 s                   ; Yes                        ; Yes                        ; 2.32 V                      ; 5.95e-09 V                  ; 2.38 V             ; -0.016 V           ; 0.22 V                              ; 0.025 V                             ; 3.06e-10 s                 ; 3.3e-10 s                  ; Yes                       ; Yes                       ;
; segment_data[2] ; 2.5 V        ; 0 s                 ; 0 s                 ; 2.32 V                       ; 5.95e-09 V                   ; 2.38 V              ; -0.016 V            ; 0.22 V                               ; 0.025 V                              ; 3.06e-10 s                  ; 3.3e-10 s                   ; Yes                        ; Yes                        ; 2.32 V                      ; 5.95e-09 V                  ; 2.38 V             ; -0.016 V           ; 0.22 V                              ; 0.025 V                             ; 3.06e-10 s                 ; 3.3e-10 s                  ; Yes                       ; Yes                       ;
; segment_data[3] ; 2.5 V        ; 0 s                 ; 0 s                 ; 2.32 V                       ; 5.95e-09 V                   ; 2.38 V              ; -0.016 V            ; 0.22 V                               ; 0.025 V                              ; 3.06e-10 s                  ; 3.3e-10 s                   ; Yes                        ; Yes                        ; 2.32 V                      ; 5.95e-09 V                  ; 2.38 V             ; -0.016 V           ; 0.22 V                              ; 0.025 V                             ; 3.06e-10 s                 ; 3.3e-10 s                  ; Yes                       ; Yes                       ;
; segment_data[4] ; 2.5 V        ; 0 s                 ; 0 s                 ; 2.32 V                       ; 5.95e-09 V                   ; 2.38 V              ; -0.016 V            ; 0.22 V                               ; 0.025 V                              ; 3.06e-10 s                  ; 3.3e-10 s                   ; Yes                        ; Yes                        ; 2.32 V                      ; 5.95e-09 V                  ; 2.38 V             ; -0.016 V           ; 0.22 V                              ; 0.025 V                             ; 3.06e-10 s                 ; 3.3e-10 s                  ; Yes                       ; Yes                       ;
; segment_data[5] ; 2.5 V        ; 0 s                 ; 0 s                 ; 2.32 V                       ; 5.95e-09 V                   ; 2.38 V              ; -0.016 V            ; 0.22 V                               ; 0.025 V                              ; 3.06e-10 s                  ; 3.3e-10 s                   ; Yes                        ; Yes                        ; 2.32 V                      ; 5.95e-09 V                  ; 2.38 V             ; -0.016 V           ; 0.22 V                              ; 0.025 V                             ; 3.06e-10 s                 ; 3.3e-10 s                  ; Yes                       ; Yes                       ;
; segment_data[6] ; 2.5 V        ; 0 s                 ; 0 s                 ; 2.32 V                       ; 5.95e-09 V                   ; 2.38 V              ; -0.016 V            ; 0.22 V                               ; 0.025 V                              ; 3.06e-10 s                  ; 3.3e-10 s                   ; Yes                        ; Yes                        ; 2.32 V                      ; 5.95e-09 V                  ; 2.38 V             ; -0.016 V           ; 0.22 V                              ; 0.025 V                             ; 3.06e-10 s                 ; 3.3e-10 s                  ; Yes                       ; Yes                       ;
; segment_data[7] ; 2.5 V        ; 0 s                 ; 0 s                 ; 2.32 V                       ; 5.95e-09 V                   ; 2.38 V              ; -0.016 V            ; 0.22 V                               ; 0.025 V                              ; 3.06e-10 s                  ; 3.3e-10 s                   ; Yes                        ; Yes                        ; 2.32 V                      ; 5.95e-09 V                  ; 2.38 V             ; -0.016 V           ; 0.22 V                              ; 0.025 V                             ; 3.06e-10 s                 ; 3.3e-10 s                  ; Yes                       ; Yes                       ;
; sel0            ; 2.5 V        ; 0 s                 ; 0 s                 ; 2.32 V                       ; 5.95e-09 V                   ; 2.38 V              ; -0.016 V            ; 0.22 V                               ; 0.025 V                              ; 3.06e-10 s                  ; 3.3e-10 s                   ; Yes                        ; Yes                        ; 2.32 V                      ; 5.95e-09 V                  ; 2.38 V             ; -0.016 V           ; 0.22 V                              ; 0.025 V                             ; 3.06e-10 s                 ; 3.3e-10 s                  ; Yes                       ; Yes                       ;
; sel1            ; 2.5 V        ; 0 s                 ; 0 s                 ; 2.32 V                       ; 5.95e-09 V                   ; 2.38 V              ; -0.016 V            ; 0.22 V                               ; 0.025 V                              ; 3.06e-10 s                  ; 3.3e-10 s                   ; Yes                        ; Yes                        ; 2.32 V                      ; 5.95e-09 V                  ; 2.38 V             ; -0.016 V           ; 0.22 V                              ; 0.025 V                             ; 3.06e-10 s                 ; 3.3e-10 s                  ; Yes                       ; Yes                       ;
; sel2            ; 2.5 V        ; 0 s                 ; 0 s                 ; 2.32 V                       ; 5.95e-09 V                   ; 2.38 V              ; -0.016 V            ; 0.22 V                               ; 0.025 V                              ; 3.06e-10 s                  ; 3.3e-10 s                   ; Yes                        ; Yes                        ; 2.32 V                      ; 5.95e-09 V                  ; 2.38 V             ; -0.016 V           ; 0.22 V                              ; 0.025 V                             ; 3.06e-10 s                 ; 3.3e-10 s                  ; Yes                       ; Yes                       ;
; enable3to8      ; 2.5 V        ; 0 s                 ; 0 s                 ; 2.32 V                       ; 5.95e-09 V                   ; 2.38 V              ; -0.016 V            ; 0.22 V                               ; 0.025 V                              ; 3.06e-10 s                  ; 3.3e-10 s                   ; Yes                        ; Yes                        ; 2.32 V                      ; 5.95e-09 V                  ; 2.38 V             ; -0.016 V           ; 0.22 V                              ; 0.025 V                             ; 3.06e-10 s                 ; 3.3e-10 s                  ; Yes                       ; Yes                       ;
; enable3to8_n    ; 2.5 V        ; 0 s                 ; 0 s                 ; 2.32 V                       ; 5.95e-09 V                   ; 2.38 V              ; -0.016 V            ; 0.22 V                               ; 0.025 V                              ; 3.06e-10 s                  ; 3.3e-10 s                   ; Yes                        ; Yes                        ; 2.32 V                      ; 5.95e-09 V                  ; 2.38 V             ; -0.016 V           ; 0.22 V                              ; 0.025 V                             ; 3.06e-10 s                 ; 3.3e-10 s                  ; Yes                       ; Yes                       ;
; pwm_output      ; 2.5 V        ; 0 s                 ; 0 s                 ; 2.32 V                       ; 5.95e-09 V                   ; 2.38 V              ; -0.016 V            ; 0.22 V                               ; 0.025 V                              ; 3.06e-10 s                  ; 3.3e-10 s                   ; Yes                        ; Yes                        ; 2.32 V                      ; 5.95e-09 V                  ; 2.38 V             ; -0.016 V           ; 0.22 V                              ; 0.025 V                             ; 3.06e-10 s                 ; 3.3e-10 s                  ; Yes                       ; Yes                       ;
; rom_data[0]     ; 2.5 V        ; 0 s                 ; 0 s                 ; 2.32 V                       ; 5.95e-09 V                   ; 2.38 V              ; -0.016 V            ; 0.22 V                               ; 0.025 V                              ; 3.06e-10 s                  ; 3.3e-10 s                   ; Yes                        ; Yes                        ; 2.32 V                      ; 5.95e-09 V                  ; 2.38 V             ; -0.016 V           ; 0.22 V                              ; 0.025 V                             ; 3.06e-10 s                 ; 3.3e-10 s                  ; Yes                       ; Yes                       ;
; rom_data[1]     ; 2.5 V        ; 0 s                 ; 0 s                 ; 2.32 V                       ; 5.95e-09 V                   ; 2.38 V              ; -0.016 V            ; 0.22 V                               ; 0.025 V                              ; 3.06e-10 s                  ; 3.3e-10 s                   ; Yes                        ; Yes                        ; 2.32 V                      ; 5.95e-09 V                  ; 2.38 V             ; -0.016 V           ; 0.22 V                              ; 0.025 V                             ; 3.06e-10 s                 ; 3.3e-10 s                  ; Yes                       ; Yes                       ;
; rom_data[2]     ; 2.5 V        ; 0 s                 ; 0 s                 ; 2.32 V                       ; 5.95e-09 V                   ; 2.38 V              ; -0.016 V            ; 0.22 V                               ; 0.025 V                              ; 3.06e-10 s                  ; 3.3e-10 s                   ; Yes                        ; Yes                        ; 2.32 V                      ; 5.95e-09 V                  ; 2.38 V             ; -0.016 V           ; 0.22 V                              ; 0.025 V                             ; 3.06e-10 s                 ; 3.3e-10 s                  ; Yes                       ; Yes                       ;
; rom_data[3]     ; 2.5 V        ; 0 s                 ; 0 s                 ; 2.32 V                       ; 5.95e-09 V                   ; 2.38 V              ; -0.016 V            ; 0.22 V                               ; 0.025 V                              ; 3.06e-10 s                  ; 3.3e-10 s                   ; Yes                        ; Yes                        ; 2.32 V                      ; 5.95e-09 V                  ; 2.38 V             ; -0.016 V           ; 0.22 V                              ; 0.025 V                             ; 3.06e-10 s                 ; 3.3e-10 s                  ; Yes                       ; Yes                       ;
; rom_data[4]     ; 2.5 V        ; 0 s                 ; 0 s                 ; 2.32 V                       ; 5.95e-09 V                   ; 2.38 V              ; -0.016 V            ; 0.22 V                               ; 0.025 V                              ; 3.06e-10 s                  ; 3.3e-10 s                   ; Yes                        ; Yes                        ; 2.32 V                      ; 5.95e-09 V                  ; 2.38 V             ; -0.016 V           ; 0.22 V                              ; 0.025 V                             ; 3.06e-10 s                 ; 3.3e-10 s                  ; Yes                       ; Yes                       ;
; rom_data[5]     ; 2.5 V        ; 0 s                 ; 0 s                 ; 2.32 V                       ; 5.95e-09 V                   ; 2.38 V              ; -0.016 V            ; 0.22 V                               ; 0.025 V                              ; 3.06e-10 s                  ; 3.3e-10 s                   ; Yes                        ; Yes                        ; 2.32 V                      ; 5.95e-09 V                  ; 2.38 V             ; -0.016 V           ; 0.22 V                              ; 0.025 V                             ; 3.06e-10 s                 ; 3.3e-10 s                  ; Yes                       ; Yes                       ;
; rom_data[6]     ; 2.5 V        ; 0 s                 ; 0 s                 ; 2.32 V                       ; 5.95e-09 V                   ; 2.38 V              ; -0.016 V            ; 0.22 V                               ; 0.025 V                              ; 3.06e-10 s                  ; 3.3e-10 s                   ; Yes                        ; Yes                        ; 2.32 V                      ; 5.95e-09 V                  ; 2.38 V             ; -0.016 V           ; 0.22 V                              ; 0.025 V                             ; 3.06e-10 s                 ; 3.3e-10 s                  ; Yes                       ; Yes                       ;
; rom_data[7]     ; 2.5 V        ; 0 s                 ; 0 s                 ; 2.32 V                       ; 5.95e-09 V                   ; 2.38 V              ; -0.016 V            ; 0.22 V                               ; 0.025 V                              ; 3.06e-10 s                  ; 3.3e-10 s                   ; Yes                        ; Yes                        ; 2.32 V                      ; 5.95e-09 V                  ; 2.38 V             ; -0.016 V           ; 0.22 V                              ; 0.025 V                             ; 3.06e-10 s                 ; 3.3e-10 s                  ; Yes                       ; Yes                       ;
; ~ALTERA_DCLK~   ; 2.5 V        ; 0 s                 ; 0 s                 ; 2.32 V                       ; 3.45e-09 V                   ; 2.38 V              ; -0.0609 V           ; 0.148 V                              ; 0.095 V                              ; 2.82e-10 s                  ; 2.59e-10 s                  ; Yes                        ; Yes                        ; 2.32 V                      ; 3.45e-09 V                  ; 2.38 V             ; -0.0609 V          ; 0.148 V                             ; 0.095 V                             ; 2.82e-10 s                 ; 2.59e-10 s                 ; Yes                       ; Yes                       ;
; ~ALTERA_nCEO~   ; 2.5 V        ; 0 s                 ; 0 s                 ; 2.32 V                       ; 5.61e-09 V                   ; 2.38 V              ; -0.00274 V          ; 0.141 V                              ; 0.006 V                              ; 4.7e-10 s                   ; 6.02e-10 s                  ; Yes                        ; Yes                        ; 2.32 V                      ; 5.61e-09 V                  ; 2.38 V             ; -0.00274 V         ; 0.141 V                             ; 0.006 V                             ; 4.7e-10 s                  ; 6.02e-10 s                 ; Yes                       ; Yes                       ;
+-----------------+--------------+---------------------+---------------------+------------------------------+------------------------------+---------------------+---------------------+--------------------------------------+--------------------------------------+-----------------------------+-----------------------------+----------------------------+----------------------------+-----------------------------+-----------------------------+--------------------+--------------------+-------------------------------------+-------------------------------------+----------------------------+----------------------------+---------------------------+---------------------------+


+----------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+
; Signal Integrity Metrics (Slow 1200mv 85c Model)                                                                                                                                                                                                                                                                                                                                                                                                                                                                                                                                                                                                                                             ;
+-----------------+--------------+---------------------+---------------------+------------------------------+------------------------------+---------------------+---------------------+--------------------------------------+--------------------------------------+-----------------------------+-----------------------------+----------------------------+----------------------------+-----------------------------+-----------------------------+--------------------+--------------------+-------------------------------------+-------------------------------------+----------------------------+----------------------------+---------------------------+---------------------------+
; Pin             ; I/O Standard ; Board Delay on Rise ; Board Delay on Fall ; Steady State Voh at FPGA Pin ; Steady State Vol at FPGA Pin ; Voh Max at FPGA Pin ; Vol Min at FPGA Pin ; Ringback Voltage on Rise at FPGA Pin ; Ringback Voltage on Fall at FPGA Pin ; 10-90 Rise Time at FPGA Pin ; 90-10 Fall Time at FPGA Pin ; Monotonic Rise at FPGA Pin ; Monotonic Fall at FPGA Pin ; Steady State Voh at Far-end ; Steady State Vol at Far-end ; Voh Max at Far-end ; Vol Min at Far-end ; Ringback Voltage on Rise at Far-end ; Ringback Voltage on Fall at Far-end ; 10-90 Rise Time at Far-end ; 90-10 Fall Time at Far-end ; Monotonic Rise at Far-end ; Monotonic Fall at Far-end ;
+-----------------+--------------+---------------------+---------------------+------------------------------+------------------------------+---------------------+---------------------+--------------------------------------+--------------------------------------+-----------------------------+-----------------------------+----------------------------+----------------------------+-----------------------------+-----------------------------+--------------------+--------------------+-------------------------------------+-------------------------------------+----------------------------+----------------------------+---------------------------+---------------------------+
; segment_data[0] ; 2.5 V        ; 0 s                 ; 0 s                 ; 2.32 V                       ; 1.06e-06 V                   ; 2.36 V              ; -0.00724 V          ; 0.107 V                              ; 0.02 V                               ; 4.5e-10 s                   ; 4.25e-10 s                  ; Yes                        ; Yes                        ; 2.32 V                      ; 1.06e-06 V                  ; 2.36 V             ; -0.00724 V         ; 0.107 V                             ; 0.02 V                              ; 4.5e-10 s                  ; 4.25e-10 s                 ; Yes                       ; Yes                       ;
; segment_data[1] ; 2.5 V        ; 0 s                 ; 0 s                 ; 2.32 V                       ; 1.06e-06 V                   ; 2.36 V              ; -0.00724 V          ; 0.107 V                              ; 0.02 V                               ; 4.5e-10 s                   ; 4.25e-10 s                  ; Yes                        ; Yes                        ; 2.32 V                      ; 1.06e-06 V                  ; 2.36 V             ; -0.00724 V         ; 0.107 V                             ; 0.02 V                              ; 4.5e-10 s                  ; 4.25e-10 s                 ; Yes                       ; Yes                       ;
; segment_data[2] ; 2.5 V        ; 0 s                 ; 0 s                 ; 2.32 V                       ; 1.06e-06 V                   ; 2.36 V              ; -0.00724 V          ; 0.107 V                              ; 0.02 V                               ; 4.5e-10 s                   ; 4.25e-10 s                  ; Yes                        ; Yes                        ; 2.32 V                      ; 1.06e-06 V                  ; 2.36 V             ; -0.00724 V         ; 0.107 V                             ; 0.02 V                              ; 4.5e-10 s                  ; 4.25e-10 s                 ; Yes                       ; Yes                       ;
; segment_data[3] ; 2.5 V        ; 0 s                 ; 0 s                 ; 2.32 V                       ; 1.06e-06 V                   ; 2.36 V              ; -0.00724 V          ; 0.107 V                              ; 0.02 V                               ; 4.5e-10 s                   ; 4.25e-10 s                  ; Yes                        ; Yes                        ; 2.32 V                      ; 1.06e-06 V                  ; 2.36 V             ; -0.00724 V         ; 0.107 V                             ; 0.02 V                              ; 4.5e-10 s                  ; 4.25e-10 s                 ; Yes                       ; Yes                       ;
; segment_data[4] ; 2.5 V        ; 0 s                 ; 0 s                 ; 2.32 V                       ; 1.06e-06 V                   ; 2.36 V              ; -0.00724 V          ; 0.107 V                              ; 0.02 V                               ; 4.5e-10 s                   ; 4.25e-10 s                  ; Yes                        ; Yes                        ; 2.32 V                      ; 1.06e-06 V                  ; 2.36 V             ; -0.00724 V         ; 0.107 V                             ; 0.02 V                              ; 4.5e-10 s                  ; 4.25e-10 s                 ; Yes                       ; Yes                       ;
; segment_data[5] ; 2.5 V        ; 0 s                 ; 0 s                 ; 2.32 V                       ; 1.06e-06 V                   ; 2.36 V              ; -0.00724 V          ; 0.107 V                              ; 0.02 V                               ; 4.5e-10 s                   ; 4.25e-10 s                  ; Yes                        ; Yes                        ; 2.32 V                      ; 1.06e-06 V                  ; 2.36 V             ; -0.00724 V         ; 0.107 V                             ; 0.02 V                              ; 4.5e-10 s                  ; 4.25e-10 s                 ; Yes                       ; Yes                       ;
; segment_data[6] ; 2.5 V        ; 0 s                 ; 0 s                 ; 2.32 V                       ; 1.06e-06 V                   ; 2.36 V              ; -0.00724 V          ; 0.107 V                              ; 0.02 V                               ; 4.5e-10 s                   ; 4.25e-10 s                  ; Yes                        ; Yes                        ; 2.32 V                      ; 1.06e-06 V                  ; 2.36 V             ; -0.00724 V         ; 0.107 V                             ; 0.02 V                              ; 4.5e-10 s                  ; 4.25e-10 s                 ; Yes                       ; Yes                       ;
; segment_data[7] ; 2.5 V        ; 0 s                 ; 0 s                 ; 2.32 V                       ; 1.06e-06 V                   ; 2.36 V              ; -0.00724 V          ; 0.107 V                              ; 0.02 V                               ; 4.5e-10 s                   ; 4.25e-10 s                  ; Yes                        ; Yes                        ; 2.32 V                      ; 1.06e-06 V                  ; 2.36 V             ; -0.00724 V         ; 0.107 V                             ; 0.02 V                              ; 4.5e-10 s                  ; 4.25e-10 s                 ; Yes                       ; Yes                       ;
; sel0            ; 2.5 V        ; 0 s                 ; 0 s                 ; 2.32 V                       ; 1.06e-06 V                   ; 2.36 V              ; -0.00724 V          ; 0.107 V                              ; 0.02 V                               ; 4.5e-10 s                   ; 4.25e-10 s                  ; Yes                        ; Yes                        ; 2.32 V                      ; 1.06e-06 V                  ; 2.36 V             ; -0.00724 V         ; 0.107 V                             ; 0.02 V                              ; 4.5e-10 s                  ; 4.25e-10 s                 ; Yes                       ; Yes                       ;
; sel1            ; 2.5 V        ; 0 s                 ; 0 s                 ; 2.32 V                       ; 1.06e-06 V                   ; 2.36 V              ; -0.00724 V          ; 0.107 V                              ; 0.02 V                               ; 4.5e-10 s                   ; 4.25e-10 s                  ; Yes                        ; Yes                        ; 2.32 V                      ; 1.06e-06 V                  ; 2.36 V             ; -0.00724 V         ; 0.107 V                             ; 0.02 V                              ; 4.5e-10 s                  ; 4.25e-10 s                 ; Yes                       ; Yes                       ;
; sel2            ; 2.5 V        ; 0 s                 ; 0 s                 ; 2.32 V                       ; 1.06e-06 V                   ; 2.36 V              ; -0.00724 V          ; 0.107 V                              ; 0.02 V                               ; 4.5e-10 s                   ; 4.25e-10 s                  ; Yes                        ; Yes                        ; 2.32 V                      ; 1.06e-06 V                  ; 2.36 V             ; -0.00724 V         ; 0.107 V                             ; 0.02 V                              ; 4.5e-10 s                  ; 4.25e-10 s                 ; Yes                       ; Yes                       ;
; enable3to8      ; 2.5 V        ; 0 s                 ; 0 s                 ; 2.32 V                       ; 1.06e-06 V                   ; 2.36 V              ; -0.00724 V          ; 0.107 V                              ; 0.02 V                               ; 4.5e-10 s                   ; 4.25e-10 s                  ; Yes                        ; Yes                        ; 2.32 V                      ; 1.06e-06 V                  ; 2.36 V             ; -0.00724 V         ; 0.107 V                             ; 0.02 V                              ; 4.5e-10 s                  ; 4.25e-10 s                 ; Yes                       ; Yes                       ;
; enable3to8_n    ; 2.5 V        ; 0 s                 ; 0 s                 ; 2.32 V                       ; 1.06e-06 V                   ; 2.36 V              ; -0.00724 V          ; 0.107 V                              ; 0.02 V                               ; 4.5e-10 s                   ; 4.25e-10 s                  ; Yes                        ; Yes                        ; 2.32 V                      ; 1.06e-06 V                  ; 2.36 V             ; -0.00724 V         ; 0.107 V                             ; 0.02 V                              ; 4.5e-10 s                  ; 4.25e-10 s                 ; Yes                       ; Yes                       ;
; pwm_output      ; 2.5 V        ; 0 s                 ; 0 s                 ; 2.32 V                       ; 1.06e-06 V                   ; 2.36 V              ; -0.00724 V          ; 0.107 V                              ; 0.02 V                               ; 4.5e-10 s                   ; 4.25e-10 s                  ; Yes                        ; Yes                        ; 2.32 V                      ; 1.06e-06 V                  ; 2.36 V             ; -0.00724 V         ; 0.107 V                             ; 0.02 V                              ; 4.5e-10 s                  ; 4.25e-10 s                 ; Yes                       ; Yes                       ;
; rom_data[0]     ; 2.5 V        ; 0 s                 ; 0 s                 ; 2.32 V                       ; 1.06e-06 V                   ; 2.36 V              ; -0.00724 V          ; 0.107 V                              ; 0.02 V                               ; 4.5e-10 s                   ; 4.25e-10 s                  ; Yes                        ; Yes                        ; 2.32 V                      ; 1.06e-06 V                  ; 2.36 V             ; -0.00724 V         ; 0.107 V                             ; 0.02 V                              ; 4.5e-10 s                  ; 4.25e-10 s                 ; Yes                       ; Yes                       ;
; rom_data[1]     ; 2.5 V        ; 0 s                 ; 0 s                 ; 2.32 V                       ; 1.06e-06 V                   ; 2.36 V              ; -0.00724 V          ; 0.107 V                              ; 0.02 V                               ; 4.5e-10 s                   ; 4.25e-10 s                  ; Yes                        ; Yes                        ; 2.32 V                      ; 1.06e-06 V                  ; 2.36 V             ; -0.00724 V         ; 0.107 V                             ; 0.02 V                              ; 4.5e-10 s                  ; 4.25e-10 s                 ; Yes                       ; Yes                       ;
; rom_data[2]     ; 2.5 V        ; 0 s                 ; 0 s                 ; 2.32 V                       ; 1.06e-06 V                   ; 2.36 V              ; -0.00724 V          ; 0.107 V                              ; 0.02 V                               ; 4.5e-10 s                   ; 4.25e-10 s                  ; Yes                        ; Yes                        ; 2.32 V                      ; 1.06e-06 V                  ; 2.36 V             ; -0.00724 V         ; 0.107 V                             ; 0.02 V                              ; 4.5e-10 s                  ; 4.25e-10 s                 ; Yes                       ; Yes                       ;
; rom_data[3]     ; 2.5 V        ; 0 s                 ; 0 s                 ; 2.32 V                       ; 1.06e-06 V                   ; 2.36 V              ; -0.00724 V          ; 0.107 V                              ; 0.02 V                               ; 4.5e-10 s                   ; 4.25e-10 s                  ; Yes                        ; Yes                        ; 2.32 V                      ; 1.06e-06 V                  ; 2.36 V             ; -0.00724 V         ; 0.107 V                             ; 0.02 V                              ; 4.5e-10 s                  ; 4.25e-10 s                 ; Yes                       ; Yes                       ;
; rom_data[4]     ; 2.5 V        ; 0 s                 ; 0 s                 ; 2.32 V                       ; 1.06e-06 V                   ; 2.36 V              ; -0.00724 V          ; 0.107 V                              ; 0.02 V                               ; 4.5e-10 s                   ; 4.25e-10 s                  ; Yes                        ; Yes                        ; 2.32 V                      ; 1.06e-06 V                  ; 2.36 V             ; -0.00724 V         ; 0.107 V                             ; 0.02 V                              ; 4.5e-10 s                  ; 4.25e-10 s                 ; Yes                       ; Yes                       ;
; rom_data[5]     ; 2.5 V        ; 0 s                 ; 0 s                 ; 2.32 V                       ; 1.06e-06 V                   ; 2.36 V              ; -0.00724 V          ; 0.107 V                              ; 0.02 V                               ; 4.5e-10 s                   ; 4.25e-10 s                  ; Yes                        ; Yes                        ; 2.32 V                      ; 1.06e-06 V                  ; 2.36 V             ; -0.00724 V         ; 0.107 V                             ; 0.02 V                              ; 4.5e-10 s                  ; 4.25e-10 s                 ; Yes                       ; Yes                       ;
; rom_data[6]     ; 2.5 V        ; 0 s                 ; 0 s                 ; 2.32 V                       ; 1.06e-06 V                   ; 2.36 V              ; -0.00724 V          ; 0.107 V                              ; 0.02 V                               ; 4.5e-10 s                   ; 4.25e-10 s                  ; Yes                        ; Yes                        ; 2.32 V                      ; 1.06e-06 V                  ; 2.36 V             ; -0.00724 V         ; 0.107 V                             ; 0.02 V                              ; 4.5e-10 s                  ; 4.25e-10 s                 ; Yes                       ; Yes                       ;
; rom_data[7]     ; 2.5 V        ; 0 s                 ; 0 s                 ; 2.32 V                       ; 1.06e-06 V                   ; 2.36 V              ; -0.00724 V          ; 0.107 V                              ; 0.02 V                               ; 4.5e-10 s                   ; 4.25e-10 s                  ; Yes                        ; Yes                        ; 2.32 V                      ; 1.06e-06 V                  ; 2.36 V             ; -0.00724 V         ; 0.107 V                             ; 0.02 V                              ; 4.5e-10 s                  ; 4.25e-10 s                 ; Yes                       ; Yes                       ;
; ~ALTERA_DCLK~   ; 2.5 V        ; 0 s                 ; 0 s                 ; 2.32 V                       ; 5.74e-07 V                   ; 2.36 V              ; -0.0201 V           ; 0.072 V                              ; 0.033 V                              ; 4.04e-10 s                  ; 3.29e-10 s                  ; Yes                        ; Yes                        ; 2.32 V                      ; 5.74e-07 V                  ; 2.36 V             ; -0.0201 V          ; 0.072 V                             ; 0.033 V                             ; 4.04e-10 s                 ; 3.29e-10 s                 ; Yes                       ; Yes                       ;
; ~ALTERA_nCEO~   ; 2.5 V        ; 0 s                 ; 0 s                 ; 2.32 V                       ; 9.45e-07 V                   ; 2.35 V              ; -0.00643 V          ; 0.081 V                              ; 0.031 V                              ; 5.31e-10 s                  ; 7.59e-10 s                  ; Yes                        ; Yes                        ; 2.32 V                      ; 9.45e-07 V                  ; 2.35 V             ; -0.00643 V         ; 0.081 V                             ; 0.031 V                             ; 5.31e-10 s                 ; 7.59e-10 s                 ; Yes                       ; Yes                       ;
+-----------------+--------------+---------------------+---------------------+------------------------------+------------------------------+---------------------+---------------------+--------------------------------------+--------------------------------------+-----------------------------+-----------------------------+----------------------------+----------------------------+-----------------------------+-----------------------------+--------------------+--------------------+-------------------------------------+-------------------------------------+----------------------------+----------------------------+---------------------------+---------------------------+


+----------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------------+
; Signal Integrity Metrics (Fast 1200mv 0c Model)                                                                                                                                                                                                                                                                                                                                                                                                                                                                                                                                                                                                                                              ;
+-----------------+--------------+---------------------+---------------------+------------------------------+------------------------------+---------------------+---------------------+--------------------------------------+--------------------------------------+-----------------------------+-----------------------------+----------------------------+----------------------------+-----------------------------+-----------------------------+--------------------+--------------------+-------------------------------------+-------------------------------------+----------------------------+----------------------------+---------------------------+---------------------------+
; Pin             ; I/O Standard ; Board Delay on Rise ; Board Delay on Fall ; Steady State Voh at FPGA Pin ; Steady State Vol at FPGA Pin ; Voh Max at FPGA Pin ; Vol Min at FPGA Pin ; Ringback Voltage on Rise at FPGA Pin ; Ringback Voltage on Fall at FPGA Pin ; 10-90 Rise Time at FPGA Pin ; 90-10 Fall Time at FPGA Pin ; Monotonic Rise at FPGA Pin ; Monotonic Fall at FPGA Pin ; Steady State Voh at Far-end ; Steady State Vol at Far-end ; Voh Max at Far-end ; Vol Min at Far-end ; Ringback Voltage on Rise at Far-end ; Ringback Voltage on Fall at Far-end ; 10-90 Rise Time at Far-end ; 90-10 Fall Time at Far-end ; Monotonic Rise at Far-end ; Monotonic Fall at Far-end ;
+-----------------+--------------+---------------------+---------------------+------------------------------+------------------------------+---------------------+---------------------+--------------------------------------+--------------------------------------+-----------------------------+-----------------------------+----------------------------+----------------------------+-----------------------------+-----------------------------+--------------------+--------------------+-------------------------------------+-------------------------------------+----------------------------+----------------------------+---------------------------+---------------------------+
; segment_data[0] ; 2.5 V        ; 0 s                 ; 0 s                 ; 2.62 V                       ; 4.05e-08 V                   ; 2.72 V              ; -0.0349 V           ; 0.173 V                              ; 0.1 V                                ; 2.72e-10 s                  ; 2.69e-10 s                  ; Yes                        ; Yes                        ; 2.62 V                      ; 4.05e-08 V                  ; 2.72 V             ; -0.0349 V          ; 0.173 V                             ; 0.1 V                               ; 2.72e-10 s                 ; 2.69e-10 s                 ; Yes                       ; Yes                       ;
; segment_data[1] ; 2.5 V        ; 0 s                 ; 0 s                 ; 2.62 V                       ; 4.05e-08 V                   ; 2.72 V              ; -0.0349 V           ; 0.173 V                              ; 0.1 V                                ; 2.72e-10 s                  ; 2.69e-10 s                  ; Yes                        ; Yes                        ; 2.62 V                      ; 4.05e-08 V                  ; 2.72 V             ; -0.0349 V          ; 0.173 V                             ; 0.1 V                               ; 2.72e-10 s                 ; 2.69e-10 s                 ; Yes                       ; Yes                       ;
; segment_data[2] ; 2.5 V        ; 0 s                 ; 0 s                 ; 2.62 V                       ; 4.05e-08 V                   ; 2.72 V              ; -0.0349 V           ; 0.173 V                              ; 0.1 V                                ; 2.72e-10 s                  ; 2.69e-10 s                  ; Yes                        ; Yes                        ; 2.62 V                      ; 4.05e-08 V                  ; 2.72 V             ; -0.0349 V          ; 0.173 V                             ; 0.1 V                               ; 2.72e-10 s                 ; 2.69e-10 s                 ; Yes                       ; Yes                       ;
; segment_data[3] ; 2.5 V        ; 0 s                 ; 0 s                 ; 2.62 V                       ; 4.05e-08 V                   ; 2.72 V              ; -0.0349 V           ; 0.173 V                              ; 0.1 V                                ; 2.72e-10 s                  ; 2.69e-10 s                  ; Yes                        ; Yes                        ; 2.62 V                      ; 4.05e-08 V                  ; 2.72 V             ; -0.0349 V          ; 0.173 V                             ; 0.1 V                               ; 2.72e-10 s                 ; 2.69e-10 s                 ; Yes                       ; Yes                       ;
; segment_data[4] ; 2.5 V        ; 0 s                 ; 0 s                 ; 2.62 V                       ; 4.05e-08 V                   ; 2.72 V              ; -0.0349 V           ; 0.173 V                              ; 0.1 V                                ; 2.72e-10 s                  ; 2.69e-10 s                  ; Yes                        ; Yes                        ; 2.62 V                      ; 4.05e-08 V                  ; 2.72 V             ; -0.0349 V          ; 0.173 V                             ; 0.1 V                               ; 2.72e-10 s                 ; 2.69e-10 s                 ; Yes                       ; Yes                       ;
; segment_data[5] ; 2.5 V        ; 0 s                 ; 0 s                 ; 2.62 V                       ; 4.05e-08 V                   ; 2.72 V              ; -0.0349 V           ; 0.173 V                              ; 0.1 V                                ; 2.72e-10 s                  ; 2.69e-10 s                  ; Yes                        ; Yes                        ; 2.62 V                      ; 4.05e-08 V                  ; 2.72 V             ; -0.0349 V          ; 0.173 V                             ; 0.1 V                               ; 2.72e-10 s                 ; 2.69e-10 s                 ; Yes                       ; Yes                       ;
; segment_data[6] ; 2.5 V        ; 0 s                 ; 0 s                 ; 2.62 V                       ; 4.05e-08 V                   ; 2.72 V              ; -0.0349 V           ; 0.173 V                              ; 0.1 V                                ; 2.72e-10 s                  ; 2.69e-10 s                  ; Yes                        ; Yes                        ; 2.62 V                      ; 4.05e-08 V                  ; 2.72 V             ; -0.0349 V          ; 0.173 V                             ; 0.1 V                               ; 2.72e-10 s                 ; 2.69e-10 s                 ; Yes                       ; Yes                       ;
; segment_data[7] ; 2.5 V        ; 0 s                 ; 0 s                 ; 2.62 V                       ; 4.05e-08 V                   ; 2.72 V              ; -0.0349 V           ; 0.173 V                              ; 0.1 V                                ; 2.72e-10 s                  ; 2.69e-10 s                  ; Yes                        ; Yes                        ; 2.62 V                      ; 4.05e-08 V                  ; 2.72 V             ; -0.0349 V          ; 0.173 V                             ; 0.1 V                               ; 2.72e-10 s                 ; 2.69e-10 s                 ; Yes                       ; Yes                       ;
; sel0            ; 2.5 V        ; 0 s                 ; 0 s                 ; 2.62 V                       ; 4.05e-08 V                   ; 2.72 V              ; -0.0349 V           ; 0.173 V                              ; 0.1 V                                ; 2.72e-10 s                  ; 2.69e-10 s                  ; Yes                        ; Yes                        ; 2.62 V                      ; 4.05e-08 V                  ; 2.72 V             ; -0.0349 V          ; 0.173 V                             ; 0.1 V                               ; 2.72e-10 s                 ; 2.69e-10 s                 ; Yes                       ; Yes                       ;
; sel1            ; 2.5 V        ; 0 s                 ; 0 s                 ; 2.62 V                       ; 4.05e-08 V                   ; 2.72 V              ; -0.0349 V           ; 0.173 V                              ; 0.1 V                                ; 2.72e-10 s                  ; 2.69e-10 s                  ; Yes                        ; Yes                        ; 2.62 V                      ; 4.05e-08 V                  ; 2.72 V             ; -0.0349 V          ; 0.173 V                             ; 0.1 V                               ; 2.72e-10 s                 ; 2.69e-10 s                 ; Yes                       ; Yes                       ;
; sel2            ; 2.5 V        ; 0 s                 ; 0 s                 ; 2.62 V                       ; 4.05e-08 V                   ; 2.72 V              ; -0.0349 V           ; 0.173 V                              ; 0.1 V                                ; 2.72e-10 s                  ; 2.69e-10 s                  ; Yes                        ; Yes                        ; 2.62 V                      ; 4.05e-08 V                  ; 2.72 V             ; -0.0349 V          ; 0.173 V                             ; 0.1 V                               ; 2.72e-10 s                 ; 2.69e-10 s                 ; Yes                       ; Yes                       ;
; enable3to8      ; 2.5 V        ; 0 s                 ; 0 s                 ; 2.62 V                       ; 4.05e-08 V                   ; 2.72 V              ; -0.0349 V           ; 0.173 V                              ; 0.1 V                                ; 2.72e-10 s                  ; 2.69e-10 s                  ; Yes                        ; Yes                        ; 2.62 V                      ; 4.05e-08 V                  ; 2.72 V             ; -0.0349 V          ; 0.173 V                             ; 0.1 V                               ; 2.72e-10 s                 ; 2.69e-10 s                 ; Yes                       ; Yes                       ;
; enable3to8_n    ; 2.5 V        ; 0 s                 ; 0 s                 ; 2.62 V                       ; 4.05e-08 V                   ; 2.72 V              ; -0.0349 V           ; 0.173 V                              ; 0.1 V                                ; 2.72e-10 s                  ; 2.69e-10 s                  ; Yes                        ; Yes                        ; 2.62 V                      ; 4.05e-08 V                  ; 2.72 V             ; -0.0349 V          ; 0.173 V                             ; 0.1 V                               ; 2.72e-10 s                 ; 2.69e-10 s                 ; Yes                       ; Yes                       ;
; pwm_output      ; 2.5 V        ; 0 s                 ; 0 s                 ; 2.62 V                       ; 4.05e-08 V                   ; 2.72 V              ; -0.0349 V           ; 0.173 V                              ; 0.1 V                                ; 2.72e-10 s                  ; 2.69e-10 s                  ; Yes                        ; Yes                        ; 2.62 V                      ; 4.05e-08 V                  ; 2.72 V             ; -0.0349 V          ; 0.173 V                             ; 0.1 V                               ; 2.72e-10 s                 ; 2.69e-10 s                 ; Yes                       ; Yes                       ;
; rom_data[0]     ; 2.5 V        ; 0 s                 ; 0 s                 ; 2.62 V                       ; 4.05e-08 V                   ; 2.72 V              ; -0.0349 V           ; 0.173 V                              ; 0.1 V                                ; 2.72e-10 s                  ; 2.69e-10 s                  ; Yes                        ; Yes                        ; 2.62 V                      ; 4.05e-08 V                  ; 2.72 V             ; -0.0349 V          ; 0.173 V                             ; 0.1 V                               ; 2.72e-10 s                 ; 2.69e-10 s                 ; Yes                       ; Yes                       ;
; rom_data[1]     ; 2.5 V        ; 0 s                 ; 0 s                 ; 2.62 V                       ; 4.05e-08 V                   ; 2.72 V              ; -0.0349 V           ; 0.173 V                              ; 0.1 V                                ; 2.72e-10 s                  ; 2.69e-10 s                  ; Yes                        ; Yes                        ; 2.62 V                      ; 4.05e-08 V                  ; 2.72 V             ; -0.0349 V          ; 0.173 V                             ; 0.1 V                               ; 2.72e-10 s                 ; 2.69e-10 s                 ; Yes                       ; Yes                       ;
; rom_data[2]     ; 2.5 V        ; 0 s                 ; 0 s                 ; 2.62 V                       ; 4.05e-08 V                   ; 2.72 V              ; -0.0349 V           ; 0.173 V                              ; 0.1 V                                ; 2.72e-10 s                  ; 2.69e-10 s                  ; Yes                        ; Yes                        ; 2.62 V                      ; 4.05e-08 V                  ; 2.72 V             ; -0.0349 V          ; 0.173 V                             ; 0.1 V                               ; 2.72e-10 s                 ; 2.69e-10 s                 ; Yes                       ; Yes                       ;
; rom_data[3]     ; 2.5 V        ; 0 s                 ; 0 s                 ; 2.62 V                       ; 4.05e-08 V                   ; 2.72 V              ; -0.0349 V           ; 0.173 V                              ; 0.1 V                                ; 2.72e-10 s                  ; 2.69e-10 s                  ; Yes                        ; Yes                        ; 2.62 V                      ; 4.05e-08 V                  ; 2.72 V             ; -0.0349 V          ; 0.173 V                             ; 0.1 V                               ; 2.72e-10 s                 ; 2.69e-10 s                 ; Yes                       ; Yes                       ;
; rom_data[4]     ; 2.5 V        ; 0 s                 ; 0 s                 ; 2.62 V                       ; 4.05e-08 V                   ; 2.72 V              ; -0.0349 V           ; 0.173 V                              ; 0.1 V                                ; 2.72e-10 s                  ; 2.69e-10 s                  ; Yes                        ; Yes                        ; 2.62 V                      ; 4.05e-08 V                  ; 2.72 V             ; -0.0349 V          ; 0.173 V                             ; 0.1 V                               ; 2.72e-10 s                 ; 2.69e-10 s                 ; Yes                       ; Yes                       ;
; rom_data[5]     ; 2.5 V        ; 0 s                 ; 0 s                 ; 2.62 V                       ; 4.05e-08 V                   ; 2.72 V              ; -0.0349 V           ; 0.173 V                              ; 0.1 V                                ; 2.72e-10 s                  ; 2.69e-10 s                  ; Yes                        ; Yes                        ; 2.62 V                      ; 4.05e-08 V                  ; 2.72 V             ; -0.0349 V          ; 0.173 V                             ; 0.1 V                               ; 2.72e-10 s                 ; 2.69e-10 s                 ; Yes                       ; Yes                       ;
; rom_data[6]     ; 2.5 V        ; 0 s                 ; 0 s                 ; 2.62 V                       ; 4.05e-08 V                   ; 2.72 V              ; -0.0349 V           ; 0.173 V                              ; 0.1 V                                ; 2.72e-10 s                  ; 2.69e-10 s                  ; Yes                        ; Yes                        ; 2.62 V                      ; 4.05e-08 V                  ; 2.72 V             ; -0.0349 V          ; 0.173 V                             ; 0.1 V                               ; 2.72e-10 s                 ; 2.69e-10 s                 ; Yes                       ; Yes                       ;
; rom_data[7]     ; 2.5 V        ; 0 s                 ; 0 s                 ; 2.62 V                       ; 4.05e-08 V                   ; 2.72 V              ; -0.0349 V           ; 0.173 V                              ; 0.1 V                                ; 2.72e-10 s                  ; 2.69e-10 s                  ; Yes                        ; Yes                        ; 2.62 V                      ; 4.05e-08 V                  ; 2.72 V             ; -0.0349 V          ; 0.173 V                             ; 0.1 V                               ; 2.72e-10 s                 ; 2.69e-10 s                 ; Yes                       ; Yes                       ;
; ~ALTERA_DCLK~   ; 2.5 V        ; 0 s                 ; 0 s                 ; 2.62 V                       ; 2.22e-08 V                   ; 2.74 V              ; -0.06 V             ; 0.158 V                              ; 0.08 V                               ; 2.68e-10 s                  ; 2.19e-10 s                  ; Yes                        ; Yes                        ; 2.62 V                      ; 2.22e-08 V                  ; 2.74 V             ; -0.06 V            ; 0.158 V                             ; 0.08 V                              ; 2.68e-10 s                 ; 2.19e-10 s                 ; Yes                       ; Yes                       ;
; ~ALTERA_nCEO~   ; 2.5 V        ; 0 s                 ; 0 s                 ; 2.62 V                       ; 3.54e-08 V                   ; 2.7 V               ; -0.00943 V          ; 0.276 V                              ; 0.035 V                              ; 3.19e-10 s                  ; 4.99e-10 s                  ; No                         ; Yes                        ; 2.62 V                      ; 3.54e-08 V                  ; 2.7 V              ; -0.00943 V         ; 0.276 V                             ; 0.035 V                             ; 3.19e-10 s                 ; 4.99e-10 s                 ; No                        ; Yes                       ;
+-----------------+--------------+---------------------+---------------------+------------------------------+------------------------------+---------------------+---------------------+--------------------------------------+--------------------------------------+-----------------------------+-----------------------------+----------------------------+----------------------------+-----------------------------+-----------------------------+--------------------+--------------------+-------------------------------------+-------------------------------------+----------------------------+----------------------------+---------------------------+---------------------------+


+-------------------------------------------------------------------------------------------------------------------------------------------------------------------+
; Setup Transfers                                                                                                                                                   ;
+-----------------------------------------------------------+-----------------------------------------------------------+----------+----------+----------+----------+
; From Clock                                                ; To Clock                                                  ; RR Paths ; FR Paths ; RF Paths ; FF Paths ;
+-----------------------------------------------------------+-----------------------------------------------------------+----------+----------+----------+----------+
; debounce_cnt[0]                                           ; debounce_cnt[0]                                           ; 610      ; 0        ; 0        ; 0        ;
; digit_clk                                                 ; digit_clk                                                 ; 8        ; 0        ; 0        ; 0        ;
; debounce_cnt[0]                                           ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[1] ; 5        ; 5        ; 0        ; 0        ;
; digit_clk                                                 ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[1] ; 1        ; 1        ; 0        ; 0        ;
; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[1] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[1] ; 4        ; 0        ; 0        ; 0        ;
; debounce_cnt[0]                                           ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 245      ; 0        ; 0        ; 0        ;
; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 322      ; 0        ; 0        ; 0        ;
+-----------------------------------------------------------+-----------------------------------------------------------+----------+----------+----------+----------+
Entries labeled "false path" only account for clock-to-clock false paths and not path-based false paths. As a result, actual path counts may be lower than reported.


+-------------------------------------------------------------------------------------------------------------------------------------------------------------------+
; Hold Transfers                                                                                                                                                    ;
+-----------------------------------------------------------+-----------------------------------------------------------+----------+----------+----------+----------+
; From Clock                                                ; To Clock                                                  ; RR Paths ; FR Paths ; RF Paths ; FF Paths ;
+-----------------------------------------------------------+-----------------------------------------------------------+----------+----------+----------+----------+
; debounce_cnt[0]                                           ; debounce_cnt[0]                                           ; 610      ; 0        ; 0        ; 0        ;
; digit_clk                                                 ; digit_clk                                                 ; 8        ; 0        ; 0        ; 0        ;
; debounce_cnt[0]                                           ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[1] ; 5        ; 5        ; 0        ; 0        ;
; digit_clk                                                 ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[1] ; 1        ; 1        ; 0        ; 0        ;
; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[1] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[1] ; 4        ; 0        ; 0        ; 0        ;
; debounce_cnt[0]                                           ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 245      ; 0        ; 0        ; 0        ;
; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; 322      ; 0        ; 0        ; 0        ;
+-----------------------------------------------------------+-----------------------------------------------------------+----------+----------+----------+----------+
Entries labeled "false path" only account for clock-to-clock false paths and not path-based false paths. As a result, actual path counts may be lower than reported.


---------------
; Report TCCS ;
---------------
No dedicated SERDES Transmitter circuitry present in device or used in design


---------------
; Report RSKM ;
---------------
No non-DPA dedicated SERDES Receiver circuitry present in device or used in design


+------------------------------------------------+
; Unconstrained Paths Summary                    ;
+---------------------------------+-------+------+
; Property                        ; Setup ; Hold ;
+---------------------------------+-------+------+
; Illegal Clocks                  ; 0     ; 0    ;
; Unconstrained Clocks            ; 0     ; 0    ;
; Unconstrained Input Ports       ; 3     ; 3    ;
; Unconstrained Input Port Paths  ; 58    ; 58   ;
; Unconstrained Output Ports      ; 19    ; 19   ;
; Unconstrained Output Port Paths ; 146   ; 146  ;
+---------------------------------+-------+------+


+-------------------------------------------------------------------------------------------------------------------------------------------------+
; Clock Status Summary                                                                                                                            ;
+-----------------------------------------------------------+-----------------------------------------------------------+-----------+-------------+
; Target                                                    ; Clock                                                     ; Type      ; Status      ;
+-----------------------------------------------------------+-----------------------------------------------------------+-----------+-------------+
; debounce_cnt[0]                                           ; debounce_cnt[0]                                           ; Base      ; Constrained ;
; digit_clk                                                 ; digit_clk                                                 ; Base      ; Constrained ;
; inclk0_sig                                                ; inclk0_sig                                                ; Base      ; Constrained ;
; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[1] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[1] ; Generated ; Constrained ;
; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] ; Generated ; Constrained ;
+-----------------------------------------------------------+-----------------------------------------------------------+-----------+-------------+


+---------------------------------------------------------------------------------------------------+
; Unconstrained Input Ports                                                                         ;
+------------+--------------------------------------------------------------------------------------+
; Input Port ; Comment                                                                              ;
+------------+--------------------------------------------------------------------------------------+
; encoder_a  ; No input delay, min/max delays, false-path exceptions, or max skew assignments found ;
; encoder_b  ; No input delay, min/max delays, false-path exceptions, or max skew assignments found ;
; reset_n    ; No input delay, min/max delays, false-path exceptions, or max skew assignments found ;
+------------+--------------------------------------------------------------------------------------+


+---------------------------------------------------------------------------------------------------------+
; Unconstrained Output Ports                                                                              ;
+-----------------+---------------------------------------------------------------------------------------+
; Output Port     ; Comment                                                                               ;
+-----------------+---------------------------------------------------------------------------------------+
; enable3to8      ; No output delay, min/max delays, false-path exceptions, or max skew assignments found ;
; rom_data[0]     ; No output delay, min/max delays, false-path exceptions, or max skew assignments found ;
; rom_data[1]     ; No output delay, min/max delays, false-path exceptions, or max skew assignments found ;
; rom_data[2]     ; No output delay, min/max delays, false-path exceptions, or max skew assignments found ;
; rom_data[3]     ; No output delay, min/max delays, false-path exceptions, or max skew assignments found ;
; rom_data[4]     ; No output delay, min/max delays, false-path exceptions, or max skew assignments found ;
; rom_data[5]     ; No output delay, min/max delays, false-path exceptions, or max skew assignments found ;
; rom_data[6]     ; No output delay, min/max delays, false-path exceptions, or max skew assignments found ;
; rom_data[7]     ; No output delay, min/max delays, false-path exceptions, or max skew assignments found ;
; segment_data[1] ; No output delay, min/max delays, false-path exceptions, or max skew assignments found ;
; segment_data[2] ; No output delay, min/max delays, false-path exceptions, or max skew assignments found ;
; segment_data[3] ; No output delay, min/max delays, false-path exceptions, or max skew assignments found ;
; segment_data[4] ; No output delay, min/max delays, false-path exceptions, or max skew assignments found ;
; segment_data[5] ; No output delay, min/max delays, false-path exceptions, or max skew assignments found ;
; segment_data[6] ; No output delay, min/max delays, false-path exceptions, or max skew assignments found ;
; segment_data[7] ; No output delay, min/max delays, false-path exceptions, or max skew assignments found ;
; sel0            ; No output delay, min/max delays, false-path exceptions, or max skew assignments found ;
; sel1            ; No output delay, min/max delays, false-path exceptions, or max skew assignments found ;
; sel2            ; No output delay, min/max delays, false-path exceptions, or max skew assignments found ;
+-----------------+---------------------------------------------------------------------------------------+


+---------------------------------------------------------------------------------------------------+
; Unconstrained Input Ports                                                                         ;
+------------+--------------------------------------------------------------------------------------+
; Input Port ; Comment                                                                              ;
+------------+--------------------------------------------------------------------------------------+
; encoder_a  ; No input delay, min/max delays, false-path exceptions, or max skew assignments found ;
; encoder_b  ; No input delay, min/max delays, false-path exceptions, or max skew assignments found ;
; reset_n    ; No input delay, min/max delays, false-path exceptions, or max skew assignments found ;
+------------+--------------------------------------------------------------------------------------+


+---------------------------------------------------------------------------------------------------------+
; Unconstrained Output Ports                                                                              ;
+-----------------+---------------------------------------------------------------------------------------+
; Output Port     ; Comment                                                                               ;
+-----------------+---------------------------------------------------------------------------------------+
; enable3to8      ; No output delay, min/max delays, false-path exceptions, or max skew assignments found ;
; rom_data[0]     ; No output delay, min/max delays, false-path exceptions, or max skew assignments found ;
; rom_data[1]     ; No output delay, min/max delays, false-path exceptions, or max skew assignments found ;
; rom_data[2]     ; No output delay, min/max delays, false-path exceptions, or max skew assignments found ;
; rom_data[3]     ; No output delay, min/max delays, false-path exceptions, or max skew assignments found ;
; rom_data[4]     ; No output delay, min/max delays, false-path exceptions, or max skew assignments found ;
; rom_data[5]     ; No output delay, min/max delays, false-path exceptions, or max skew assignments found ;
; rom_data[6]     ; No output delay, min/max delays, false-path exceptions, or max skew assignments found ;
; rom_data[7]     ; No output delay, min/max delays, false-path exceptions, or max skew assignments found ;
; segment_data[1] ; No output delay, min/max delays, false-path exceptions, or max skew assignments found ;
; segment_data[2] ; No output delay, min/max delays, false-path exceptions, or max skew assignments found ;
; segment_data[3] ; No output delay, min/max delays, false-path exceptions, or max skew assignments found ;
; segment_data[4] ; No output delay, min/max delays, false-path exceptions, or max skew assignments found ;
; segment_data[5] ; No output delay, min/max delays, false-path exceptions, or max skew assignments found ;
; segment_data[6] ; No output delay, min/max delays, false-path exceptions, or max skew assignments found ;
; segment_data[7] ; No output delay, min/max delays, false-path exceptions, or max skew assignments found ;
; sel0            ; No output delay, min/max delays, false-path exceptions, or max skew assignments found ;
; sel1            ; No output delay, min/max delays, false-path exceptions, or max skew assignments found ;
; sel2            ; No output delay, min/max delays, false-path exceptions, or max skew assignments found ;
+-----------------+---------------------------------------------------------------------------------------+


+------------------------------------+
; TimeQuest Timing Analyzer Messages ;
+------------------------------------+
Info: *******************************************************************
Info: Running Quartus Prime TimeQuest Timing Analyzer
    Info: Version 15.1.1 Build 189 12/02/2015 SJ Lite Edition
    Info: Processing started: Fri May  6 14:24:15 2016
Info: Command: quartus_sta lab5 -c lab5
Info: qsta_default_script.tcl version: #1
Warning (20028): Parallel compilation is not licensed and has been disabled
Info (21076): High junction temperature operating condition is not set. Assuming a default value of '85'.
Info (21076): Low junction temperature operating condition is not set. Assuming a default value of '0'.
Critical Warning (332012): Synopsys Design Constraints File file not found: 'lab5.sdc'. A Synopsys Design Constraints File is required by the TimeQuest Timing Analyzer to get proper timing constraints. Without it, the Compiler will not properly optimize the design.
Info (332142): No user constrained generated clocks found in the design. Calling "derive_pll_clocks -create_base_clocks"
Info (332110): Deriving PLL clocks
    Info (332110): create_clock -period 20.000 -waveform {0.000 10.000} -name inclk0_sig inclk0_sig
    Info (332110): create_generated_clock -source {pll_lab5_inst|altpll_component|auto_generated|pll1|inclk[0]} -divide_by 12500 -duty_cycle 50.00 -name {pll_lab5_inst|altpll_component|auto_generated|pll1|clk[1]} {pll_lab5_inst|altpll_component|auto_generated|pll1|clk[1]}
    Info (332110): create_generated_clock -source {pll_lab5_inst|altpll_component|auto_generated|pll1|inclk[0]} -divide_by 152 -multiply_by 51 -duty_cycle 50.00 -name {pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2]} {pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2]}
Info (332142): No user constrained base clocks found in the design. Calling "derive_clocks -period 1.0"
Info (332105): Deriving Clocks
    Info (332105): create_clock -period 1.000 -name debounce_cnt[0] debounce_cnt[0]
    Info (332105): create_clock -period 1.000 -name digit_clk digit_clk
Info (332143): No user constrained clock uncertainty found in the design. Calling "derive_clock_uncertainty"
Info (332123): Deriving Clock Uncertainty. Please refer to report_sdc in TimeQuest to see clock uncertainties.
Info: Found TIMEQUEST_REPORT_SCRIPT_INCLUDE_DEFAULT_ANALYSIS = ON
Info: Analyzing Slow 1200mV 85C Model
Critical Warning (332148): Timing requirements not met
    Info (11105): For recommendations on closing timing, run Report Timing Closure Recommendations in the TimeQuest Timing Analyzer.
Info (332146): Worst-case setup slack is -5.344
    Info (332119):     Slack       End Point TNS Clock 
    Info (332119): ========= =================== =====================
    Info (332119):    -5.344            -112.036 pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] 
    Info (332119):    -2.368             -31.522 debounce_cnt[0] 
    Info (332119):    -0.798              -2.342 pll_lab5_inst|altpll_component|auto_generated|pll1|clk[1] 
    Info (332119):    -0.501              -1.125 digit_clk 
Info (332146): Worst-case hold slack is -0.207
    Info (332119):     Slack       End Point TNS Clock 
    Info (332119): ========= =================== =====================
    Info (332119):    -0.207              -0.392 pll_lab5_inst|altpll_component|auto_generated|pll1|clk[1] 
    Info (332119):     0.357               0.000 debounce_cnt[0] 
    Info (332119):     0.361               0.000 digit_clk 
    Info (332119):     0.534               0.000 pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] 
Info (332140): No Recovery paths to report
Info (332140): No Removal paths to report
Info (332146): Worst-case minimum pulse width slack is -1.000
    Info (332119):     Slack       End Point TNS Clock 
    Info (332119): ========= =================== =====================
    Info (332119):    -1.000             -26.000 debounce_cnt[0] 
    Info (332119):    -1.000              -3.000 digit_clk 
    Info (332119):     9.835               0.000 inclk0_sig 
    Info (332119):    29.550               0.000 pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] 
    Info (332119): 124999.747               0.000 pll_lab5_inst|altpll_component|auto_generated|pll1|clk[1] 
Info: Analyzing Slow 1200mV 0C Model
Info (334003): Started post-fitting delay annotation
Info (334004): Delay annotation completed successfully
Info (332123): Deriving Clock Uncertainty. Please refer to report_sdc in TimeQuest to see clock uncertainties.
Critical Warning (332148): Timing requirements not met
    Info (11105): For recommendations on closing timing, run Report Timing Closure Recommendations in the TimeQuest Timing Analyzer.
Info (332146): Worst-case setup slack is -4.693
    Info (332119):     Slack       End Point TNS Clock 
    Info (332119): ========= =================== =====================
    Info (332119):    -4.693             -98.560 pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] 
    Info (332119):    -2.058             -26.608 debounce_cnt[0] 
    Info (332119):    -0.608              -1.746 pll_lab5_inst|altpll_component|auto_generated|pll1|clk[1] 
    Info (332119):    -0.347              -0.693 digit_clk 
Info (332146): Worst-case hold slack is -0.265
    Info (332119):     Slack       End Point TNS Clock 
    Info (332119): ========= =================== =====================
    Info (332119):    -0.265              -0.516 pll_lab5_inst|altpll_component|auto_generated|pll1|clk[1] 
    Info (332119):     0.312               0.000 debounce_cnt[0] 
    Info (332119):     0.318               0.000 digit_clk 
    Info (332119):     0.479               0.000 pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] 
Info (332140): No Recovery paths to report
Info (332140): No Removal paths to report
Info (332146): Worst-case minimum pulse width slack is -1.000
    Info (332119):     Slack       End Point TNS Clock 
    Info (332119): ========= =================== =====================
    Info (332119):    -1.000             -26.000 debounce_cnt[0] 
    Info (332119):    -1.000              -3.000 digit_clk 
    Info (332119):     9.818               0.000 inclk0_sig 
    Info (332119):    29.548               0.000 pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] 
    Info (332119): 124999.743               0.000 pll_lab5_inst|altpll_component|auto_generated|pll1|clk[1] 
Info: Analyzing Fast 1200mV 0C Model
Info (332123): Deriving Clock Uncertainty. Please refer to report_sdc in TimeQuest to see clock uncertainties.
Critical Warning (332148): Timing requirements not met
    Info (11105): For recommendations on closing timing, run Report Timing Closure Recommendations in the TimeQuest Timing Analyzer.
Info (332146): Worst-case setup slack is -3.152
    Info (332119):     Slack       End Point TNS Clock 
    Info (332119): ========= =================== =====================
    Info (332119):    -3.152             -66.595 pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] 
    Info (332119):    -0.853             -10.334 debounce_cnt[0] 
    Info (332119):    -0.325              -0.920 pll_lab5_inst|altpll_component|auto_generated|pll1|clk[1] 
    Info (332119):     0.174               0.000 digit_clk 
Info (332146): Worst-case hold slack is -0.116
    Info (332119):     Slack       End Point TNS Clock 
    Info (332119): ========= =================== =====================
    Info (332119):    -0.116              -0.216 pll_lab5_inst|altpll_component|auto_generated|pll1|clk[1] 
    Info (332119):     0.187               0.000 debounce_cnt[0] 
    Info (332119):     0.194               0.000 digit_clk 
    Info (332119):     0.285               0.000 pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] 
Info (332140): No Recovery paths to report
Info (332140): No Removal paths to report
Info (332146): Worst-case minimum pulse width slack is -1.000
    Info (332119):     Slack       End Point TNS Clock 
    Info (332119): ========= =================== =====================
    Info (332119):    -1.000             -26.000 debounce_cnt[0] 
    Info (332119):    -1.000              -3.000 digit_clk 
    Info (332119):     9.587               0.000 inclk0_sig 
    Info (332119):    29.556               0.000 pll_lab5_inst|altpll_component|auto_generated|pll1|clk[2] 
    Info (332119): 124999.782               0.000 pll_lab5_inst|altpll_component|auto_generated|pll1|clk[1] 
Info (332102): Design is not fully constrained for setup requirements
Info (332102): Design is not fully constrained for hold requirements
Info: Quartus Prime TimeQuest Timing Analyzer was successful. 0 errors, 5 warnings
    Info: Peak virtual memory: 1043 megabytes
    Info: Processing ended: Fri May  6 14:24:16 2016
    Info: Elapsed time: 00:00:01
    Info: Total CPU time (on all processors): 00:00:02


